Datasheet> 器件分类 > 嵌入式处理器和控制器> 微控制器和处理器> 5962-8946302YC

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5962-8946302YC: 产品描述Math Coprocessor, CMOS, CQFP68, CERAMIC, QFP-68; 产品类别嵌入式处理器和控制器微控制器和处理器; 文件大小1MB，共43页; 制造商Atmel (Microchip)

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5962-8946302YC概述

Math Coprocessor, CMOS, CQFP68, CERAMIC, QFP-68

5962-8946302YC规格参数

参数名称	属性值
是否Rohs认证	不符合
零件包装代码	QFP
包装说明	QFP, QFP68,1.1SQ,50
针数	68
Reach Compliance Code	unknown
ECCN代码	3A001.A.2.C
JESD-30 代码	S-CQFP-G68
JESD-609代码	e4
长度	24.13 mm
端子数量	68
最高工作温度	125 °C
最低工作温度	-55 °C
封装主体材料	CERAMIC, METAL-SEALED COFIRED
封装代码	QFP
封装等效代码	QFP68,1.1SQ,50
封装形状	SQUARE
封装形式	FLATPACK
电源	5 V
认证状态	Not Qualified
筛选级别	MIL-STD-883
座面最大高度	3.43 mm
最大压摆率	150 mA
最大供电电压	5.5 V
最小供电电压	4.5 V
标称供电电压	5 V
表面贴装	YES
技术	CMOS
温度等级	MILITARY
端子面层	Gold (Au)
端子形式	GULL WING
端子节距	1.27 mm
端子位置	QUAD
宽度	24.13 mm
uPs/uCs/外围集成电路类型	MATH PROCESSOR, COPROCESSOR
Base Number Matches	1

文档解析

TS68882协处理器是一款为THOMSON TS68000系列微处理器设计的浮点协处理器，它在嵌入式系统设计中提供了一些显著的优势，同时也带来了一些潜在的挑战：

优势：

高性能浮点运算：TS68882提供了一个高性能的浮点运算单元，能够快速处理浮点运算，这对于需要进行大量数值计算的应用（如图形处理、科学计算、信号处理等）非常有利。
符合IEEE 754标准：它完全符合IEEE 754二进制浮点数算术标准，包括所有要求和建议，确保了浮点运算的准确性和一致性。
丰富的指令集：拥有46条指令，包括35条算术操作，支持所有TS68000系列主机微处理器的寻址模式，提供了强大的编程灵活性。
多种数据类型支持：支持多种数据类型，包括字节、字、长整数；单精度、双精度和扩展精度实数；以及打包的二进制编码的十进制字符串实数。
硬件支持多种格式转换：专门设计的硬件可以快速在单精度、双精度、扩展格式和内部扩展格式之间进行转换。
独立状态机：拥有独立的控制主机通信的状态机，为流水线指令处理提供了支持。
与主处理器的全并发指令执行：能够与主处理器全并发执行指令，提高了整体系统的效率。
广泛的适用性：可以使用任何宿主处理器，支持8位、16位或32位的数据总线。
温度范围宽：适用于-55°C至+125°C的温度范围，适合多种环境条件。

挑战：

设计与集成复杂性：协处理器需要与主处理器协同工作，这可能需要复杂的系统集成和调试工作。
功耗和散热问题：高性能的浮点运算可能会增加系统的功耗和散热需求，需要额外的散热解决方案。
成本问题：增加协处理器可能会提高系统的成本，特别是在需要特定封装或特殊处理的情况下。
软件支持和开发工具：可能需要特定的软件支持和开发工具来充分利用协处理器的能力。
学习曲线：开发者需要熟悉协处理器的指令集和编程模型，这可能有一个学习曲线。
兼容性问题：在不同的系统和不同的主处理器之间集成协处理器时，可能需要解决兼容性问题。
维护和升级：随着技术的发展，维护和升级包含协处理器的系统可能更加复杂。
实时性能要求：在需要严格实时性能的系统中，协处理器与主处理器之间的通信和同步可能需要特别设计，以满足实时性要求。

总的来说，TS68882协处理器为嵌入式系统设计提供了强大的浮点运算能力，但同时也需要设计者在系统设计、功耗管理、成本控制和软件开发等方面进行综合考虑。

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Features

•

Eight General-purpose Floating-point Data Registers, Each Supporting a Full 80-bit

•

Extended Precision Real Data Format (a 64-bit Mantissa Plus a Sign Bit, and a 15-bit

Signed Exponent)

A 67-bit Arithmetic Unit to Allow Very Fast Calculations with Intermediate are Precision

Greater than the Extended Precision Format

A 67-bit Barrel Shifter for High-speed Shifting Operations (for Normalizing etc.)

Special-purpose Hardware for High-speed Conversion Between Single, Double, and

Extended Formats and the Internal Extended Format

An Independent State Machine to Control Main Processor Communication for

Pipelined Instruction Processing

Forty-six Instructions, Including 35 Arithmetic Operations

Full Conformation to the IEEE 754 Standard, Including All Requirements and

Suggestions

Support of Functions Not Defined by the IEEE Standard, Including a Full Set of

Trigonometric and Transcendental Functions

Seven Data Type Types: Byte, Word and Long Integers; Single, Double, and Extended

Precision Real Numbers; and Packed Binary Coded Decimal String Real Numbers

Twenty-two Constants Available In The On-chip ROM, Including

π,

e, and Powers of 10

Virtual Memory/Machine Operations

Efficient Mechanisms for Procedure Calls, Context Switches, and Interrupt Handling

Fully Concurrent Instruction Execution with the Main Processor

Fully Concurrent Instruction Execution of Multiple Floating-point Instructions

Use with any Host Processor, on an 8-, 16- or 32-bit Data Bus

Available in 16.67, 20, 25 and 33 MHz for T

from -55°C to +125°C

= 5V

10%

CMOS

Enhanced

Floating-point

Co-processor

TS68882

Description

The TS68882 enhanced floating-point co-processor is a full implementation of the

IEEE Standard for Binary Floating-Point Arithmetic (754) for use with the THOMSON

TS68000 Family of microprocessors. It is a pin and software compatible upgrade of

the TS68881 with optimized MPU interface that provides over 1.5 times the perfor-

mance of the TS68881. It is implemented using VLSI technology to give systems

designers the highest possible functionality in a physically small device.

Intended primarily for use as a co-processor to the TS68020/68030 32-bit micropro-

cessor units (MPUs), the TS68882 provides a logical extension to the main MPU

integer data processing capabilities. It does this by providing a very high performance

floating-point arithmetic unit and a set of floating-point data registers that are utilized

in a manner that is analogous to the use of the integer data registers. The TS68882

instruction set is a natural extension of all earlier members of the TS68000 Family, and

supports all of the addressing modes of the host MPU. Due to the flexible bus inter-

face of the TS68000 Family, the TS68882 can be used with any of the MPU devices of

the TS68000 Family, and it may also be used as a peripheral to non-TS68000

processors.

Screening/Quality

This product could be manufactured

in full compliance with either:

•

MIL-STD-883 Class B

DESC 5962-89436

or According to ATMEL-

Grenoble Standards

Rev. 2119A–HIREL–04/02

R suffix

PGA 68

Ceramic Pin Grid Array

F suffix

CQFP 68

Ceramic Quad Flat Pack

Introduction

The TS68882 is a high-performance floating-point device designed to interface with the

TS68020 or TS68030 as a co-processor. This device fully supports the TS68000 virtual

machine architecture, and is implemented in HCMOS, Atmel’s low power, small geome-

try process. This process allows CMOS and HMOS (high-density NMOS) gates to be

combined on the same device. CMOS structures are used where speed and low power

is required, and HMOS structures are used where minimum silicon area is desired. The

HCMOS technology enables the TS68882 to be very fast while consuming less power

than comparable HMOS, and still have a reasonably small die size.

With some performance degradation, the TS68882 can also be used as a peripheral

processor in systems where the TS68020 or TS68030 is not the main processor (i.e.,

TS68000, TS68010). The configuration of the TS68882 as a peripheral processor or co-

processor may be completely transparent to user software (i.e., the same object code

may be executed in either configuration).

The architecture of the TS68882 appears to the user as a logical extension of the

TS68000 Family architecture. Coupling of the co-processor interface allows the

TS68020/TS68030 programmer to view the TS68882 registers as though the registers

are resident in the TS68020/TS68030. Thus, a TS68020 or TS68030/TS68882 device

pair appears to be one processor that supports seven floating-point and integer data

types, and has eight integer data registers, eight address registers, and eight floating-

point data registers.

As shown in Figure 1, the TS68882 is internally divided into four processing elements;

the Bus Interface Unit (BIU), the Conversion Control Unit (CCU), the Execution Control

Unit (ECU), and the Microcode Control Unit (MCU). The BIU communicates with the

main processor, the CCU controls the main processor communications dialog and per-

forms some data conversions, and the ECU and MCU execute most floating-point

calculations.

The BIU contains the co-processor interface registers, and the 32-bit control, and

instruction address registers. In addition to these registers, the register select and

DSACK timing control logic is contained in the BIU. Finally, the status flags used to mon-

itor the status of communications with the main processor are contained in the BIU.

The CCU contains special-purpose hardware that performs conversions between the

single, double, and extended precision memory data formula and the internal data for-

mat used by the ECU. It also contains a state machine that controls communications

with the main processor during co-processor interface dialogs.

The eight 80-bit floating-point data registers (FP0-FP7) are located in the ECU. In addi-

tion to these registers, the ECU contains a high-speed 67-bit arithmetic unit used for

both mantissa and exponent calculations, a barrel shifter that can shift from 1-bit to 67-

bits in one machine cycle, and ROM constants (for use by the internal algorithms or user

programs).

The MCU contains the clock generator, a two-level microcoded sequencer that controls

the ECU, the microcode ROM, and self-test circuitry. The built-in self-test capabilities of

the TS68882 enhance reliability and ease manufacturing requirements; however, these

diagnostic functions are not available to the user.

TS68882

2119A–HIREL–04/02

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描述	Math Coprocessor, CMOS, CQFP68, CERAMIC, QFP-68	Math Coprocessor, CMOS, CPGA68, CERAMIC, PGA-68	Math Coprocessor, CMOS, CQFP68, CERAMIC, QFP-68	Math Coprocessor, CMOS, CPGA68, CERAMIC, PGA-68	Math Coprocessor, CMOS, CQFP68, CERAMIC, QFP-68	Math Coprocessor, CMOS, CQFP68, CERAMIC, QFP-68	Math Coprocessor, CMOS, CPGA68, CERAMIC, PGA-68	Math Coprocessor, 32-Bit, CMOS, CPGA68, CERAMIC, PGA-68	Math Coprocessor, CMOS, CPGA68, CERAMIC, PGA-68
是否Rohs认证	不符合	不符合	不符合	不符合	不符合	不符合	不符合	不符合	不符合
零件包装代码	QFP	PGA	QFP	PGA	QFP	QFP	PGA	PGA	PGA
包装说明	QFP, QFP68,1.1SQ,50	PGA, PGA68,10X10	QFP, QFP68,1.1SQ,50	PGA, PGA68,10X10	QFP, QFP68,1.1SQ,50	QFP, QFP68,1.1SQ,50	PGA, PGA68,10X10	PGA, PGA68,10X10	PGA, PGA68,10X10
针数	68	68	68	68	68	68	68	68	68
Reach Compliance Code	unknown	unknown	unknown	unknown	compliant	unknown	compliant	unknown	unknown
ECCN代码	3A001.A.2.C	3A001.A.2.C	3A001.A.2.C	3A001.A.2.C	3A001.A.2.C	3A001.A.2.C	3A001.A.2.C	3A001.A.2.C	3A001.A.2.C
JESD-30 代码	S-CQFP-G68	S-CPGA-P68	S-CQFP-G68	S-CPGA-P68	S-CQFP-G68	S-CQFP-G68	S-CPGA-P68	S-CPGA-P68	S-CPGA-P68
JESD-609代码	e4	e4	e4	e4	e0	e4	e0	e4	e4
长度	24.13 mm	26.92 mm	24.13 mm	26.92 mm	24.13 mm	24.13 mm	26.92 mm	26.92 mm	26.92 mm
端子数量	68	68	68	68	68	68	68	68	68
最高工作温度	125 °C	125 °C	125 °C	125 °C	125 °C	125 °C	125 °C	125 °C	125 °C
最低工作温度	-55 °C	-55 °C	-55 °C	-55 °C	-55 °C	-55 °C	-55 °C	-55 °C	-55 °C
封装主体材料	CERAMIC, METAL-SEALED COFIRED	CERAMIC, METAL-SEALED COFIRED	CERAMIC, METAL-SEALED COFIRED	CERAMIC, METAL-SEALED COFIRED	CERAMIC, METAL-SEALED COFIRED	CERAMIC, METAL-SEALED COFIRED	CERAMIC, METAL-SEALED COFIRED	CERAMIC, METAL-SEALED COFIRED	CERAMIC, METAL-SEALED COFIRED
封装代码	QFP	PGA	QFP	PGA	QFP	QFP	PGA	PGA	PGA
封装等效代码	QFP68,1.1SQ,50	PGA68,10X10	QFP68,1.1SQ,50	PGA68,10X10	QFP68,1.1SQ,50	QFP68,1.1SQ,50	PGA68,10X10	PGA68,10X10	PGA68,10X10
封装形状	SQUARE	SQUARE	SQUARE	SQUARE	SQUARE	SQUARE	SQUARE	SQUARE	SQUARE
封装形式	FLATPACK	GRID ARRAY	FLATPACK	GRID ARRAY	FLATPACK	FLATPACK	GRID ARRAY	GRID ARRAY	GRID ARRAY
电源	5 V	5 V	5 V	5 V	5 V	5 V	5 V	5 V	5 V
认证状态	Not Qualified	Not Qualified	Not Qualified	Not Qualified	Not Qualified	Not Qualified	Not Qualified	Not Qualified	Not Qualified
筛选级别	MIL-STD-883	MIL-STD-883	MIL-STD-883	MIL-STD-883	MIL-STD-883	MIL-STD-883	MIL-STD-883	MIL-STD-883	MIL-STD-883
座面最大高度	3.43 mm	4.82 mm	3.43 mm	4.82 mm	3.43 mm	3.43 mm	4.184 mm	4.82 mm	4.82 mm
最大压摆率	150 mA	150 mA	150 mA	150 mA	150 mA	150 mA	150 mA	150 mA	150 mA
最大供电电压	5.5 V	5.5 V	5.5 V	5.5 V	5.5 V	5.5 V	5.5 V	5.5 V	5.5 V
最小供电电压	4.5 V	4.5 V	4.5 V	4.5 V	4.5 V	4.5 V	4.5 V	4.5 V	4.5 V
标称供电电压	5 V	5 V	5 V	5 V	5 V	5 V	5 V	5 V	5 V
表面贴装	YES	NO	YES	NO	YES	YES	NO	NO	NO
技术	CMOS	CMOS	CMOS	CMOS	CMOS	CMOS	CMOS	CMOS	CMOS
温度等级	MILITARY	MILITARY	MILITARY	MILITARY	MILITARY	MILITARY	MILITARY	MILITARY	MILITARY
端子面层	Gold (Au)	Gold (Au)	Gold (Au)	Gold (Au)	Tin/Lead (Sn/Pb) - hot dipped	Gold (Au)	Tin/Lead (Sn/Pb) - hot dipped	Gold (Au)	Gold (Au)
端子形式	GULL WING	PIN/PEG	GULL WING	PIN/PEG	GULL WING	GULL WING	PIN/PEG	PIN/PEG	PIN/PEG
端子节距	1.27 mm	2.54 mm	1.27 mm	2.54 mm	1.27 mm	1.27 mm	2.54 mm	2.54 mm	2.54 mm
端子位置	QUAD	PERPENDICULAR	QUAD	PERPENDICULAR	QUAD	QUAD	PERPENDICULAR	PERPENDICULAR	PERPENDICULAR
宽度	24.13 mm	26.92 mm	24.13 mm	26.92 mm	24.13 mm	24.13 mm	26.92 mm	26.92 mm	26.92 mm
uPs/uCs/外围集成电路类型	MATH PROCESSOR, COPROCESSOR	MATH PROCESSOR, COPROCESSOR	MATH PROCESSOR, COPROCESSOR	MATH PROCESSOR, COPROCESSOR	MATH PROCESSOR, COPROCESSOR	MATH PROCESSOR, COPROCESSOR	MATH PROCESSOR, COPROCESSOR	MATH PROCESSOR, COPROCESSOR	MATH PROCESSOR, COPROCESSOR
Base Number Matches	1	1	1	1	1	1	1	1	1

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