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70121S55JG: 产品描述Dual-Port SRAM, 2KX9, 55ns, CMOS, PQCC52, 0.750 X 0.750 INCH, 0.170 INCH HEIGHT, GREEN, PLASTIC, LCC-52; 产品类别存储存储; 文件大小200KB，共16页; 制造商IDT (Integrated Device Technology); 标准

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70121S55JG概述

Dual-Port SRAM, 2KX9, 55ns, CMOS, PQCC52, 0.750 X 0.750 INCH, 0.170 INCH HEIGHT, GREEN, PLASTIC, LCC-52

70121S55JG规格参数

参数名称	属性值
是否Rohs认证	符合
厂商名称	IDT (Integrated Device Technology)
包装说明	QCCJ, LDCC52,.8SQ
Reach Compliance Code	compliant
Is Samacsys	N
最长访问时间	55 ns
I/O 类型	COMMON
JESD-30 代码	S-PQCC-J52
JESD-609代码	e3
内存密度	18432 bit
内存集成电路类型	DUAL-PORT SRAM
内存宽度	9
湿度敏感等级	1
功能数量	1
端口数量	2
端子数量	52
字数	2048 words
字数代码	2000
工作模式	ASYNCHRONOUS
最高工作温度	70 °C
最低工作温度
组织	2KX9
输出特性	3-STATE
封装主体材料	PLASTIC/EPOXY
封装代码	QCCJ
封装等效代码	LDCC52,.8SQ
封装形状	SQUARE
封装形式	CHIP CARRIER
并行/串行	PARALLEL
峰值回流温度（摄氏度）	NOT SPECIFIED
电源	5 V
认证状态	Not Qualified
最大待机电流	0.015 A
最小待机电流	2 V
最大压摆率	0.24 mA
最大供电电压 (Vsup)	5.5 V
最小供电电压 (Vsup)	4.5 V
标称供电电压 (Vsup)	5 V
表面贴装	YES
技术	CMOS
温度等级	COMMERCIAL
端子面层	Matte Tin (Sn) - annealed
端子形式	J BEND
端子节距	1.27 mm
端子位置	QUAD
处于峰值回流温度下的最长时间	NOT SPECIFIED
Base Number Matches	1

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HIGH-SPEED

2K x 9 DUAL-PORT

STATIC RAM

WITH BUSY & INTERRUPT

Features

✵

◆

IDT70121S/L

IDT70125S/L

◆

High-speed access

– Commercial: 25/35/55ns (max.)

– Industrial: 35ns (max.)

Low-power operation

– IDT70121/70125S

Active: 675mW (typ.)

Standby: 5mW (typ.)

– IDT70121/70125L

Active: 675mW (typ.)

Standby: 1mW (typ.)

◆

Fully asychronous operation from either port

MASTER IDT70121 easily expands data bus width to 18 bits or

more using SLAVE IDT70125 chip

On-chip port arbitration logic (IDT70121 only)

BUSY

output flag on Master;

BUSY

input on Slave

INT

flag for port-to-port communication

Battery backup operation—2V data retention

TTL-compatible, signal 5V (±10%) power supply

Available in 52-pin PLCC

Industrial temperature range (–40°C to +85°C) is available for

selected speeds

Green parts available, see ordering information

Functional Block Diagram

R/W

I/O

- I/O

I/O

Control

BUSY

10L

(1,2)

I/O

-I/O

I/O

Control

BUSY

Address

Decoder

(1,2)

MEMORY

ARRAY

Address

Decoder

10R

R/W

ARBITRATION

INTERRUPT

LOGIC

R/W

INT

(2)

INT

2654 drw 01

(2)

NOTES:

1. 70121 (MASTER):

BUSY

is non-tri-stated push-pull output.

70125 (SLAVE):

BUSY

is input.

INT

is non-tri-stated push-pull output.

AUGUST 2014

DSC 2654/13

70121S55JG相似产品对比

	70121S55JG	70125S35JG8	70125S35JGI8	70125S35JGI	70125S35JG	70125L55JGI8	70125L55JGI	70121S55JG8	70121S55JGI	70121S55JGI8
描述	Dual-Port SRAM, 2KX9, 55ns, CMOS, PQCC52, 0.750 X 0.750 INCH, 0.170 INCH HEIGHT, GREEN, PLASTIC, LCC-52	Dual-Port SRAM, 2KX9, 35ns, CMOS, PQCC52, 0.750 X 0.750 INCH, 0.170 INCH HEIGHT, GREEN, PLASTIC, LCC-52	Dual-Port SRAM, 2KX9, 35ns, CMOS, PQCC52, 0.750 X 0.750 INCH, 0.170 INCH HEIGHT, GREEN, PLASTIC, LCC-52	Dual-Port SRAM, 2KX9, 35ns, CMOS, PQCC52, 0.750 X 0.750 INCH, 0.170 INCH HEIGHT, GREEN, PLASTIC, LCC-52	Dual-Port SRAM, 2KX9, 35ns, CMOS, PQCC52, 0.750 X 0.750 INCH, 0.170 INCH HEIGHT, GREEN, PLASTIC, LCC-52	Dual-Port SRAM	Dual-Port SRAM	Dual-Port SRAM, 2KX9, 55ns, CMOS, PQCC52, 0.750 X 0.750 INCH, 0.170 INCH HEIGHT, GREEN, PLASTIC, LCC-52	Dual-Port SRAM	Dual-Port SRAM
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Reach Compliance Code	compliant	compliant	compliant	compliant	compliant	compliant	compliant	compliant	compliant	compliant
内存集成电路类型	DUAL-PORT SRAM	DUAL-PORT SRAM	DUAL-PORT SRAM	DUAL-PORT SRAM	DUAL-PORT SRAM	DUAL-PORT SRAM	DUAL-PORT SRAM	DUAL-PORT SRAM	DUAL-PORT SRAM	DUAL-PORT SRAM
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