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74FCT388915T100PYG: 产品描述PLL Based Clock Driver, FCT Series, 7 True Output(s), 1 Inverted Output(s), CMOS, PDSO28, GREEN, SSOP-28; 产品类别逻辑逻辑; 文件大小124KB，共12页; 制造商IDT (Integrated Device Technology); 标准

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74FCT388915T100PYG概述

PLL Based Clock Driver, FCT Series, 7 True Output(s), 1 Inverted Output(s), CMOS, PDSO28, GREEN, SSOP-28

74FCT388915T100PYG规格参数

参数名称	属性值
是否无铅	不含铅
是否Rohs认证	符合
厂商名称	IDT (Integrated Device Technology)
零件包装代码	SSOP
包装说明	GREEN, SSOP-28
针数	28
Reach Compliance Code	compliant
其他特性	OUTPUT FREQUENCY RATIOS ARE 0.5F/1.0F/2.0F; MAX PART TO PART SKEW = 1NS
系列	FCT
输入调节	SCHMITT TRIGGER MUX
JESD-30 代码	R-PDSO-G28
JESD-609代码	e3
长度	10.2 mm
逻辑集成电路类型	PLL BASED CLOCK DRIVER
最大I（ol）	0.032 A
湿度敏感等级	1
功能数量	1
反相输出次数	1
端子数量	28
实输出次数	7
最高工作温度	70 °C
最低工作温度
输出特性	3-STATE
封装主体材料	PLASTIC/EPOXY
封装代码	SSOP
封装等效代码	SSOP28,.3
封装形状	RECTANGULAR
封装形式	SMALL OUTLINE, SHRINK PITCH
峰值回流温度（摄氏度）	260
电源	3.3 V
传播延迟（tpd）	1.3 ns
认证状态	Not Qualified
Same Edge Skew-Max（tskwd）	0.8 ns
座面最大高度	1.99 mm
最大供电电压 (Vsup)	3.6 V
最小供电电压 (Vsup)	3 V
标称供电电压 (Vsup)	3.3 V
表面贴装	YES
技术	CMOS
温度等级	COMMERCIAL
端子面层	Matte Tin (Sn) - annealed
端子形式	GULL WING
端子节距	0.65 mm
端子位置	DUAL
处于峰值回流温度下的最长时间	30
宽度	5.3 mm
最小 fmax	100 MHz
Base Number Matches	1

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IDT74FCT388915T

3.3V LOW SKEW PLL-BASED CMOS CLOCK DRIVER (3-STATE)

COMMERCIAL TEMPERATURE RANGE

3.3V LOW SKEW PLL-BASED

CMOS CLOCK DRIVER

(WITH 3-STATE)

NOT RECOMMENDED FOR NEW DESIGNS

IDT74FCT388915T

70/100/133/150

NRND

FEATURES:

• 0.5 MICRON CMOS Technology

• Input frequency range: 10MHz – f2Q Max. spec

(FREQ_SEL = HIGH)

• Max. output frequency: 150MHz

• Pin and function compatible with FCT88915T, MC88915T

• 5 non-inverting outputs, one inverting output, one 2x output,

one ÷2 output; all outputs are TTL-compatible

• 3-State outputs

• Duty cycle distortion < 500ps (max.)

• 32/–16mA drive at CMOS output voltage levels

• V

= 3.3V ± 0.3V

• Inputs can be driven by 3.3V or 5V components

• Available in 28 pin PLCC and SSOP packages

•

NOT RECOMMENDED FOR NEW DESIGNS

DESCRIPTION:

The FCT388915T uses phase-lock loop technology to lock the fre-

quency and phase of outputs to the input reference clock. It provides low

skew clock distribution for high performance PCs and workstations. One of

the outputs is fed back to the PLL at the FEEDBACK input resulting in

essentially zero delay across the device. The PLL consists of the phase/

frequency detector, charge pump, loop filter and VCO. The VCO is

designed for a 2Q operating frequency range of 40MHz to f2Q Max.

The FCT388915T provides 8 outputs, the

output is inverted from the

Q outputs. The 2Q runs at twice the Q frequency and Q/2 runs at half the

Q frequency.

The FREQ_SEL control provides an additional ÷ 2 option in the output

path. PLL _EN allows bypassing of the PLL, which is useful in static test

modes. When PLL_EN is low, SYNC input may be used as a test clock. In

this test mode, the input frequency is not limited to the specified range and

the polarity of outputs is complementary to that in normal operation (PLL_EN

= 1). The LOCK output attains logic HIGH when the PLL is in steady-state

phase and frequency lock. When OE/RST is low, all the outputs are put in

high impedance state and registers at Q,

and Q/2 outputs are reset.

The FCT388915T requires one external loop filter component as

recommended in Figure 3.

FUNCTIONAL BLOCK DIAGRAM

FEED BAC K

Voltage

Controlled

Oscilator

REF_SEL

PLL_EN

M ux

( 1)

LOCK

SYNC (0)

SYNC (1)

Phase/Freq.

Detector

Charge Pum p

Divide

-By-2

FREQ_SEL

OE/RST

( 2)

CP R Q

CP R

Q/2

The IDT logo is a registered trademark of Integrated Device Technology, Inc.

COMMERCIAL TEMPERATURE RANGE

MAY 2013

DSC-4243/7

74FCT388915T100PYG相似产品对比

	74FCT388915T100PYG	74FCT388915T70JG	74FCT388915T133JG	74FCT388915T133PYG	74FCT388915T150JG	74FCT388915T150PYG	74FCT388915T100JG	74FCT388915T70PYG
描述	PLL Based Clock Driver, FCT Series, 7 True Output(s), 1 Inverted Output(s), CMOS, PDSO28, GREEN, SSOP-28	PLL Based Clock Driver, FCT Series, 7 True Output(s), 1 Inverted Output(s), CMOS, PQCC28, GREEN, PLASTIC, LCC-28	PLL Based Clock Driver, FCT Series, 7 True Output(s), 1 Inverted Output(s), CMOS, PQCC28, GREEN, PLASTIC, LCC-28	PLL Based Clock Driver, FCT Series, 7 True Output(s), 1 Inverted Output(s), CMOS, PDSO28, GREEN, SSOP-28	PLL Based Clock Driver, FCT Series, 7 True Output(s), 1 Inverted Output(s), CMOS, PQCC28, GREEN, PLASTIC, LCC-28	PLL Based Clock Driver, FCT Series, 7 True Output(s), 1 Inverted Output(s), CMOS, PDSO28, GREEN, SSOP-28	PLL Based Clock Driver, FCT Series, 7 True Output(s), 1 Inverted Output(s), CMOS, PQCC28, GREEN, PLASTIC, LCC-28	PLL Based Clock Driver, FCT Series, 7 True Output(s), 1 Inverted Output(s), CMOS, PDSO28, GREEN, SSOP-28
是否无铅	不含铅	不含铅	不含铅	不含铅	不含铅	不含铅	不含铅	不含铅
是否Rohs认证	符合	符合	符合	符合	符合	符合	符合	符合
厂商名称	IDT (Integrated Device Technology)	IDT (Integrated Device Technology)	IDT (Integrated Device Technology)	IDT (Integrated Device Technology)	IDT (Integrated Device Technology)	IDT (Integrated Device Technology)	IDT (Integrated Device Technology)	IDT (Integrated Device Technology)
零件包装代码	SSOP	QLCC	QLCC	SSOP	QLCC	SSOP	QLCC	SSOP
包装说明	GREEN, SSOP-28	QCCJ,	GREEN, PLASTIC, LCC-28	GREEN, SSOP-28	QCCJ,	GREEN, SSOP-28	GREEN, PLASTIC, LCC-28	GREEN, SSOP-28
针数	28	28	28	28	28	28	28	28
Reach Compliance Code	compliant	compliant	compliant	compliant	compliant	compliant	compliant	compliant
其他特性	OUTPUT FREQUENCY RATIOS ARE 0.5F/1.0F/2.0F; MAX PART TO PART SKEW = 1NS	OUTPUT FREQUENCY RATIOS ARE 0.5F/1.0F/2.0F; MAX PART TO PART SKEW = 1NS	OUTPUT FREQUENCY RATIOS ARE 0.5F/1.0F/2.0F; MAX PART TO PART SKEW = 1NS	OUTPUT FREQUENCY RATIOS ARE 0.5F/1.0F/2.0F; MAX PART TO PART SKEW = 1NS	OUTPUT FREQUENCY RATIOS ARE 0.5F/1.0F/2.0F; MAX PART TO PART SKEW = 1NS	OUTPUT FREQUENCY RATIOS ARE 0.5F/1.0F/2.0F; MAX PART TO PART SKEW = 1NS	OUTPUT FREQUENCY RATIOS ARE 0.5F/1.0F/2.0F; MAX PART TO PART SKEW = 1NS	OUTPUT FREQUENCY RATIOS ARE 0.5F/1.0F/2.0F; MAX PART TO PART SKEW = 1NS
系列	FCT	FCT	FCT	FCT	FCT	FCT	FCT	FCT
输入调节	SCHMITT TRIGGER MUX	SCHMITT TRIGGER MUX	SCHMITT TRIGGER MUX	SCHMITT TRIGGER MUX	SCHMITT TRIGGER MUX	SCHMITT TRIGGER MUX	SCHMITT TRIGGER MUX	SCHMITT TRIGGER MUX
JESD-30 代码	R-PDSO-G28	S-PQCC-J28	S-PQCC-J28	R-PDSO-G28	S-PQCC-J28	R-PDSO-G28	S-PQCC-J28	R-PDSO-G28
JESD-609代码	e3	e3	e3	e3	e3	e3	e3	e3
长度	10.2 mm	11.5062 mm	11.5062 mm	10.2 mm	11.5062 mm	10.2 mm	11.5062 mm	10.2 mm
逻辑集成电路类型	PLL BASED CLOCK DRIVER	PLL BASED CLOCK DRIVER	PLL BASED CLOCK DRIVER	PLL BASED CLOCK DRIVER	PLL BASED CLOCK DRIVER	PLL BASED CLOCK DRIVER	PLL BASED CLOCK DRIVER	PLL BASED CLOCK DRIVER
功能数量	1	1	1	1	1	1	1	1
反相输出次数	1	1	1	1	1	1	1	1
端子数量	28	28	28	28	28	28	28	28
实输出次数	7	7	7	7	7	7	7	7
最高工作温度	70 °C	70 °C	70 °C	70 °C	70 °C	70 °C	70 °C	70 °C
输出特性	3-STATE	3-STATE	3-STATE	3-STATE	3-STATE	3-STATE	3-STATE	3-STATE
封装主体材料	PLASTIC/EPOXY	PLASTIC/EPOXY	PLASTIC/EPOXY	PLASTIC/EPOXY	PLASTIC/EPOXY	PLASTIC/EPOXY	PLASTIC/EPOXY	PLASTIC/EPOXY
封装代码	SSOP	QCCJ	QCCJ	SSOP	QCCJ	SSOP	QCCJ	SSOP
封装形状	RECTANGULAR	SQUARE	SQUARE	RECTANGULAR	SQUARE	RECTANGULAR	SQUARE	RECTANGULAR
封装形式	SMALL OUTLINE, SHRINK PITCH	CHIP CARRIER	CHIP CARRIER	SMALL OUTLINE, SHRINK PITCH	CHIP CARRIER	SMALL OUTLINE, SHRINK PITCH	CHIP CARRIER	SMALL OUTLINE, SHRINK PITCH
峰值回流温度（摄氏度）	260	260	260	260	260	260	260	260
传播延迟（tpd）	1.3 ns	1.3 ns	1.3 ns	1.3 ns	1.3 ns	1.3 ns	1.3 ns	1.3 ns
认证状态	Not Qualified	Not Qualified	Not Qualified	Not Qualified	Not Qualified	Not Qualified	Not Qualified	Not Qualified
Same Edge Skew-Max（tskwd）	0.8 ns	0.8 ns	0.8 ns	0.8 ns	0.8 ns	0.8 ns	0.8 ns	0.8 ns
座面最大高度	1.99 mm	4.572 mm	4.572 mm	1.99 mm	4.572 mm	1.99 mm	4.572 mm	1.99 mm
最大供电电压 (Vsup)	3.6 V	3.6 V	3.6 V	3.6 V	3.6 V	3.6 V	3.6 V	3.6 V
最小供电电压 (Vsup)	3 V	3 V	3 V	3 V	3 V	3 V	3 V	3 V
标称供电电压 (Vsup)	3.3 V	3.3 V	3.3 V	3.3 V	3.3 V	3.3 V	3.3 V	3.3 V
表面贴装	YES	YES	YES	YES	YES	YES	YES	YES
技术	CMOS	CMOS	CMOS	CMOS	CMOS	CMOS	CMOS	CMOS
温度等级	COMMERCIAL	COMMERCIAL	COMMERCIAL	COMMERCIAL	COMMERCIAL	COMMERCIAL	COMMERCIAL	COMMERCIAL
端子面层	Matte Tin (Sn) - annealed	Matte Tin (Sn)	Matte Tin (Sn)	Matte Tin (Sn) - annealed	Matte Tin (Sn)	Matte Tin (Sn) - annealed	Matte Tin (Sn)	Matte Tin (Sn) - annealed
端子形式	GULL WING	J BEND	J BEND	GULL WING	J BEND	GULL WING	J BEND	GULL WING
端子节距	0.65 mm	1.27 mm	1.27 mm	0.65 mm	1.27 mm	0.65 mm	1.27 mm	0.65 mm
端子位置	DUAL	QUAD	QUAD	DUAL	QUAD	DUAL	QUAD	DUAL
处于峰值回流温度下的最长时间	30	30	30	30	30	30	30	30
宽度	5.3 mm	11.5062 mm	11.5062 mm	5.3 mm	11.5062 mm	5.3 mm	11.5062 mm	5.3 mm
最小 fmax	100 MHz	70 MHz	133 MHz	133 MHz	150 MHz	150 MHz	100 MHz	70 MHz
Base Number Matches	1	1	1	1	1	1	1	1

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