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CMCI-65656V-55

产品描述Standard SRAM, 32KX8, 55ns, CMOS, CDIP28,
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文件大小105KB,共9页
制造商TEMIC
官网地址http://www.temic.de/
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CMCI-65656V-55概述

Standard SRAM, 32KX8, 55ns, CMOS, CDIP28,

CMCI-65656V-55规格参数

参数名称属性值
厂商名称TEMIC
Reach Compliance Codeunknown
最长访问时间55 ns
JESD-30 代码R-CDIP-T28
内存密度262144 bit
内存集成电路类型STANDARD SRAM
内存宽度8
功能数量1
端口数量1
端子数量28
字数32768 words
字数代码32000
工作模式ASYNCHRONOUS
最高工作温度70 °C
最低工作温度
组织32KX8
输出特性3-STATE
可输出YES
封装主体材料CERAMIC, METAL-SEALED COFIRED
封装形状RECTANGULAR
封装形式IN-LINE
并行/串行PARALLEL
认证状态Not Qualified
最小待机电流2 V
最大供电电压 (Vsup)5.5 V
最小供电电压 (Vsup)4.5 V
标称供电电压 (Vsup)5 V
表面贴装NO
技术CMOS
温度等级COMMERCIAL
端子形式THROUGH-HOLE
端子位置DUAL

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MATRA MHS
M 65656
32 K
×
8 Ultimate CMOS SRAM
Description
The M 65656 is a very low power CMOS static RAM
organized as 32768
×
8 bits. It is manufactured using the
MHS high performance CMOS technology named
SCMOS.
With this process, MHS is the first to bring the solution for
applications where fast computing is as mandatory as low
consumption, such as aerospace electronics, portable
instruments or embarked systems.
Using an array of six transistors (6T) memory cells, the
M 65656 combines an extremely low standby supply
current (Typical value = 0.1
µA)
with a fast access time
at 40 ns. The high stability of the 6T cell provides
excellent protection against soft errors due to noise.
Extra protection against heavy ions is given by the use of
an epitaxial layer of a P substrate.
For military/space applications that demand superior
levels of performance and reliability the M 65656 is
processed according to the methods of the latest revision
of the MIL STD 883 (class B or S) and/or ESA SCC 9000.
Features
D
Access time
commercial : 35(*), 40, 45, 55 ns
industrial automotive and military : 40(*), 45, 55 ns
D
Very low power consumption
active : 50 mW (typ)
standby : 0.5
µ
W (typ)
data retention : 0.4
µ
W (typ)
(*) Preliminary. Consult sales.
D
D
D
D
D
D
D
Wide temperature range : –55 to + 125°C
300 and 600 mils width package
TTL compatible inputs and outputs
Asynchronous
Single 5 volt supply
Equal cycle and access time
Gated inputs :
no pull-up/down
resistors are required
Interface
Block Diagram
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