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IS62LV12816L-55T

产品描述Standard SRAM, 128KX16, 55ns, CMOS, PDSO44,
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文件大小458KB,共10页
制造商Integrated Circuit Solution Inc
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IS62LV12816L-55T概述

Standard SRAM, 128KX16, 55ns, CMOS, PDSO44,

IS62LV12816L-55T规格参数

参数名称属性值
是否Rohs认证不符合
包装说明TSOP, TSOP44,.46,32
Reach Compliance Codeunknown
最长访问时间55 ns
I/O 类型COMMON
JESD-30 代码R-PDSO-G44
JESD-609代码e0
内存密度2097152 bit
内存集成电路类型STANDARD SRAM
内存宽度16
端子数量44
字数131072 words
字数代码128000
工作模式ASYNCHRONOUS
最高工作温度70 °C
最低工作温度
组织128KX16
输出特性3-STATE
封装主体材料PLASTIC/EPOXY
封装代码TSOP
封装等效代码TSOP44,.46,32
封装形状RECTANGULAR
封装形式SMALL OUTLINE, THIN PROFILE
并行/串行PARALLEL
电源3/3.3 V
认证状态Not Qualified
最小待机电流1.5 V
最大压摆率0.04 mA
表面贴装YES
技术CMOS
温度等级COMMERCIAL
端子面层Tin/Lead (Sn/Pb)
端子形式GULL WING
端子节距0.8 mm
端子位置DUAL
Base Number Matches1

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IS62LV12816L
IS62LV12816LL
IS62LV12816L
IS62LV12816LL
128K x 16 LOW VOLTAGE, ULTRA
LOW POWER CMOS STATIC RAM
FEATURES
• High-speed access times: 55, 70, 100 ns
•
CMOS low power operation
-- 120 mW (typical) operating
-- 6 µW (typical) CMOS standby
• TTL compatible interface levels
• Single 2.7V-3.6V Vcc power supply
• Fully static operation: no clock or refresh re-
quired
• Three state outputs
• Data control for upper and lower bytes
• Industrial temperature available
• Available in the 44-pin TSOP-2 and 48-pin
6*8mm TF-BGA
DESCRIPTION
The
1+51
IS62LV12816L and IS62LV12816LL are high-speed,
2.097,152-bit static RAMs organized as 131,072 words by 16
bits. They are fabricated using
1+51
's high-performance CMOS
technology. This highly reliable process coupled with innova-
tive circuit design techniques, yields high-performance and
low power consumption devices.
When
CE
is HIGH (deselected) or when
CE
is low and both
LB
and
UB
are HIGH, the device assumes a standby mode at
which the power dissipation can be reduced by using CMOS
input levels.
Easy memory expansion is provided by using Chip Enable
Output and Enable inputs,
CE
and
OE.
The active LOW Write
Enable (WE) controls both writing and reading of the memory.
A data byte allows Upper Byte (UB) and Lower Byte (LB)
access.
The IS62LV12816L and IS62LV12816LL are packaged in the
JEDEC standare 44-pin 400mil TSOP-2 and 48-pin 6*8mm
TF-BGA.
FUNCTIONAL BLOCK DIAGRAM
A0-A16
DECODER
128K x 16
MEMORY ARRAY
VCC
GND
I/O0-I/O7
Lower Byte
I/O8-I/O15
Upper Byte
I/O
DATA
CIRCUIT
COLUMN I/O
CE
OE
WE
UB
LB
CONTROL
CIRCUIT
ICSI reserves the right to make changes to its products at any time without notice in order to improve design and supply the best possible product. We assume no responsibility for any errors
which may appear in this publication. © Copyright 2000, Integrated Circuit Solution Inc.
Integrated Circuit Solution Inc.
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