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5962H9653201VXA

产品描述AND-OR-Invert Gate, AC Series, 1-Func, 8-Input, CMOS, CDFP14, BOTTOM BRAZED, CERAMIC, DFP-14
产品类别逻辑    逻辑   
文件大小137KB,共17页
制造商Cobham PLC
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5962H9653201VXA概述

AND-OR-Invert Gate, AC Series, 1-Func, 8-Input, CMOS, CDFP14, BOTTOM BRAZED, CERAMIC, DFP-14

5962H9653201VXA规格参数

参数名称属性值
包装说明DFP, FL14,.3
Reach Compliance Codeunknown
ECCN代码3A001.A.1.A
系列AC
JESD-30 代码R-XDFP-F14
JESD-609代码e0
长度9.525 mm
逻辑集成电路类型AND-OR-INVERT GATE
最大I(ol)0.008 A
功能数量1
输入次数8
端子数量14
最高工作温度125 °C
最低工作温度-55 °C
封装主体材料CERAMIC, METAL-SEALED COFIRED
封装代码DFP
封装等效代码FL14,.3
封装形状RECTANGULAR
封装形式FLATPACK
电源5 V
Prop。Delay @ Nom-Sup16 ns
传播延迟(tpd)16 ns
认证状态Qualified
施密特触发器NO
筛选级别38535V;38534K;883S
座面最大高度2.921 mm
最大供电电压 (Vsup)5.5 V
最小供电电压 (Vsup)4.5 V
标称供电电压 (Vsup)5 V
表面贴装YES
技术CMOS
温度等级MILITARY
端子面层TIN LEAD
端子形式FLAT
端子节距1.27 mm
端子位置DUAL
总剂量1M Rad(Si) V
宽度6.2865 mm
Base Number Matches1

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REVISIONS
LTR
A
B
C
DESCRIPTION
Changes in accordance with NOR 5962-R114-97.
Incorporate Revision A. Update boilerplate to MIL-PRF-38535 requirements. –
LTG
Correct the title to accurately describe the device function. Update boilerplate
to the latest MIL-PRF-38535 requirements. - jak
DATE (YR-MO-DA)
96-12-12
01-09-04
07-11-21
APPROVED
Monica L. Poelking
Thomas M. Hess
Thomas M. Hess
REV
SHEET
REV
SHEET
REV STATUS
OF SHEETS
PMIC N/A
C
15
C
16
REV
SHEET
PREPARED BY
Thanh V. Nguyen
C
1
C
2
C
3
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4
C
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6
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C
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C
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C
14
STANDARD
MICROCIRCUIT
DRAWING
THIS DRAWING IS AVAILABLE
FOR USE BY ALL
DEPARTMENTS
AND AGENCIES OF THE
DEPARTMENT OF DEFENSE
AMSC N/A
CHECKED BY
Thanh V. Nguyen
DEFENSE SUPPLY CENTER COLUMBUS
COLUMBUS, OHIO 43218-3990
http://www.dscc.dla.mil
APPROVED BY
Monica L. Poelking
DRAWING APPROVAL DATE
96-04-05
REVISION LEVEL
C
MICROCIRCUIT, DIGITAL, ADVANCED CMOS,
RADIATION HARDENED, 4-WIDE 2-INPUT AND-
OR-INVERT GATE, MONOLITHIC SILICON
SIZE
A
SHEET
CAGE CODE
67268
1 OF
16
5962-96532
DSCC FORM 2233
APR 97
.
5962-E399-07

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描述 AND-OR-Invert Gate, AC Series, 1-Func, 8-Input, CMOS, CDFP14, BOTTOM BRAZED, CERAMIC, DFP-14 AND-OR-Invert Gate, AC Series, 1-Func, 8-Input, CMOS, CDFP14, BOTTOM BRAZED, CERAMIC, DFP-14 AND-OR-Invert Gate, AC Series, 1-Func, 8-Input, CMOS, CDFP14, BOTTOM BRAZED, CERAMIC, DFP-14 AND-OR-Invert Gate, AC Series, 1-Func, 8-Input, CMOS, CDIP14, SIDE BRAZED, CERAMIC, DIP-14 AND-OR-Invert Gate, AC Series, 1-Func, 8-Input, CMOS, CDIP14, SIDE BRAZED, CERAMIC, DIP-14 AND-OR-Invert Gate, AC Series, 1-Func, 8-Input, CMOS, CDFP14, BOTTOM BRAZED, CERAMIC, DFP-14 AND-OR-Invert Gate, AC Series, 1-Func, 8-Input, CMOS, CDIP14, SIDE BRAZED, CERAMIC, DIP-14 AND-OR-Invert Gate, AC Series, 1-Func, 8-Input, CMOS, CDIP14, SIDE BRAZED, CERAMIC, DIP-14
包装说明 DFP, FL14,.3 DFP, FL14,.3 DFP, FL14,.3 DIP, DIP14,.3 DIP, DIP14,.3 DFP, FL14,.3 DIP, DIP14,.3 DIP, DIP14,.3
Reach Compliance Code unknown unknown unknown unknown unknown unknown unknown unknown
ECCN代码 3A001.A.1.A 3A001.A.1.A 3A001.A.1.A 3A001.A.1.A 3A001.A.1.A 3A001.A.1.A 3A001.A.1.A 3A001.A.1.A
系列 AC AC AC AC AC AC AC AC
JESD-30 代码 R-XDFP-F14 R-XDFP-F14 R-XDFP-F14 R-XDIP-T14 R-XDIP-T14 R-XDFP-F14 R-XDIP-T14 R-XDIP-T14
JESD-609代码 e0 e0 e4 e4 e4 e4 e0 e0
长度 9.525 mm 9.525 mm 9.525 mm 19.43 mm 19.43 mm 9.525 mm 19.43 mm 19.43 mm
逻辑集成电路类型 AND-OR-INVERT GATE AND-OR-INVERT GATE AND-OR-INVERT GATE AND-OR-INVERT GATE AND-OR-INVERT GATE AND-OR-INVERT GATE AND-OR-INVERT GATE AND-OR-INVERT GATE
最大I(ol) 0.008 A 0.008 A 0.008 A 0.008 A 0.008 A 0.008 A 0.008 A 0.008 A
功能数量 1 1 1 1 1 1 1 1
输入次数 8 8 8 8 8 8 8 8
端子数量 14 14 14 14 14 14 14 14
最高工作温度 125 °C 125 °C 125 °C 125 °C 125 °C 125 °C 125 °C 125 °C
最低工作温度 -55 °C -55 °C -55 °C -55 °C -55 °C -55 °C -55 °C -55 °C
封装主体材料 CERAMIC, METAL-SEALED COFIRED CERAMIC, METAL-SEALED COFIRED CERAMIC, METAL-SEALED COFIRED CERAMIC, METAL-SEALED COFIRED CERAMIC, METAL-SEALED COFIRED CERAMIC, METAL-SEALED COFIRED CERAMIC, METAL-SEALED COFIRED CERAMIC, METAL-SEALED COFIRED
封装代码 DFP DFP DFP DIP DIP DFP DIP DIP
封装等效代码 FL14,.3 FL14,.3 FL14,.3 DIP14,.3 DIP14,.3 FL14,.3 DIP14,.3 DIP14,.3
封装形状 RECTANGULAR RECTANGULAR RECTANGULAR RECTANGULAR RECTANGULAR RECTANGULAR RECTANGULAR RECTANGULAR
封装形式 FLATPACK FLATPACK FLATPACK IN-LINE IN-LINE FLATPACK IN-LINE IN-LINE
电源 5 V 5 V 5 V 5 V 5 V 5 V 5 V 5 V
Prop。Delay @ Nom-Sup 16 ns 16 ns 16 ns 16 ns 16 ns 16 ns 16 ns 16 ns
传播延迟(tpd) 16 ns 16 ns 16 ns 16 ns 16 ns 16 ns 16 ns 16 ns
认证状态 Qualified Qualified Qualified Qualified Qualified Qualified Qualified Qualified
施密特触发器 NO NO NO NO NO NO NO NO
筛选级别 38535V;38534K;883S 38535Q/M;38534H;883B 38535Q/M;38534H;883B 38535Q/M;38534H;883B 38535V;38534K;883S 38535V;38534K;883S 38535Q/M;38534H;883B 38535V;38534K;883S
座面最大高度 2.921 mm 2.921 mm 2.921 mm 5.08 mm 5.08 mm 2.921 mm 5.08 mm 5.08 mm
最大供电电压 (Vsup) 5.5 V 5.5 V 5.5 V 5.5 V 5.5 V 5.5 V 5.5 V 5.5 V
最小供电电压 (Vsup) 4.5 V 4.5 V 4.5 V 4.5 V 4.5 V 4.5 V 4.5 V 4.5 V
标称供电电压 (Vsup) 5 V 5 V 5 V 5 V 5 V 5 V 5 V 5 V
表面贴装 YES YES YES NO NO YES NO NO
技术 CMOS CMOS CMOS CMOS CMOS CMOS CMOS CMOS
温度等级 MILITARY MILITARY MILITARY MILITARY MILITARY MILITARY MILITARY MILITARY
端子面层 TIN LEAD TIN LEAD GOLD GOLD GOLD GOLD TIN LEAD TIN LEAD
端子形式 FLAT FLAT FLAT THROUGH-HOLE THROUGH-HOLE FLAT THROUGH-HOLE THROUGH-HOLE
端子节距 1.27 mm 1.27 mm 1.27 mm 2.54 mm 2.54 mm 1.27 mm 2.54 mm 2.54 mm
端子位置 DUAL DUAL DUAL DUAL DUAL DUAL DUAL DUAL
总剂量 1M Rad(Si) V 1M Rad(Si) V 1M Rad(Si) V 1M Rad(Si) V 1M Rad(Si) V 1M Rad(Si) V 1M Rad(Si) V 1M Rad(Si) V
宽度 6.2865 mm 6.2865 mm 6.2865 mm 7.62 mm 7.62 mm 6.2865 mm 7.62 mm 7.62 mm
Base Number Matches 1 1 1 1 1 1 1 1
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