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GAL16V8A-20LD/883

产品描述EE PLD, 20ns, PAL-Type, CMOS, CDIP20, CERDIP-20
产品类别可编程逻辑器件    可编程逻辑   
文件大小364KB,共10页
制造商Lattice(莱迪斯)
官网地址http://www.latticesemi.com
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GAL16V8A-20LD/883概述

EE PLD, 20ns, PAL-Type, CMOS, CDIP20, CERDIP-20

GAL16V8A-20LD/883规格参数

参数名称属性值
是否Rohs认证不符合
零件包装代码DIP
包装说明CERDIP-20
针数20
Reach Compliance Codeunknown
ECCN代码EAR99
其他特性PAL WITH MACROCELLS; 8 MACROCELLS; REGISTER PRELOAD; POWER-UP RESET; SHARED INPUT/CLOCK
架构PAL-TYPE
最大时钟频率33.3 MHz
JESD-30 代码R-GDIP-T20
JESD-609代码e0
长度25.27 mm
湿度敏感等级1
专用输入次数8
I/O 线路数量8
输入次数18
输出次数8
产品条款数64
端子数量20
最高工作温度125 °C
最低工作温度-55 °C
组织8 DEDICATED INPUTS, 8 I/O
输出函数MACROCELL
封装主体材料CERAMIC, GLASS-SEALED
封装代码DIP
封装等效代码DIP20,.3
封装形状RECTANGULAR
封装形式IN-LINE
峰值回流温度(摄氏度)NOT SPECIFIED
电源5 V
可编程逻辑类型EE PLD
传播延迟20 ns
认证状态Not Qualified
筛选级别38535Q/M;38534H;883B
座面最大高度5.08 mm
最大供电电压5.5 V
最小供电电压4.5 V
标称供电电压5 V
表面贴装NO
技术CMOS
温度等级MILITARY
端子面层Tin/Lead (Sn/Pb)
端子形式THROUGH-HOLE
端子节距2.54 mm
端子位置DUAL
处于峰值回流温度下的最长时间NOT SPECIFIED
宽度7.62 mm
Base Number Matches1

GAL16V8A-20LD/883相似产品对比

GAL16V8A-20LD/883 5962-8983903RX 5962-89839022X 5962-89839032X GAL16V8A-20LR/883 GAL16V8A-30LD/883 5962-8983902RX
描述 EE PLD, 20ns, PAL-Type, CMOS, CDIP20, CERDIP-20 EE PLD, 15ns, CMOS, CDIP20, CERDIP-20 EE PLD, 20ns, CMOS, CQCC20, LCC-20 EE PLD, 15ns, CMOS, CQCC20, LCC-20 EE PLD, 20ns, PAL-Type, CMOS, CQCC20, LCC-20 EE PLD, 30ns, PAL-Type, CMOS, CDIP20, CERDIP-20 EE PLD, 20ns, CMOS, CDIP20, CERDIP-20
零件包装代码 DIP DIP QLCC QLCC QLCC DIP DIP
包装说明 CERDIP-20 DIP, QCCN, QCCN, LCC-20 CERDIP-20 DIP,
针数 20 20 20 20 20 20 20
Reach Compliance Code unknown unknown unknown unknown unknown unknown unknown
ECCN代码 EAR99 EAR99 EAR99 EAR99 EAR99 EAR99 EAR99
其他特性 PAL WITH MACROCELLS; 8 MACROCELLS; REGISTER PRELOAD; POWER-UP RESET; SHARED INPUT/CLOCK 1 EXTERNAL CLOCK; REGISTER PRELOAD 1 EXTERNAL CLOCK; REGISTER PRELOAD 1 EXTERNAL CLOCK; REGISTER PRELOAD PAL WITH MACROCELLS; 8 MACROCELLS; REGISTER PRELOAD; POWER-UP RESET; SHARED INPUT/CLOCK PAL WITH MACROCELLS; 8 MACROCELLS; REGISTER PRELOAD; POWER-UP RESET; SHARED INPUT/CLOCK 1 EXTERNAL CLOCK; REGISTER PRELOAD
最大时钟频率 33.3 MHz 41.6 MHz 33.3 MHz 41.6 MHz 33.3 MHz 22.2 MHz 33.3 MHz
JESD-30 代码 R-GDIP-T20 R-GDIP-T20 S-CQCC-N20 S-CQCC-N20 S-CQCC-N20 R-GDIP-T20 R-GDIP-T20
长度 25.27 mm 25.27 mm 8.89 mm 8.89 mm 8.89 mm 25.27 mm 25.27 mm
专用输入次数 8 8 8 8 8 8 8
I/O 线路数量 8 8 8 8 8 8 8
端子数量 20 20 20 20 20 20 20
最高工作温度 125 °C 125 °C 125 °C 125 °C 125 °C 125 °C 125 °C
最低工作温度 -55 °C -55 °C -55 °C -55 °C -55 °C -55 °C -55 °C
组织 8 DEDICATED INPUTS, 8 I/O 8 DEDICATED INPUTS, 8 I/O 8 DEDICATED INPUTS, 8 I/O 8 DEDICATED INPUTS, 8 I/O 8 DEDICATED INPUTS, 8 I/O 8 DEDICATED INPUTS, 8 I/O 8 DEDICATED INPUTS, 8 I/O
输出函数 MACROCELL MACROCELL MACROCELL MACROCELL MACROCELL MACROCELL MACROCELL
封装主体材料 CERAMIC, GLASS-SEALED CERAMIC, GLASS-SEALED CERAMIC, METAL-SEALED COFIRED CERAMIC, METAL-SEALED COFIRED CERAMIC, METAL-SEALED COFIRED CERAMIC, GLASS-SEALED CERAMIC, GLASS-SEALED
封装代码 DIP DIP QCCN QCCN QCCN DIP DIP
封装形状 RECTANGULAR RECTANGULAR SQUARE SQUARE SQUARE RECTANGULAR RECTANGULAR
封装形式 IN-LINE IN-LINE CHIP CARRIER CHIP CARRIER CHIP CARRIER IN-LINE IN-LINE
可编程逻辑类型 EE PLD EE PLD EE PLD EE PLD EE PLD EE PLD EE PLD
传播延迟 20 ns 15 ns 20 ns 15 ns 20 ns 30 ns 20 ns
认证状态 Not Qualified Not Qualified Not Qualified Not Qualified Not Qualified Not Qualified Not Qualified
座面最大高度 5.08 mm 5.08 mm 2.54 mm 2.54 mm 2.54 mm 5.08 mm 5.08 mm
最大供电电压 5.5 V 5.5 V 5.5 V 5.5 V 5.5 V 5.5 V 5.5 V
最小供电电压 4.5 V 4.5 V 4.5 V 4.5 V 4.5 V 4.5 V 4.5 V
标称供电电压 5 V 5 V 5 V 5 V 5 V 5 V 5 V
表面贴装 NO NO YES YES YES NO NO
技术 CMOS CMOS CMOS CMOS CMOS CMOS CMOS
温度等级 MILITARY MILITARY MILITARY MILITARY MILITARY MILITARY MILITARY
端子形式 THROUGH-HOLE THROUGH-HOLE NO LEAD NO LEAD NO LEAD THROUGH-HOLE THROUGH-HOLE
端子节距 2.54 mm 2.54 mm 1.27 mm 1.27 mm 1.27 mm 2.54 mm 2.54 mm
端子位置 DUAL DUAL QUAD QUAD QUAD DUAL DUAL
宽度 7.62 mm 7.62 mm 8.89 mm 8.89 mm 8.89 mm 7.62 mm 7.62 mm
Base Number Matches 1 1 1 1 1 1 1
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