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74ABT2541CMTC

产品描述IC BUF NON-INVERT 5.5V 20TSSOP
产品类别半导体    逻辑   
文件大小111KB,共9页
制造商ON Semiconductor(安森美)
官网地址http://www.onsemi.cn
标准
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74ABT2541CMTC在线购买

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74ABT2541CMTC概述

IC BUF NON-INVERT 5.5V 20TSSOP

74ABT2541CMTC规格参数

参数名称属性值
逻辑类型缓冲器,非反向
元件数1
每元件位数8
输出类型三态
电流 - 输出高,低32mA,15mA
电压 - 电源4.5 V ~ 5.5 V
工作温度-40°C ~ 85°C(TA)
安装类型表面贴装
封装/外壳20-TSSOP(0.173",4.40mm 宽)
供应商器件封装20-TSSOP

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74ABT2541 Octal Buffer/Line Driver with 25: Series Resistors in the Outputs
September 1992
Revised March 2005
74ABT2541
Octal Buffer/Line Driver with
25: Series Resistors in the Outputs
General Description
The ABT2541 is an octal buffer and line driver designed to
drive the capacitive inputs of MOS memory drivers,
address drivers, clock drivers, and bus-oriented transmit-
ters/receivers. Functionally identical to the ABT541.
The 25
:
series resistors in the outputs reduce ringing and
eliminate the need for external resistors.
Features
s
Guaranteed output skew
s
Guaranteed multiple output switching specifications
s
Output switching specified for both 50 pF and
250 pF loads
s
Guaranteed simultaneously switching noise level and
dynamic threshold performance
s
Guaranteed latchup protection
s
High impedance glitch free bus loading during entire
power up and power down cycle
s
Nondestructive hot insertion capability
s
Disable time less than enable time to avoid bus
contention
Ordering Code:
Order Number
74ABT2541CSC
74ABT2541CSJ
74ABT2541CMSA
74ABT2541CMTC
Package Number
M20B
M20D
MSA20
MTC20
Package Description
20-Lead Small Outline Integrated Circuit (SOIC), JEDEC MS-013, 0.300" Wide
Pb-Free 20-Lead Small Outline Package (SOP), EIAJ TYPE II, 5.3mm Wide
20-Lead Shrink Small Outline Package (SSOP), JEDEC MO-150, 5.3mm Wide
20-Lead Thin Shrink Small Outline Package (TSSOP), JEDEC MO-153, 4.4mm Wide
Devices also available in Tape and Reel. Specify by appending “X” to the ordering code.
Pb-Free package per JEDEC J-STD-020B.
Connection Diagram
Pin Descriptions
Pin Names
OE
1
, OE
2
I
0
–I
7
O
0
–O
7
Description
Output Enable Input (Active LOW)
Inputs
Outputs
Truth Table
Inputs
Outputs
I
H
X
X
L
H
Z
Z
L
Schematic of Each Output
OE
1
L
H
X
L
H HIGH Voltage Level
L LOW Voltage Level
X Immaterial
Z High Impedance
OE
2
L
X
H
L
© 2005 Fairchild Semiconductor Corporation
DS011502
www.fairchildsemi.com
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