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74ALVCH16543DGGS: 产品描述IC TXRX NON-INVERT 3.6V 56TSSOP; 产品类别逻辑逻辑; 文件大小194KB，共17页; 制造商Nexperia; 官网地址https://www.nexperia.com

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74ALVCH16543DGGS概述

IC TXRX NON-INVERT 3.6V 56TSSOP

74ALVCH16543DGGS规格参数

参数名称	属性值
Brand Name	Nexperia
厂商名称	Nexperia
零件包装代码	TSSOP
包装说明	TSSOP,
针数	56
制造商包装代码	SOT364-1
Reach Compliance Code	compliant
Samacsys Description	74ALVCH16543 - 16-bit D-type registered transceiver; 3-state@en-us
其他特性	INDEPENDENT OUTPUT ENABLE FOR EACH DIRECTION; MASTER CONTROL FOR LATCH
系列	ALVC/VCX/A
JESD-30 代码	R-PDSO-G56
JESD-609代码	e4
长度	14 mm
逻辑集成电路类型	REGISTERED BUS TRANSCEIVER
湿度敏感等级	2
位数	8
功能数量	2
端口数量	2
端子数量	56
最高工作温度	85 °C
最低工作温度	-40 °C
输出特性	3-STATE
输出极性	TRUE
封装主体材料	PLASTIC/EPOXY
封装代码	TSSOP
封装形状	RECTANGULAR
封装形式	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
峰值回流温度（摄氏度）	260
传播延迟（tpd）	6.5 ns
座面最大高度	1.2 mm
最大供电电压 (Vsup)	3.6 V
最小供电电压 (Vsup)	1.2 V
标称供电电压 (Vsup)	2.4 V
表面贴装	YES
技术	CMOS
温度等级	INDUSTRIAL
端子面层	Nickel/Palladium/Gold (Ni/Pd/Au)
端子形式	GULL WING
端子节距	0.5 mm
端子位置	DUAL
处于峰值回流温度下的最长时间	30
宽度	6.1 mm

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74ALVCH16543

Rev. 3 — 15 December 2017

16-bit D-type registered transceiver; 3-state

Product data sheet

General description

The 74ALVCH16543 is a dual octal registered transceiver. Each section contains two

sets of D-type latches for temporary storage of the data flow in either direction.

Separate latch enable (nLEAB, nLEBA) and output enable (nOEAB, nOEBA) inputs are

provided for each register to permit independent control in either direction of the data

flow.

The 74ALVCH16543 contains two sections each consisting of two sets of eight D-type

latches with separate inputs and controls for each set. For data flow from A to B,

for example, the A-to-B enable (nEAB) inputs must be LOW in order to enter

data from nA0 to nA7, or take data from nB0 to nB7, as indicated in the function

table. With nEAB LOW, a LOW signal on the A-to-B latch enable (nLEAB) input

makes the A-to-B latches transparent; a subsequent LOW-to-HIGH transition of the

nLEAB signal stores the A data into the latches. With nEAB and nOEAB both LOW,

the 3-state B output buffers are active and display the data present at the output of

the A latches. Similarly, the nEBA, nLEBA and nOEBA signals control the data flow

from B-to-A.

Active bus hold circuitry is provided to hold unused or floating data inputs at a valid logic

level.

Features and benefits

•

CMOS low power consumption

Direct interface with TTL levels

MULTIBYTE flow-through standard pin-out architecture

Back-to-back registers for storage

Output drive capability 50 Ω transmission lines at 85 °C

All data inputs have bushold

Low inductance multiple V

and GND pins for minimize noise and ground bounce

Current drive ±24 mA at V

= 3.0 V.

3-state non-inverting outputs for bus oriented applications

Complies with JEDEC standards:

–

JESD8-5 (2.3 V to 2.7 V)

–

JESD8B/JESD36 (2.7 V to 3.6 V)

•

ESD protection:

–

HBM ANSI/ESDA/JEDEC JS-001 exceeds 2000 V

–

CDM JESD22-C101E exceeds 1000 V

74ALVCH16543DGGS相似产品对比

	74ALVCH16543DGGS	74ALVCH16543DGGY	74ALVCH16543DGG:11
描述	IC TXRX NON-INVERT 3.6V 56TSSOP	IC TXRX NON-INVERT 3.6V 56TSSOP	74ALVCH16543 - 16-bit D-type registered transceiver; 3-state TSSOP 56-Pin
Brand Name	Nexperia	Nexperia	Nexperia
零件包装代码	TSSOP	TSSOP	TSSOP
包装说明	TSSOP,	TSSOP,	TSSOP,
针数	56	56	56
制造商包装代码	SOT364-1	SOT364-1	SOT364-1
其他特性	INDEPENDENT OUTPUT ENABLE FOR EACH DIRECTION; MASTER CONTROL FOR LATCH	INDEPENDENT OUTPUT ENABLE FOR EACH DIRECTION; MASTER CONTROL FOR LATCH	INDEPENDENT OUTPUT ENABLE FOR EACH DIRECTION; MASTER CONTROL FOR LATCH
系列	ALVC/VCX/A	ALVC/VCX/A	ALVC/VCX/A
JESD-30 代码	R-PDSO-G56	R-PDSO-G56	R-PDSO-G56
JESD-609代码	e4	e4	e4
长度	14 mm	14 mm	14 mm
逻辑集成电路类型	REGISTERED BUS TRANSCEIVER	REGISTERED BUS TRANSCEIVER	REGISTERED BUS TRANSCEIVER
湿度敏感等级	2	2	1
位数	8	8	8
功能数量	2	2	2
端口数量	2	2	2
端子数量	56	56	56
最高工作温度	85 °C	85 °C	85 °C
最低工作温度	-40 °C	-40 °C	-40 °C
输出特性	3-STATE	3-STATE	3-STATE
输出极性	TRUE	TRUE	TRUE
封装主体材料	PLASTIC/EPOXY	PLASTIC/EPOXY	PLASTIC/EPOXY
封装代码	TSSOP	TSSOP	TSSOP
封装形状	RECTANGULAR	RECTANGULAR	RECTANGULAR
封装形式	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
峰值回流温度（摄氏度）	260	260	260
传播延迟（tpd）	6.5 ns	6.5 ns	6.5 ns
座面最大高度	1.2 mm	1.2 mm	1.2 mm
最大供电电压 (Vsup)	3.6 V	3.6 V	3.6 V
最小供电电压 (Vsup)	1.2 V	1.2 V	1.2 V
标称供电电压 (Vsup)	2.4 V	2.4 V	2.4 V
表面贴装	YES	YES	YES
技术	CMOS	CMOS	CMOS
温度等级	INDUSTRIAL	INDUSTRIAL	INDUSTRIAL
端子面层	Nickel/Palladium/Gold (Ni/Pd/Au)	Nickel/Palladium/Gold (Ni/Pd/Au)	Nickel/Palladium/Gold (Ni/Pd/Au)
端子形式	GULL WING	GULL WING	GULL WING
端子节距	0.5 mm	0.5 mm	0.5 mm
端子位置	DUAL	DUAL	DUAL
处于峰值回流温度下的最长时间	30	30	30
宽度	6.1 mm	6.1 mm	6.1 mm
厂商名称	Nexperia	Nexperia	-
Reach Compliance Code	compliant	compliant	-
Samacsys Description	74ALVCH16543 - 16-bit D-type registered transceiver; 3-state@en-us	74ALVCH16543 - 16-bit D-type registered transceiver; 3-state@en-us	-

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