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Datasheet> 器件分类 > 可编程逻辑器件> 可编程逻辑> EP20K1000CF672C9

EP20K1000CF672C9: 产品描述FPGA - Field Programmable Gate Array CPLD - APEX 20K 2560 Macro 508 IOs; 产品类别可编程逻辑器件可编程逻辑; 文件大小531KB，共91页; 制造商Altera (Intel)

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EP20K1000CF672C9概述

FPGA - Field Programmable Gate Array CPLD - APEX 20K 2560 Macro 508 IOs

EP20K1000CF672C9规格参数

参数名称	属性值
是否无铅	含铅
是否Rohs认证	不符合
厂商名称	Altera (Intel)
零件包装代码	BGA
包装说明	27 X 27 MM, 1 MM PITCH, FBGA-672
针数	672
Reach Compliance Code	compliant
ECCN代码	3A001.A.7.A
JESD-30 代码	S-PBGA-B672
JESD-609代码	e0
长度	27 mm
湿度敏感等级	3
专用输入次数	4
I/O 线路数量	508
输入次数	500
逻辑单元数量	38400
输出次数	500
端子数量	672
最高工作温度	85 °C
最低工作温度
组织	4 DEDICATED INPUTS, 508 I/O
输出函数	MACROCELL
封装主体材料	PLASTIC/EPOXY
封装代码	BGA
封装等效代码	BGA672,26X26,40
封装形状	SQUARE
封装形式	GRID ARRAY
峰值回流温度（摄氏度）	220
电源	1.8,1.8/3.3 V
可编程逻辑类型	LOADABLE PLD
传播延迟	2.02 ns
认证状态	Not Qualified
座面最大高度	3.5 mm
最大供电电压	1.89 V
最小供电电压	1.71 V
标称供电电压	1.8 V
表面贴装	YES
技术	CMOS
温度等级	OTHER
端子面层	Tin/Lead (Sn/Pb)
端子形式	BALL
端子节距	1 mm
端子位置	BOTTOM
处于峰值回流温度下的最长时间	30
宽度	27 mm

EP20K1000CF672C9相似产品对比

	EP20K1000CF672C9	EP20K400CF672C9	EP20K1000CB652C7	EP20K1000CF672C7N	EP20K400CF672C8	EP20K600CB652C9	EP20K600CF672I8	EP20K600CF672C9	EP20K600CF672C7	EP20K1000CF33C8
描述	FPGA - Field Programmable Gate Array CPLD - APEX 20K 2560 Macro 508 IOs	FPGA - Field Programmable Gate Array CPLD - APEX 20K 1664 Macro 488 IOs	FPGA - Field Programmable Gate Array CPLD - APEX 20K 2560 Macros 488 IO	FPGA - Field Programmable Gate Array CPLD - APEX 20K 2560 Macros 508 IO	FPGA - Field Programmable Gate Array CPLD - APEX 20K 1664 Macros 488 IO	FPGA - Field Programmable Gate Array CPLD - APEX 20K 2432 Macro 488 IOs	FPGA - Field Programmable Gate Array CPLD - APEX 20K 2432 Macros 508 IO	FPGA - Field Programmable Gate Array CPLD - APEX 20K 2432 Macro 508 IOs	FPGA - Field Programmable Gate Array CPLD - APEX 20K 2432 Macros 508 IO	FPGA - Field Programmable Gate Array CPLD - APEX 20K 2560 Macros 1.8 V
是否无铅	含铅	含铅	含铅	不含铅	含铅	含铅	含铅	含铅	含铅	含铅
是否Rohs认证	不符合	不符合	不符合	符合	不符合	不符合	不符合	不符合	不符合	不符合
厂商名称	Altera (Intel)	Altera (Intel)	Altera (Intel)	Altera (Intel)	Altera (Intel)	Altera (Intel)	Altera (Intel)	Altera (Intel)	Altera (Intel)	Altera (Intel)
零件包装代码	BGA	BGA	BGA	BGA	BGA	BGA	BGA	BGA	BGA	BGA
包装说明	27 X 27 MM, 1 MM PITCH, FBGA-672	27 X 27 MM, 1 MM PITCH, FBGA-672	45 X 45 MM, 1.27 MM PITCH, BGA-652	BGA,	27 X 27 MM, 1 MM PITCH, FBGA-672	45 X 45 MM, 1.27 MM PITCH, BGA-652	27 X 27 MM, 1 MM PITCH, FBGA-672	27 X 27 MM, 1 MM PITCH, FBGA-672	27 X 27 MM, 1 MM PITCH, FBGA-672	33 X 33 MM, 1 MM PITCH, FBGA-1020
针数	672	672	652	672	672	652	672	672	672	1020
Reach Compliance Code	compliant	compliant	compliant	compliant	compliant	compliant	not_compliant	not_compliant	not_compliant	not_compliant
ECCN代码	3A001.A.7.A	3A001.A.7.A	3A001.A.7.A	3A001.A.7.A	3A001.A.7.A	3A001.A.7.A	3A001.A.7.A	3A001.A.7.A	3A001.A.7.A	3A001.A.7.A
JESD-30 代码	S-PBGA-B672	S-PBGA-B672	S-PBGA-B652	S-PBGA-B672	S-PBGA-B672	S-PBGA-B652	S-PBGA-B672	S-PBGA-B672	S-PBGA-B672	S-PBGA-B1020
JESD-609代码	e0	e0	e0	e1	e0	e0	e0	e0	e0	e0
长度	27 mm	27 mm	45 mm	27 mm	27 mm	45 mm	27 mm	27 mm	27 mm	33 mm
湿度敏感等级	3	3	3	3	3	3	4	4	4	3
专用输入次数	4	4	4	4	4	4	4	4	4	4
I/O 线路数量	508	488	488	508	488	488	508	508	508	708
端子数量	672	672	652	672	672	652	672	672	672	1020
最高工作温度	85 °C	85 °C	85 °C	85 °C	85 °C	85 °C	85 °C	85 °C	85 °C	85 °C
组织	4 DEDICATED INPUTS, 508 I/O	4 DEDICATED INPUTS, 488 I/O	4 DEDICATED INPUTS, 488 I/O	4 DEDICATED INPUTS, 508 I/O	4 DEDICATED INPUTS, 488 I/O	4 DEDICATED INPUTS, 488 I/O	4 DEDICATED INPUTS, 508 I/O	4 DEDICATED INPUTS, 508 I/O	4 DEDICATED INPUTS, 508 I/O	4 DEDICATED INPUTS, 708 I/O
输出函数	MACROCELL	MACROCELL	MACROCELL	MACROCELL	MACROCELL	MACROCELL	MACROCELL	MACROCELL	MACROCELL	MACROCELL
封装主体材料	PLASTIC/EPOXY	PLASTIC/EPOXY	PLASTIC/EPOXY	PLASTIC/EPOXY	PLASTIC/EPOXY	PLASTIC/EPOXY	PLASTIC/EPOXY	PLASTIC/EPOXY	PLASTIC/EPOXY	PLASTIC/EPOXY
封装代码	BGA	BGA	BGA	BGA	BGA	BGA	BGA	BGA	BGA	BGA
封装形状	SQUARE	SQUARE	SQUARE	SQUARE	SQUARE	SQUARE	SQUARE	SQUARE	SQUARE	SQUARE
封装形式	GRID ARRAY	GRID ARRAY	GRID ARRAY	GRID ARRAY	GRID ARRAY	GRID ARRAY	GRID ARRAY	GRID ARRAY	GRID ARRAY	GRID ARRAY
峰值回流温度（摄氏度）	220	220	220	245	220	220	220	220	220	220
可编程逻辑类型	LOADABLE PLD	LOADABLE PLD	LOADABLE PLD	LOADABLE PLD	LOADABLE PLD	LOADABLE PLD	LOADABLE PLD	LOADABLE PLD	LOADABLE PLD	LOADABLE PLD
传播延迟	2.02 ns	2 ns	1.49 ns	1.49 ns	1.78 ns	2 ns	1.78 ns	2 ns	1.48 ns	1.79 ns
认证状态	Not Qualified	Not Qualified	Not Qualified	Not Qualified	Not Qualified	Not Qualified	Not Qualified	Not Qualified	Not Qualified	Not Qualified
座面最大高度	3.5 mm	3.5 mm	3.5 mm	3.5 mm	3.5 mm	2 mm	3.5 mm	3.5 mm	3.5 mm	3.5 mm
最大供电电压	1.89 V	1.89 V	1.89 V	1.89 V	1.89 V	1.89 V	1.89 V	1.89 V	1.89 V	1.89 V
最小供电电压	1.71 V	1.71 V	1.71 V	1.71 V	1.71 V	1.71 V	1.71 V	1.71 V	1.71 V	1.71 V
标称供电电压	1.8 V	1.8 V	1.8 V	1.8 V	1.8 V	1.8 V	1.8 V	1.8 V	1.8 V	1.8 V
表面贴装	YES	YES	YES	YES	YES	YES	YES	YES	YES	YES
温度等级	OTHER	OTHER	OTHER	OTHER	OTHER	OTHER	INDUSTRIAL	OTHER	OTHER	OTHER
端子面层	Tin/Lead (Sn/Pb)	Tin/Lead (Sn/Pb)	Tin/Lead (Sn/Pb)	TIN SILVER COPPER	Tin/Lead (Sn/Pb)	Tin/Lead (Sn/Pb)	Tin/Lead (Sn63Pb37)	Tin/Lead (Sn63Pb37)	Tin/Lead (Sn63Pb37)	Tin/Lead (Sn63Pb37)
端子形式	BALL	BALL	BALL	BALL	BALL	BALL	BALL	BALL	BALL	BALL
端子节距	1 mm	1 mm	1.27 mm	1 mm	1 mm	1.27 mm	1 mm	1 mm	1 mm	1 mm
端子位置	BOTTOM	BOTTOM	BOTTOM	BOTTOM	BOTTOM	BOTTOM	BOTTOM	BOTTOM	BOTTOM	BOTTOM
处于峰值回流温度下的最长时间	30	30	30	40	30	30	30	30	30	30
宽度	27 mm	27 mm	45 mm	27 mm	27 mm	45 mm	27 mm	27 mm	27 mm	33 mm
输入次数	500	480	480	-	480	480	500	500	500	-
逻辑单元数量	38400	16640	38400	-	16640	24320	24320	24320	24320	-
输出次数	500	480	480	-	480	480	500	500	500	-
封装等效代码	BGA672,26X26,40	BGA672,26X26,40	BGA652,35X35,50	-	BGA672,26X26,40	BGA652,35X35,50	BGA672,26X26,40	BGA672,26X26,40	BGA672,26X26,40	-
电源	1.8,1.8/3.3 V	1.8,1.8/3.3 V	1.8,1.8/3.3 V	-	1.8,1.8/3.3 V	1.8,1.8/3.3 V	1.8,1.8/3.3 V	1.8,1.8/3.3 V	1.8,1.8/3.3 V	-
技术	CMOS	CMOS	CMOS	-	CMOS	CMOS	CMOS	CMOS	CMOS	-

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