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74LVC1G08GW-R

产品描述Logic Gates SINGLE 2-INPUT AND
产品类别逻辑    逻辑   
文件大小787KB,共19页
制造商NXP(恩智浦)
官网地址https://www.nxp.com
标准
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74LVC1G08GW-R在线购买

供应商 器件名称 价格 最低购买 库存  
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74LVC1G08GW-R概述

Logic Gates SINGLE 2-INPUT AND

74LVC1G08GW-R规格参数

参数名称属性值
Source Url Status Check Date2013-06-14 00:00:00
是否无铅含铅
是否Rohs认证符合
厂商名称NXP(恩智浦)
包装说明TSSOP,
Reach Compliance Codecompliant
系列LVC/LCX/Z
JESD-30 代码R-PDSO-G5
长度2.05 mm
逻辑集成电路类型AND GATE
功能数量1
输入次数2
端子数量5
最高工作温度125 °C
最低工作温度-40 °C
封装主体材料PLASTIC/EPOXY
封装代码TSSOP
封装形状RECTANGULAR
封装形式SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
峰值回流温度(摄氏度)NOT SPECIFIED
传播延迟(tpd)10.5 ns
座面最大高度1.1 mm
最大供电电压 (Vsup)5.5 V
最小供电电压 (Vsup)1.65 V
标称供电电压 (Vsup)3.3 V
表面贴装YES
技术CMOS
温度等级AUTOMOTIVE
端子形式GULL WING
端子节距0.65 mm
端子位置DUAL
处于峰值回流温度下的最长时间NOT SPECIFIED
宽度1.25 mm

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74LVC1G08
Single 2-input AND gate
Rev. 11 — 28 November 2016
Product data sheet
1. General description
The 74LVC1G08 provides one 2-input AND function.
Inputs can be driven from either 3.3 V or 5 V devices. This feature allows the use of these
devices as translators in mixed 3.3 V and 5 V applications.
Schmitt trigger action at all inputs makes the circuit tolerant of slower input rise and fall
time.
This device is fully specified for partial power-down applications using I
OFF
.
The I
OFF
circuitry disables the output, preventing the damaging backflow current through
the device when it is powered down.
2. Features and benefits
Wide supply voltage range from 1.65 V to 5.5 V
High noise immunity
Complies with JEDEC standard:
JESD8-7 (1.65 V to 1.95 V)
JESD8-5 (2.3 V to 2.7 V)
JESD8-B/JESD36 (2.7 V to 3.6 V)
24
mA output drive (V
CC
= 3.0 V)
CMOS low power consumption
Latch-up performance
250 mA
Direct interface with TTL levels
Inputs accept voltages up to 5 V
ESD protection:
HBM JESD22-A114F exceeds 2000 V
MM JESD22-A115-A exceeds 200 V
Multiple package options
Specified from
40 C
to +85
C
and
40 C
to +125
C

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