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74LVC162245ADGV-QJ

产品描述收发器,非反相 2 元件 8 位每元件 三态 Output 48-TSSOP
产品类别逻辑    逻辑-缓冲器,驱动器,接收器,收发器   
文件大小240KB,共14页
制造商Nexperia
官网地址https://www.nexperia.com
标准
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74LVC162245ADGV-QJ概述

收发器,非反相 2 元件 8 位每元件 三态 Output 48-TSSOP

74LVC162245ADGV-QJ规格参数

参数名称属性值
类别
厂商名称Nexperia
系列Automotive, AEC-Q100, 74LVC
包装卷带(TR)剪切带(CT)Digi-Reel® 得捷定制卷带
逻辑类型收发器,非反相
元件数2
每个元件位数8
输出类型三态
电流 - 输出高、低12mA,12mA
电压 - 供电1.65V ~ 3.6V
工作温度-40°C ~ 125°C(TA)
安装类型表面贴装型
封装/外壳48-TFSOP(0.173",4.40mm 宽)
供应商器件封装48-TSSOP
基本产品编号74LVC162245

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74LVC162245A-Q100
Rev. 3 — 23 September 2021
16-bit transceiver with direction pin; 30 Ω series termination
resistors; 5 V tolerant input/output; 3-state
Product data sheet
1. General description
The 74LVC162245A is a 16-bit transceiver with 30 Ω termination resistors and 3-state outputs. The
device can be used as two 8-bit transceivers or one 16-bit transceiver. The device features two
output enables (1OE and 2OE) each controlling eight outputs, and two send/receive (1DIR and
2DIR) inputs for direction control. A HIGH on nOE causes the outputs to assume a high-impedance
OFF-state. Inputs can be driven from either 3.3 V or 5 V devices. This feature allows the use of
these devices as translators in mixed 3.3 V and 5 V environments.
Schmitt-trigger action at all inputs makes the circuit tolerant of slower input rise and fall times.
This device is fully specified for partial power down applications using I
OFF
. The I
OFF
circuitry
disables the output, preventing the potentially damaging backflow current through the device when
it is powered down.
This product has been qualified to the Automotive Electronics Council (AEC) standard Q100
(Grade 1) and is suitable for use in automotive applications.
2. Features and benefits
Automotive product qualification in accordance with AEC-Q100 (Grade 1)
Specified from -40 °C to +85 °C and from -40 °C to +125 °C
Overvoltage tolerant inputs to 5.5 V
Wide supply voltage range from 1.2 V to 3.6 V
CMOS low power dissipation
Multibyte flow-through standard pin-out architecture
Low inductance multiple power and ground pins for minimum noise and ground bounce
Direct interface with TTL levels
Integrated 30 Ω termination resistors
I
OFF
circuitry provides partial Power-down mode operation
Complies with JEDEC standard:
JESD8-7A (1.65 V to 1.95 V)
JESD8-5A (2.3 V to 2.7 V)
JESD8-C/JESD36 (2.7 V to 3.6 V)
ESD protection:
HBM JESD22-A114F exceeds 2000 V
MM JESD22-A115-A exceeds 200 V (C = 200 pF, R = 0 Ω)
CDM ANSI/ESDA/Jedec JS-002 exceeds 1000 V
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