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5962H9658001QXX

产品描述R-S Latch, AC Series, 4-Func, Low Level Triggered, 2-Bit, True Output, CMOS, CDFP16, BOTTOM BRAZED, CERAMIC, DFP-16
产品类别逻辑    逻辑   
文件大小229KB,共9页
制造商Cobham Semiconductor Solutions
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5962H9658001QXX概述

R-S Latch, AC Series, 4-Func, Low Level Triggered, 2-Bit, True Output, CMOS, CDFP16, BOTTOM BRAZED, CERAMIC, DFP-16

5962H9658001QXX规格参数

参数名称属性值
零件包装代码DFP
包装说明DFP,
针数16
Reach Compliance Codeunknown
ECCN代码3A001.A.1.A
其他特性WITH DUAL S INPUT FOR TWO FUNCTIONS
系列AC
JESD-30 代码R-CDFP-F16
JESD-609代码e0/e4
逻辑集成电路类型R-S LATCH
位数2
功能数量4
端子数量16
最高工作温度125 °C
最低工作温度-55 °C
输出极性TRUE
封装主体材料CERAMIC, METAL-SEALED COFIRED
封装代码DFP
封装形状RECTANGULAR
封装形式FLATPACK
传播延迟(tpd)18 ns
认证状态Not Qualified
筛选级别MIL-PRF-38535 Class Q
座面最大高度2.921 mm
最大供电电压 (Vsup)5.5 V
最小供电电压 (Vsup)4.5 V
标称供电电压 (Vsup)5 V
表面贴装YES
技术CMOS
温度等级MILITARY
端子面层TIN LEAD/GOLD
端子形式FLAT
端子节距1.27 mm
端子位置DUAL
总剂量1M Rad(Si) V
触发器类型LOW LEVEL
宽度6.731 mm
Base Number Matches1

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Standard Products
UT54ACS279/UT54ACTS279
Quadruple S-R Latches
Datasheet
November 2010
www.aeroflex.com/logic
FEATURES
1.2μ
CMOS
- Latchup immune
High speed
Low power consumption
Single 5 volt supply
Available QML Q or V processes
Flexible package
- 16-pin DIP
- 16-lead flatpack
UT54ACS279- SMD 5962-96580
UT54ACTS279 - SMD 5962-96581
DESCRIPTION
The UT54ACS279 and the UT54ACTS279 contain four basic
S-R flip-flop latches. Under conventional operation, the S-R
inputs are normally held high. When the S input is pulsed low,
the Q output will be set high. When R is pulsed low, the Q output
will be reset low. If the S-R inputs are taken low simultaneously,
the Q output is unpredictable.
The devices are characterized over full military temperature
range of -55°C to +125°C.
FUNCTION TABLE
INPUTS
S
H
L
H
L
R
H
H
L
L
OUTPUT
Q
Q
0
H
L
H
1
PINOUTS
16-Pin DIP
Top View
1R
1S1
1S2
1Q
2R
2S
2Q
V
SS
1
2
3
4
5
6
7
8
16
15
14
13
12
11
10
9
V
DD
4S
4R
4Q
3S2
3S1
3R
3Q
16-Lead Flatpack
Top View
1R
1S1
1S2
1Q
2R
2S
2Q
V
SS
1
2
3
4
5
6
7
8
16
15
14
13
12
11
10
9
V
DD
4S
4R
4Q
3S2
3S1
3R
3Q
LOGIC SYMBOL
(1)
1R
(2)
1S1
(3)
1S2
(5)
2R
(6)
2S
(10)
3R
(11)
3S1
(12)
3S2
(14)
4R
(15)
4S
Note:
1. This configuration is nonstable. It may not persist when the S and R inputs
return to their inactive (high) level.
R
S1
S1
R
S2
R
S3
S3
R
S4
(4)
1Q
(7)
2Q
LOGIC DIAGRAM
(LATCHES 1 & 3)
R
R
(LATCHES 2 & 4)
(9)
3Q
(13)
4Q
Note:
1. Logic symbol in accordance with ANSI/IEEE standard 91-1984 and IEC
Publication 617-12.
S1
S2
Q
S
Q
1
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