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7015S20JGB8

产品描述Dual-Port SRAM, 8KX9, 20ns, CMOS, PQCC68, 0.95 X 0.95 INCH, 0.17 INCH HEIGHT, GREEN, PLASTIC, LCC-68
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文件大小308KB,共21页
制造商IDT (Integrated Device Technology)
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7015S20JGB8概述

Dual-Port SRAM, 8KX9, 20ns, CMOS, PQCC68, 0.95 X 0.95 INCH, 0.17 INCH HEIGHT, GREEN, PLASTIC, LCC-68

7015S20JGB8规格参数

参数名称属性值
厂商名称IDT (Integrated Device Technology)
包装说明QCCJ,
Reach Compliance Codecompliant
最长访问时间20 ns
其他特性INTERRUPT FLAG; SEMAPHORE; AUTOMATIC POWER-DOWN
JESD-30 代码S-PQCC-J68
JESD-609代码e3
长度24.2062 mm
内存密度73728 bit
内存集成电路类型DUAL-PORT SRAM
内存宽度9
功能数量1
端子数量68
字数8192 words
字数代码8000
工作模式ASYNCHRONOUS
最高工作温度125 °C
最低工作温度-55 °C
组织8KX9
封装主体材料PLASTIC/EPOXY
封装代码QCCJ
封装形状SQUARE
封装形式CHIP CARRIER
并行/串行PARALLEL
认证状态Not Qualified
筛选级别MIL-PRF-38535
座面最大高度4.57 mm
最大供电电压 (Vsup)5.5 V
最小供电电压 (Vsup)4.5 V
标称供电电压 (Vsup)5 V
表面贴装YES
技术CMOS
温度等级MILITARY
端子面层MATTE TIN
端子形式J BEND
端子节距1.27 mm
端子位置QUAD
宽度24.2062 mm
Base Number Matches1

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HIGH-SPEED
8K x 9 DUAL-PORT
STATIC RAM
Features:
IDT7015S/L
True Dual-Ported memory cells which allow simultaneous
reads of the same memory location
High-speed access
– Commercial: 12/15/17/20/25/35ns (max.)
– Industrial: 20ns (max.)
– Military: 20/25/35ns (max.)
Low-power operation
– IDT7015S
Active: 750mW (typ.)
Standby: 5mW (typ.)
– IDT7015L
Active: 750mW (typ.)
Standby: 1mW (typ.)
IDT7015 easily expands data bus width to 18 bits or more
using the Master/Slave select when cascading more than
one device
M/S = V
IH
for
BUSY
output flag on Master
M/S = V
IL
for
BUSY
input on Slave
Busy and Interrupt Flag
On-chip port arbitration logic
Full on-chip hardware support of semaphore signaling
between ports
Fully asynchronous operation from either port
TTL-compatible, single 5V (±10%) power supply
Available in ceramic 68-pin PGA, 68-pin PLCC, and an 80-
pin TQFP
Industrial temperature range (–40°C to +85°C) is available
for selected speeds
Green parts available, see ordering information
Functional Block Diagram
OE
L
CE
L
R/W
L
OE
R
CE
R
R/W
R
I/O
0L
- I/O
8L
I/O
Control
BUSY
L
A
12L
A
0L
(1,2)
I/O
Control
I/O
0R
-I/O
8R
BUSY
R
Address
Decoder
13
(1,2)
MEMORY
ARRAY
13
Address
Decoder
A
12R
A
0R
CE
L
OE
L
R/W
L
ARBITRATION
INTERRUPT
SEMAPHORE
LOGIC
CE
R
OE
R
R/W
R
SEM
L
(2)
INT
L
NOTES:
1. In MASTER mode:
BUSY
is an output and is a push-pull driver
In SLAVE mode:
BUSY
is input.
2.
BUSY
outputs and
INT
outputs are non-tri-stated push-pull drivers.
M/S
2954 drw 01
SEM
R
(2)
INT
R
AUGUST 2014
1
©2014 Integrated Device Technology, Inc.
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