PR10F-1913-FB50Q,PR10F-1913-FB50Q pdf中文资料,PR10F-1913-FB50Q引脚图,PR10F-1913-FB50Q电路-Datasheet-电子工程世界

PR10F-1913-FB50Q: 产品描述Fixed Resistor, Wire Wound, 10W, 191000ohm, 1000V, 1% +/-Tol, 50ppm/Cel,; 产品类别无源元件电阻器; 文件大小208KB，共1页; 制造商RCD Components Inc.; 官网地址http://www.rcdcomponents.com/

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PR10F-1913-FB50Q概述

Fixed Resistor, Wire Wound, 10W, 191000ohm, 1000V, 1% +/-Tol, 50ppm/Cel,

参数名称	属性值
是否Rohs认证	不符合
Objectid	927726020
Reach Compliance Code	compliant
Country Of Origin	Mainland China, Saint Lucia, USA
ECCN代码	EAR99
YTEOL	4.84
构造	Tubular
JESD-609代码	e0
引线直径	1 mm
引线长度	35 mm
端子数量	2
最高工作温度	150 °C
最低工作温度	-55 °C
封装直径	8.89 mm
封装长度	43.7 mm
封装形状	TUBULAR PACKAGE
封装形式	Axial
包装方法	Bulk
额定功率耗散 (P)	10 W
电阻	191000 Ω
电阻器类型	FIXED RESISTOR
系列	PR
技术	WIRE WOUND
温度系数	50 ppm/°C
端子面层	Tin/Lead (Sn/Pb)
容差	1%
工作电压	1000 V

Verilog程序实现功能不对怎么办啊？: 对给定的4个输入in1，in2，in3,in4,对应4个输出c1,c2,c3,c4，每个输出随着输入的上升沿来到而+1，就是c1计算in1上升沿的个数，c2,c3,c4类似，接下来对c1,c2,c3,c4进行比较，当c1,c2,c3,c4中有两个以上的数相同时，让输出等于这个数。程序中还设置了个复位键reset，当reset为1时，复位。程序如下：module ronghe(c,in1,in2,i...; eeleader FPGA/CPLD

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器件捷径: E0 E1 E2 E3 E4 E5 E6 E7 E8 E9 EA EB EC ED EE EF EG EH EI EJ EK EL EM EN EO EP EQ ER ES ET EU EV EW EX EY EZ F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 FA FB FC FD FE FF FG FH FI FJ FK FL FM FN FO FP FQ FR FS FT FU FV FW FX FY FZ G0 G1 G2 G3 G4 G5 G6 G7 G8 G9 GA GB GC GD GE GF GG GH GI GJ GK GL GM GN GO GP GQ GR GS GT GU GV GW GX GZ H0 H1 H2 H3 H4 H5 H6 H7 H8 HA HB HC HD HE HF HG HH HI HJ HK HL HM HN HO HP HQ HR HS HT HU HV HW HX HY HZ I1 I2 I3 I4 I5 I6 I7 IA IB IC ID IE IF IG IH II IK IL IM IN IO IP IQ IR IS IT IU IV IW IX J0 J1 J2 J6 J7 JA JB JC JD JE JF JG JH JJ JK JL JM JN JP JQ JR JS JT JV JW JX JZ K0 K1 K2 K3 K4 K5 K6 K7 K8 K9 KA KB KC KD KE KF KG KH KI KJ KK KL KM KN KO KP KQ KR KS KT KU KV KW KX KY KZ

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