RNN60E2492FMM76,RNN60E2492FMM76 pdf中文资料,RNN60E2492FMM76引脚图,RNN60E2492FMM76电路-Datasheet-电子工程世界

RNN60E2492FMM76: 产品描述RESISTOR, METAL FILM, 0.125 W, 1 %, 25 ppm, 24900 ohm, THROUGH HOLE MOUNT, AXIAL LEADED; 产品类别无源元件电阻器; 文件大小79KB，共4页; 制造商Vishay(威世); 官网地址http://www.vishay.com

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RNN60E2492FMM76概述

RESISTOR, METAL FILM, 0.125 W, 1 %, 25 ppm, 24900 ohm, THROUGH HOLE MOUNT, AXIAL LEADED

参数名称	属性值
是否无铅	含铅
是否Rohs认证	不符合
Objectid	1617445877
包装说明	Axial,
Reach Compliance Code	compliant
Country Of Origin	USA
ECCN代码	EAR99
YTEOL	6.9
其他特性	HERMETICALLY SEALED, PRECISION
构造	Tubular
JESD-609代码	e0
引线直径	0.635 mm
引线长度	38.1 mm
安装特点	THROUGH HOLE MOUNT
端子数量	2
最高工作温度	175 °C
封装直径	3.18 mm
封装长度	9.53 mm
封装形式	Axial
包装方法	BULK
额定功率耗散 (P)	0.125 W
额定温度	125 °C
参考标准	MIL-PRF-55182
电阻	24900 Ω
电阻器类型	FIXED RESISTOR
表面贴装	NO
技术	METAL FILM
温度系数	25 ppm/°C
端子面层	Tin/Lead (Sn/Pb)
端子形状	WIRE
容差	1%
工作电压	250 V

clk_in是20MHz.需要一个12Mhz信号.用verilog有什么简单的实现方法么?: RT.以前学的都是VHDL.猛一看verilogHDL晕晕的.话说..这样的问题用VHDL我好像也不知道该怎么办...大家给支一招吧.或者有什么替代的方法?...; astwyg FPGA/CPLD

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器件捷径: 00 01 02 03 04 05 06 07 08 09 0A 0C 0F 0J 0L 0M 0R 0S 0T 0Z 10 11 12 13 14 15 16 17 18 19 1A 1B 1C 1D 1E 1F 1H 1K 1M 1N 1P 1S 1T 1V 1X 1Z 20 21 22 23 24 25 26 27 28 29 2A 2B 2C 2D 2E 2F 2G 2K 2M 2N 2P 2Q 2R 2S 2T 2W 2Z 30 31 32 33 34 35 36 37 38 39 3A 3B 3C 3D 3E 3F 3G 3H 3J 3K 3L 3M 3N 3P 3R 3S 3T 3V 40 41 42 43 44 45 46 47 48 49 4A 4B 4C 4D 4M 4N 4P 4S 4T 50 51 52 53 54 55 56 57 58 59 5A 5B 5C 5E 5G 5H 5K 5M 5N 5P 5S 5T 5V 60 61 62 63 64 65 66 67 68 69 6A 6C 6E 6F 6M 6N 6P 6R 6S 6T 70 71 72 73 74 75 76 77 78 79 7A 7B 7C 7M 7N 7P 7Q 7V 7W 7X 80 81 82 83 84 85 86 87 88 89 8A 8D 8E 8L 8N 8P 8S 8T 8W 8Y 8Z 90 91 92 93 94 95 96 97 98 99 9A 9B 9C 9D 9F 9G 9H 9L 9S 9T 9W