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74ALVCH16373DGG:51: 产品描述IC 16bit D transp latch 48tssop; 产品类别逻辑逻辑; 文件大小123KB，共18页; 制造商NXP(恩智浦); 官网地址https://www.nxp.com

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74ALVCH16373DGG:51概述

IC 16bit D transp latch 48tssop

74ALVCH16373DGG:51规格参数

参数名称	属性值
Brand Name	NXP Semiconduc
零件包装代码	TSSOP
包装说明	TSSOP,
针数	48
制造商包装代码	SOT362-1
Reach Compliance Code	compli
其他特性	CAN ALSO OPERATES AT 3 TO 3.6 V RANGE
系列	ALVC/VCX/A
JESD-30 代码	R-PDSO-G48
JESD-609代码	e4
长度	12.5 mm
逻辑集成电路类型	BUS DRIVER
湿度敏感等级	1
位数	8
功能数量	2
端口数量	2
端子数量	48
最高工作温度	85 °C
最低工作温度	-40 °C
输出特性	3-STATE
输出极性	TRUE
封装主体材料	PLASTIC/EPOXY
封装代码	TSSOP
封装形状	RECTANGULAR
封装形式	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
峰值回流温度（摄氏度）	260
传播延迟（tpd）	3.9 ns
认证状态	Not Qualified
座面最大高度	1.2 mm
最大供电电压 (Vsup)	2.7 V
最小供电电压 (Vsup)	2.3 V
标称供电电压 (Vsup)	2.5 V
表面贴装	YES
技术	CMOS
温度等级	INDUSTRIAL
端子面层	NICKEL PALLADIUM GOLD
端子形式	GULL WING
端子节距	0.5 mm
端子位置	DUAL
处于峰值回流温度下的最长时间	30
宽度	6.1 mm
Base Number Matches	1

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74ALVCH16373

2.5 V/3.3 V 16-bit D-type transparent latch; 3-state

Rev. 6 — 10 July 2012

Product data sheet

1. General description

The 74ALVCH16373 is 16-bit D-type transparent latch featuring separate D-type inputs for

each latch and 3-state outputs for bus oriented applications.

Incorporates bus hold data inputs which eliminate the need for external pull-up or

pull-down resistors to hold unused inputs.

One latch enable (LE) input and one output enable (OE) are provided per 8-bit section.

The 74ALVCH16373 consists of 2 sections of eight D-type transparent latches with 3-state

true outputs. When LE is HIGH, data at the nDn inputs enter the latches. In this condition

the latches are transparent, therefore a latch output will change each time its

corresponding D-input changes.

When LE is LOW, the latches store the information that was present at the nDn inputs at a

set-up time preceding the LOW-to-HIGH transition of LE. When OE is LOW, the contents

of the eight latches are available at the outputs. When OE is HIGH, the outputs go to the

high-impedance OFF-state. Operation of the OE input does not affect the state of the

latches.

2. Features and benefits



Wide supply voltage range from 1.2 V to 3.6 V

Complies with JEDEC standard JESD8-B

CMOS low power consumption

MULTIBYTE flow-through standard pin-out architecture

Low inductance multiple V

and GND pins for minimum noise and ground bounce

Direct interface with TTL levels

All data inputs have bus hold

Output drive capability 50



transmission lines at 85

C

Current drive

24

mA at V

= 3.0 V

74ALVCH16373DGG:51相似产品对比

	74ALVCH16373DGG:51	74ALVCH16373DGG,51	74ALVCH16373DGG-T	935205120512	935205120518
描述	IC 16bit D transp latch 48tssop	IC 16bit D transp latch 48tssop	IC ALVC/VCX/A SERIES, DUAL 8-BIT DRIVER, TRUE OUTPUT, PDSO48, Bus Driver/Transceiver	ALVC/VCX/A SERIES, DUAL 8-BIT DRIVER, TRUE OUTPUT, PDSO48, PLASTIC, TSSOP2-48	ALVC/VCX/A SERIES, DUAL 8-BIT DRIVER, TRUE OUTPUT, PDSO48, PLASTIC, TSSOP2-48
包装说明	TSSOP,	TSSOP, TSSOP48,.3,20	TSSOP,	TSSOP,	TSSOP,
Reach Compliance Code	compli	unknow	unknown	unknow	unknow
其他特性	CAN ALSO OPERATES AT 3 TO 3.6 V RANGE	CAN ALSO OPERATES AT 3 TO 3.6 V RANGE	CAN ALSO OPERATES AT 3 TO 3.6 V RANGE	CAN ALSO OPERATES AT 3 TO 3.6 V RANGE	CAN ALSO OPERATES AT 3 TO 3.6 V RANGE
系列	ALVC/VCX/A	ALVC/VCX/A	ALVC/VCX/A	ALVC/VCX/A	ALVC/VCX/A
JESD-30 代码	R-PDSO-G48	R-PDSO-G48	R-PDSO-G48	R-PDSO-G48	R-PDSO-G48
长度	12.5 mm	12.5 mm	12.5 mm	12.5 mm	12.5 mm
逻辑集成电路类型	BUS DRIVER	BUS DRIVER	BUS DRIVER	BUS DRIVER	BUS DRIVER
位数	8	8	8	8	8
功能数量	2	2	2	2	2
端口数量	2	2	2	2	2
端子数量	48	48	48	48	48
最高工作温度	85 °C	85 °C	85 °C	85 °C	85 °C
最低工作温度	-40 °C	-40 °C	-40 °C	-40 °C	-40 °C
输出特性	3-STATE	3-STATE	3-STATE	3-STATE	3-STATE
输出极性	TRUE	TRUE	TRUE	TRUE	TRUE
封装主体材料	PLASTIC/EPOXY	PLASTIC/EPOXY	PLASTIC/EPOXY	PLASTIC/EPOXY	PLASTIC/EPOXY
封装代码	TSSOP	TSSOP	TSSOP	TSSOP	TSSOP
封装形状	RECTANGULAR	RECTANGULAR	RECTANGULAR	RECTANGULAR	RECTANGULAR
封装形式	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
传播延迟（tpd）	3.9 ns	3.9 ns	3.9 ns	3.9 ns	3.9 ns
座面最大高度	1.2 mm	1.2 mm	1.2 mm	1.2 mm	1.2 mm
最大供电电压 (Vsup)	2.7 V	2.7 V	2.7 V	2.7 V	2.7 V
最小供电电压 (Vsup)	2.3 V	2.3 V	2.3 V	2.3 V	2.3 V
标称供电电压 (Vsup)	2.5 V	2.5 V	2.5 V	2.5 V	2.5 V
表面贴装	YES	YES	YES	YES	YES
技术	CMOS	CMOS	CMOS	CMOS	CMOS
温度等级	INDUSTRIAL	INDUSTRIAL	INDUSTRIAL	INDUSTRIAL	INDUSTRIAL
端子形式	GULL WING	GULL WING	GULL WING	GULL WING	GULL WING
端子节距	0.5 mm	0.5 mm	0.5 mm	0.5 mm	0.5 mm
端子位置	DUAL	DUAL	DUAL	DUAL	DUAL
宽度	6.1 mm	6.1 mm	6.1 mm	6.1 mm	6.1 mm
JESD-609代码	e4	e4	-	e4	e4
认证状态	Not Qualified	Not Qualified	Not Qualified	-	-
端子面层	NICKEL PALLADIUM GOLD	Nickel/Palladium/Gold (Ni/Pd/Au)	-	NICKEL PALLADIUM GOLD	NICKEL PALLADIUM GOLD
厂商名称	-	NXP(恩智浦)	NXP(恩智浦)	NXP(恩智浦)	NXP(恩智浦)

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