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ATS-12B-137-C3-R0: 产品描述heatsink 25x25x10mm L-tab t412; 产品类别热管理产品; 文件大小345KB，共1页; 制造商Seek Thermal; 官网地址https://www.thermal.com/; 标准

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ATS-12B-137-C3-R0概述

heatsink 25x25x10mm L-tab t412

参数名称	属性值
Datasheets
ATS-12B-137-C3-R0
Standard Package	1
Category	Fans, Thermal Manageme
Family	Thermal - Heat Sinks
类型 Type	Top Mou
Package Cooled	Assorted (BGA, LGA, CPU, ASIC...)
Attachment Method	Push Pi
Shape	Square, Fins
长度 Length	0.984" (25.00mm)
宽度 Width	0.984" (25.00mm)
Height Off Base (Height of Fin)	0.394" (10.00mm)
Thermal Resistance @ Forced Air Flow	18.63°C/W @ 100 LFM
Material	Aluminum
Material Finish	Blue Anodized

FPGA DSP 通信，用EMIF接口: 请问有人做过FPGA与DSP通信吗？用EMIF接口，在FPGA上我用的是内部fifo，那些fifo的接口与DSP的引脚该怎么连呀？我现在的结果是感觉接受不同步...; wangyaoli FPGA/CPLD

几本经典FPGA验证书籍: SystemVerilog是一种硬件描述和验证语言（HDVL），它基于IEEE1364-2001 Verilog硬件描述语言（HDL），并对其进行了扩展，包括扩充了C语言数据类型、结构、压缩和非压缩数组、接口、断言等等，这些都使得SystemVerilog在一个更高的抽象层次上提高了设计建模的能力。SystemVerilog由Accellera开发，它主要定位在芯片的实现和验证流程上，并为系统级...; arui1999 下载中心专版

CPLD有一个管脚不工作: 程序烧写成功后，CPLD的触发管脚一直处于高阻态，整个电路一上电就触发，想知道是CPLD的问题还是PCB 的问题。若是CPLD 的问题，那CPLD 是根据什么判断电路已经触发，然后执行程序的？...; xiaxuedehai FPGA/CPLD

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器件捷径: 00 01 02 03 04 05 06 07 08 09 0A 0C 0F 0J 0L 0M 0R 0S 0T 0Z 10 11 12 13 14 15 16 17 18 19 1A 1B 1C 1D 1E 1F 1H 1K 1M 1N 1P 1S 1T 1V 1X 1Z 20 21 22 23 24 25 26 27 28 29 2A 2B 2C 2D 2E 2F 2G 2K 2M 2N 2P 2Q 2R 2S 2T 2W 2Z 30 31 32 33 34 35 36 37 38 39 3A 3B 3C 3D 3E 3F 3G 3H 3J 3K 3L 3M 3N 3P 3R 3S 3T 3V 40 41 42 43 44 45 46 47 48 49 4A 4B 4C 4D 4M 4N 4P 4S 4T 50 51 52 53 54 55 56 57 58 59 5A 5B 5C 5E 5G 5H 5K 5M 5N 5P 5S 5T 5V 60 61 62 63 64 65 66 67 68 69 6A 6C 6E 6F 6M 6N 6P 6R 6S 6T 70 71 72 73 74 75 76 77 78 79 7A 7B 7C 7M 7N 7P 7Q 7V 7W 7X 80 81 82 83 84 85 86 87 88 89 8A 8D 8E 8L 8N 8P 8S 8T 8W 8Y 8Z 90 91 92 93 94 95 96 97 98 99 9A 9B 9C 9D 9F 9G 9H 9L 9S 9T 9W