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750-502

产品描述2-channel digital output; 24 VDC; 2.0 A
文件大小485KB,共12页
制造商WAGO
官网地址https://www.wago.com/
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750-502概述

2-channel digital output; 24 VDC; 2.0 A

stm32复位后端口是高阻态吗?
用了STM32F103C6T6,通过一个端口加上缓冲芯片74LV07,低电平驱动光藕。发现有时上电过程中光藕带的负载导通一下。请问GPIO复位后看手册是FLOAT输入,是高阻态的吗?如果是高阻态光藕不应该瞬间导通的。...
safeandc stm32/stm8
关于1个VHDL 编译错误
LIBRARY IEEE;USE IEEE.STD_LOGIC_1164.ALL;USE ieee.std_logic_arith.all;USE ieee.std_logic_unsigned.all;USE ieee.numeric_std.ALL;LIBRARY lpm;USE lpm.lpm_components.all;ENTITY test ISGENERIC (MIO_TOTAL :...
a20061475 FPGA/CPLD
MSP430 定时器输出PWM波形实例
[size=4]定时器的PWM输出有有8种模式:[/size][size=4][/size][size=4]输出模式0输出模式:输出信号OUTx由每个捕获/比较模块的控制寄存器CCTLx中的OUTx位定义,并在写入该寄存器后立即更新。最终位OUTx直通。 [/size][size=4]输出模式1 置位模式:输出信号在TAR等于CCRx时置位,并保持置位到定时器复位或选择另一种输出模式为止。 [/s...
fish001 微控制器 MCU
这里有玩Quartus II的伐? 用VHDL编过计数器的帮忙
先声明 偶才接触这东西10来天的样子 不怎么熟练 外加这边的人看上去似乎都是专业的= =最好能给点指导 或者能给个计数器的实例看下 我一般情况下就能搞懂了以下这段实验用的东西为啥通不过编译呢?LIBRARY ieee;USE ieee.std_logic_1164.all;--Entity DeclarationENTITY test IS-- {{ALTERA_IO_BEGIN}} DO NOT...
darkgrass 嵌入式系统
最坏分析
最坏分析其实就是极端值分析:让你知道怎么样才会出问题。Assure acceptable operation throughout the entire product life cycleunder the most unfavorable combination of anticipated conditionsDefine Critical Components and Spec. Cont...
yulzhu 汽车电子
【ADI工程师见解,你怎么看】如何选择分立晶体管
[align=left][color=#333333][size=12px]如果选择晶体管?[/size][/color][/align][align=left][color=#333333][size=12px]答:谨慎些。[/size][/color][/align][align=left][color=#333333][size=12px]不过,过于小心也不好。我曾经看到有些工程师为了给低速...
雨中 ADI参考电路

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