SIT3521AE-1C2301DY1.000000,SIT3521AE-1C2301DY1.000000 pdf中文资料,SIT3521AE-1C2301DY1.000000引脚图,SIT3521AE-1C2301DY1.000000电路-Datasheet-电子工程世界

SIT3521AE-1C2301DY1.000000: 产品描述LVPECL Output Clock Oscillator, 1MHz Nom, QFN, 10 PIN; 产品类别无源元件振荡器; 文件大小1MB，共45页; 制造商SiTime; 标准

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SIT3521AE-1C2301DY1.000000概述

LVPECL Output Clock Oscillator, 1MHz Nom, QFN, 10 PIN

参数名称	属性值
是否Rohs认证	符合
Objectid	145145200698
包装说明	LCC10,.12X.2,50/40
Reach Compliance Code	unknown
Country Of Origin	Malaysia, Taiwan, Thailand
YTEOL	6.21
其他特性	ENABLE/DISABLE FUNCTION
最长下降时间	0.29 ns
频率调整-机械	NO
频率稳定性	25%
JESD-609代码	e4
安装特点	SURFACE MOUNT
端子数量	10
标称工作频率	1 MHz
最高工作温度	105 °C
最低工作温度	-40 °C
振荡器类型	LVPECL
输出负载	50 OHM
封装等效代码	LCC10,.12X.2,50/40
物理尺寸	5.0mm x 3.2mm x 0.9mm
最长上升时间	0.29 ns
最大供电电压	3.3 V
最小供电电压	2.7 V
标称供电电压	3 V
表面贴装	YES
最大对称度	55/45 %
端子面层	Nickel/Palladium/Gold (Ni/Pd/Au)

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Quartus警告分析 warning: 1.Found clock-sensitive change during active clock edge at time on register ""原因:vector source file中时钟敏感信号(如:数据,允许端,清零,同步加载等)在时钟的边缘同时变化.而时钟敏感信号是不能在时钟边沿变化的.其后果为导致结果不正确.措施:编辑vector source file2.Verilo...; eeleader FPGA/CPLD

器件捷径: L0 L1 L2 L3 L4 L5 L6 L7 L8 L9 LA LB LC LD LE LF LG LH LI LJ LK LL LM LN LO LP LQ LR LS LT LU LV LW LX LY LZ M0 M1 M2 M3 M4 M5 M6 M7 M8 M9 MA MB MC MD ME MF MG MH MI MJ MK ML MM MN MO MP MQ MR MS MT MU MV MW MX MY MZ N0 N1 N2 N3 N4 N5 N6 N7 N8 NA NB NC ND NE NF NG NH NI NJ NK NL NM NN NO NP NQ NR NS NT NU NV NX NZ O0 O1 O2 O3 OA OB OC OD OE OF OG OH OI OJ OK OL OM ON OP OQ OR OS OT OV OX OY OZ P0 P1 P2 P3 P4 P5 P6 P7 P8 P9 PA PB PC PD PE PF PG PH PI PJ PK PL PM PN PO PP PQ PR PS PT PU PV PW PX PY PZ Q1 Q2 Q3 Q4 Q5 Q6 Q8 Q9 QA QB QC QE QF QG QH QK QL QM QP QR QS QT QV QW QX QY R0 R1 R2 R3 R4 R5 R6 R7 R8 R9 RA RB RC RD RE RF RG RH RI RJ RK RL RM RN RO RP RQ RR RS RT RU RV RW RX RY RZ

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