PLL/Frequency Synthesis Circuit,
参数名称 | 属性值 |
Objectid | 4000532156 |
包装说明 | DIP, |
Reach Compliance Code | compliant |
ECCN代码 | EAR99 |
其他特性 | SEATED HEIGHT CALCULATED |
模拟集成电路 - 其他类型 | PHASE DETECTOR |
JESD-30 代码 | R-PDIP-T16 |
长度 | 20.32 mm |
功能数量 | 1 |
端子数量 | 16 |
最高工作温度 | 70 °C |
最低工作温度 | |
封装主体材料 | PLASTIC/EPOXY |
封装代码 | DIP |
封装形状 | RECTANGULAR |
封装形式 | IN-LINE |
座面最大高度 | 4.58 mm |
最大供电电压 (Vsup) | 5.5 V |
最小供电电压 (Vsup) | 4.5 V |
标称供电电压 (Vsup) | 5 V |
表面贴装 | NO |
温度等级 | COMMERCIAL |
端子形式 | THROUGH-HOLE |
端子节距 | 2.54 mm |
端子位置 | DUAL |
宽度 | 7.62 mm |
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