HG532371F55GDT,HG532371F55GDT pdf中文资料,HG532371F55GDT引脚图,HG532371F55GDT电路-Datasheet-电子工程世界

HG532371F55GDT: 产品描述Parallel - Fundamental Quartz Crystal, 37.125MHz Nom, ROHS COMPLIANT PACKAGE-2; 产品类别无源元件晶体/谐振器; 文件大小94KB，共2页; 制造商CTS; 标准

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HG532371F55GDT概述

Parallel - Fundamental Quartz Crystal, 37.125MHz Nom, ROHS COMPLIANT PACKAGE-2

参数名称	属性值
是否Rohs认证	符合
Objectid	1535366642
包装说明	ROHS COMPLIANT PACKAGE-2
Reach Compliance Code	compliant
YTEOL	7.23
其他特性	AT-CUT; TAPE AND REEL
老化	5 PPM/YEAR
晶体/谐振器类型	PARALLEL - FUNDAMENTAL
驱动电平	10 µW
频率稳定性	0.005%
频率容差	50 ppm
JESD-609代码	e4
负载电容	18 pF
制造商序列号	HG532
安装特点	SURFACE MOUNT
标称工作频率	37.125 MHz
最高工作温度	105 °C
最低工作温度	-40 °C
物理尺寸	L5.0XB3.2XH1.3 (mm)/L0.197XB0.126XH0.051 (inch)
串联电阻	50 Ω
表面贴装	YES
端子面层	Gold (Au) - with Nickel (Ni) barrier

Altera的时序约束问题: 有一个62.5Mhz的时钟clk_62M，我用语句 assign clk_62M_inv = ~clk_62M;生成一个反向时钟。时钟clk_62M和clk_62M_inv的周期是16ns,我希望把这两个时钟的上升沿的时间约束在7.5-8.5ns之间？该如何写约束呢？我用的是Altera的TimeQuest。谢谢...; lzxylwq FPGA/CPLD

2440流式摄像头驱动录像: 请问，用2440流式摄像头驱动录像时，在应用程序中如何确定一帧数据已采集完，可以去读数据，然后再读下一帧数据。通过调用 CAM_IOCTL_GET_LATEST_FRAME实现。谢谢了。...; amu08 嵌入式系统

fpga配置时的管脚状态(转帖）: 大多数的回答是：配置的时候所有的管脚默认是Z态。这个说法到底对不对呢？下面我谈谈自己使用的几款新品的情况。项目背景：开关信号发射机。初始状态要求IO信号都是低电平，来自控制DSP的发射控制信号触发IO开关信号的产生。上电的时候不能有高电平，否则引起发射机状态不稳，会产生问题。（1）VirtexII1000设作IO的信号在上电配置的过程中用示波器测量时高电平，大约在90ms左右，和配置时间基本一致。...; eeleader FPGA/CPLD

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常见阻抗匹配的方式: [size=4][color=#000000][backcolor=white]1、串联终端匹配[/backcolor][/color][/size][size=4][color=#000000][backcolor=white][/backcolor][/color][/size][size=4][color=#000000][backcolor=white]在信号源端阻抗低于传输线特征阻抗的条...; fish001 模拟与混合信号

器件捷径: A0 A1 A2 A3 A4 A5 A6 A7 A8 A9 AA AB AC AD AE AF AG AH AI AJ AK AL AM AN AO AP AQ AR AS AT AU AV AW AX AY AZ B0 B1 B2 B3 B4 B5 B6 B7 B8 B9 BA BB BC BD BE BF BG BH BI BJ BK BL BM BN BO BP BQ BR BS BT BU BV BW BX BY BZ C0 C1 C2 C3 C4 C5 C6 C7 C8 C9 CA CB CC CD CE CF CG CH CI CJ CK CL CM CN CO CP CQ CR CS CT CU CV CW CX CY CZ D0 D1 D2 D3 D4 D5 D6 D7 D8 D9 DA DB DC DD DE DF DG DH DI DJ DK DL DM DN DO DP DQ DR DS DT DU DV DW DX DZ

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