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HCPL-7720-060

产品描述1 CHANNEL LOGIC OUTPUT OPTOCOUPLER, 25Mbps, 0.300 INCH, DIP-8
产品类别光电子/LED    光电   
文件大小176KB,共19页
制造商AVAGO
官网地址http://www.avagotech.com/
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HCPL-7720-060概述

1 CHANNEL LOGIC OUTPUT OPTOCOUPLER, 25Mbps, 0.300 INCH, DIP-8

HCPL-7720-060规格参数

参数名称属性值
是否无铅含铅
是否Rohs认证不符合
厂商名称AVAGO
包装说明0.300 INCH, DIP-8
Reach Compliance Codecompliant
Is SamacsysN
其他特性UL RECOGNIZED, VDE APPROVED
配置COMPLEX
标称数据速率25 MBps
最大正向电流0.00001 A
最大绝缘电压3750 V
元件数量1
最大通态电流0.01 A
最高工作温度85 °C
最低工作温度-40 °C
光电设备类型LOGIC IC OUTPUT OPTOCOUPLER
最小供电电压4.5 V
Base Number Matches1

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HCPL-0720, HCPL-7720, HCPL-0721 and HCPL-7721
40 ns Propagation Delay, CMOS Optocoupler
Data Sheet
Lead (Pb) Free
RoHS 6 fully
compliant
RoHS 6 fully
compliant options available;
-xxxE denotes
a
lead-free
product
Description
Available in either an 8-pin DIP or SO-8 package style
respectively, the HCPL-772X or HCPL-072X optocouplers
utilize the latest CMOS IC technology to achieve out-
standing performance with very low power consump-
tion. The HCPL-772X/072X require only two bypass ca-
pacitors for complete CMOS compatability.
Basic building blocks of the HCPL-772X/072X are a CMOS
LED driver IC, a high speed LED and a CMOS detector
IC. A CMOS logic input signal controls the LED driver IC
which supplies current to the LED. The detector IC incor-
porates an integrated photodiode, a high-speed tran-
simpedance amplifier, and a voltage comparator with an
output driver.
Features
x
+5 V CMOS compatibility
x
20 ns maximum prop. delay skew
x
High speed: 25 MBd
x
40 ns max. prop. delay
x
10 kV/μs minimum common mode rejection
x
–40 to 85°C temperature range
x
Safety and regulatory approvals
UL recognized
– 3750 Vrms for 1 min. per UL 1577
– 5000 Vrms for 1 min. per UL 1577
(for HCPL-772X option 020)
CSA component acceptance notice #5
IEC/EN/DIN EN 60747-5-2
– V
IORM
= 630 Vpeak for HCPL-772X option 060
– V
IORM
= 560 Vpeak for HCPL-072X option 060
Functional Diagram
**V
DD1
1
8
V
DD2
**
Applications
x
Digital fieldbus isolation: CC-Link, DeviceNet, Profi-
bus, SDS
x
AC plasma display panel level shifting
x
Multiplexed data transmission
x
Computer peripheral interface
x
Microprocessor system interface
V
I
2
I
O
7
NC*
*
3
LED1
6
V
O
GND
1
4
SHIELD
5
GND
2
Pin 3 is the anode of the internal LED and must be left unconnected
for guaranteed data sheet performance. Pin 7 is not connected
internally.
** A 0.1 μF bypass capacitor must be connected between pins 1 and
4, and 5 and 8.
*
TRUTH TABLE
POSITIVE LOGIC
V
I
H
L
LED1
OFF
ON
V
o
OUTPUT
H
L
CAUTION: It is advised that normal static precautions be taken in handling and assembly
of this component to prevent damage and/or degradation which may be induced by ESD.
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