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74LCX240SJ

产品描述Bus Driver, LVC/LCX/Z Series, 2-Func, 4-Bit, Inverted Output, CMOS, PDSO20, 5.30 MM, EIAJ TYPE2, SOP-20
产品类别逻辑    逻辑   
文件大小411KB,共12页
制造商Fairchild
官网地址http://www.fairchildsemi.com/
标准
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74LCX240SJ概述

Bus Driver, LVC/LCX/Z Series, 2-Func, 4-Bit, Inverted Output, CMOS, PDSO20, 5.30 MM, EIAJ TYPE2, SOP-20

74LCX240SJ规格参数

参数名称属性值
Brand NameFairchild Semiconductor
是否无铅不含铅
是否Rohs认证符合
厂商名称Fairchild
零件包装代码SOP
包装说明SOP, SOP20,.3
针数20
制造商包装代码20LD,SOP,EIAJ TYPE II, 5.3MM WIDE
Reach Compliance Codecompliant
ECCN代码EAR99
控制类型ENABLE LOW
系列LVC/LCX/Z
JESD-30 代码R-PDSO-G20
JESD-609代码e3
长度12.6 mm
负载电容(CL)50 pF
逻辑集成电路类型BUS DRIVER
最大I(ol)0.024 A
湿度敏感等级1
位数4
功能数量2
端口数量2
端子数量20
最高工作温度85 °C
最低工作温度-40 °C
输出特性3-STATE
输出极性INVERTED
封装主体材料PLASTIC/EPOXY
封装代码SOP
封装等效代码SOP20,.3
封装形状RECTANGULAR
封装形式SMALL OUTLINE
包装方法RAIL
峰值回流温度(摄氏度)260
电源3.3 V
Prop。Delay @ Nom-Sup6.5 ns
传播延迟(tpd)7.8 ns
认证状态Not Qualified
座面最大高度2.1 mm
最大供电电压 (Vsup)3.6 V
最小供电电压 (Vsup)2 V
标称供电电压 (Vsup)2.5 V
表面贴装YES
技术CMOS
温度等级INDUSTRIAL
端子面层Matte Tin (Sn)
端子形式GULL WING
端子节距1.27 mm
端子位置DUAL
处于峰值回流温度下的最长时间NOT SPECIFIED
宽度5.3 mm
Base Number Matches1

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74LCX240 — Low Voltage Octal Buffer/Line Driver with 5V Tolerant Inputs and Outputs
January 2008
74LCX240
Low Voltage Octal Buffer/Line Driver with 5V Tolerant
Inputs and Outputs
Features
5V tolerant inputs and outputs
2.3V–3.6V V
CC
specifications provided
6.5ns t
PD
max. (V
CC
=
3.3V), 10µA I
CC
max.
Power-down high impedance inputs and outputs
Supports live insertion/withdrawal
(1)
±24mA output drive (V
CC
=
3.0V)
Implements patented noise/EMI reduction circuitry
Latch-up performance exceeds 500mA
ESD performance:
General Description
The LCX240 is an inverting octal buffer and line driver
designed to be employed as a memory address driver,
clock driver and bus oriented transmitter or receiver. The
device is designed for low voltage (2.5V or 3.3V) V
CC
applications with capability of interfacing to a 5V signal
environment.
The LCX240 is fabricated with an advanced CMOS tech-
nology to achieve high speed operation while maintain-
ing CMOS low power dissipation.
– Human body model
>
2000V
– Machine model
>
200V
Note:
1. To ensure the high-impedance state during power up
or down, OE should be tied to V
CC
through a pull-up
resistor: the minimum value or the resistor is
determined by the current-sourcing capability of the
driver.
Ordering Information
Order
Number
74LCX240WM
74LCX240SJ
74LCX240MSA
74LCX240MTC
Package
Number
M20B
M20D
MSA20
MTC20
Package Description
20-Lead Small Outline Integrated Circuit (SOIC), JEDEC MS-013, 0.300" Wide
20-Lead Small Outline Package (SOP), EIAJ TYPE II, 5.3mm Wide
20-Lead Shrink Small Outline Package (SSOP), JEDEC MO-150, 5.3mm Wide
20-Lead Thin Shrink Small Outline Package (TSSOP), JEDEC MO-153, 4.4mm
Wide
Device also available in Tape and Reel. Specify by appending suffix letter “X” to the ordering number.
All packages are lead free per JEDEC: J-STD-020B standard.
©1994 Fairchild Semiconductor Corporation
74LCX240 Rev. 1.6.0
www.fairchildsemi.com
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