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SI4931DY

产品描述Dual P-Channel 12-V (D-S) MOSFET
产品类别分立半导体    晶体管   
文件大小200KB,共4页
制造商Vishay(威世)
官网地址http://www.vishay.com
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SI4931DY概述

Dual P-Channel 12-V (D-S) MOSFET

SI4931DY规格参数

参数名称属性值
是否Rohs认证不符合
厂商名称Vishay(威世)
零件包装代码SOT
包装说明SMALL OUTLINE, R-PDSO-G8
针数8
Reach Compliance Codecompli
ECCN代码EAR99
配置SEPARATE, 2 ELEMENTS WITH BUILT-IN DIODE
最小漏源击穿电压12 V
最大漏极电流 (ID)6.7 A
最大漏源导通电阻0.018 Ω
FET 技术METAL-OXIDE SEMICONDUCTOR
JESD-30 代码R-PDSO-G8
JESD-609代码e0
元件数量2
端子数量8
工作模式ENHANCEMENT MODE
封装主体材料PLASTIC/EPOXY
封装形状RECTANGULAR
封装形式SMALL OUTLINE
峰值回流温度(摄氏度)NOT SPECIFIED
极性/信道类型P-CHANNEL
认证状态Not Qualified
表面贴装YES
端子面层TIN LEAD
端子形式GULL WING
端子位置DUAL
处于峰值回流温度下的最长时间NOT SPECIFIED
晶体管应用SWITCHING
晶体管元件材料SILICON

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SPICE Device Model Si4931DY
Vishay Siliconix
Dual P-Channel 12-V (D-S) MOSFET
CHARACTERISTICS
P-Channel Vertical DMOS
Macro Model (Subcircuit Model)
Level 3 MOS
Apply for both Linear and Switching Application
Accurate over the
−55
to 125°C Temperature Range
Model the Gate Charge, Transient, and Diode Reverse Recovery
Characteristics
DESCRIPTION
The attached spice model describes the typical electrical
characteristics of the p-channel vertical DMOS. The subcircuit
model is extracted and optimized over the
−55
to 125°C
temperature ranges under the pulsed 0-V to 5-V gate drive. The
saturated output impedance is best fit at the gate bias near the
threshold voltage.
A novel gate-to-drain feedback capacitance network is used to model
the gate charge characteristics while avoiding convergence difficulties
of the switched C
gd
model. All model parameter values are optimized
to provide a best fit to the measured electrical data and are not
intended as an exact physical interpretation of the device.
SUBCIRCUIT MODEL SCHEMATIC
This document is intended as a SPICE modeling guideline and does not constitute a commercial product data sheet. Designers should refer to the appropriate
data sheet of the same number for guaranteed specification limits.
Document Number: 72553
S-52446Rev. B, 28-Nov-05
www.vishay.com
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