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JGX-41F/2D-240A3ZSG

产品描述SOLID STATE RELAY
文件大小53KB,共3页
制造商ETC1
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JGX-41F/2D-240A3ZSG概述

SOLID STATE RELAY

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请问verilog中的for循环的循环次数可不可以作为输入参数,如 for(index=2;index<=n;index=index+4'b1) 其中的n作为函数的输入,我这样在quartus2 中综合报错,在modelism中没有报错,但是仿真不正确,不知道是不是由这个原因引起的。...
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