L-71-255,L-71-255 pdf中文资料,L-71-255引脚图,L-71-255电路-Datasheet-电子工程世界

L-71-255: 产品描述Passive Delay Line, 1-Func, 10-Tap, True Output, LOW PROFILE, DIP-14; 产品类别逻辑逻辑; 文件大小57KB，共1页; 制造商SIXNET; 官网地址http://www.sixnet.com/index.cfm

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L-71-255概述

Passive Delay Line, 1-Func, 10-Tap, True Output, LOW PROFILE, DIP-14

参数名称	属性值
厂商名称	SIXNET
零件包装代码	DIP
包装说明	DIP,
针数	14
Reach Compliance Code	unknown
其他特性	MILITARY DESIGNATION NUMBER M23859/23-255; MAX RISE TIME & TEMP. COEFF. CAPTURED
JESD-30 代码	R-XDIP-T14
长度	19.05 mm
负载电容（CL）	11 pF
逻辑集成电路类型	PASSIVE DELAY LINE
功能数量	1
抽头/阶步数	10
端子数量	14
最高工作温度	125 °C
最低工作温度	-55 °C
输出阻抗标称值（Z0）	200 Ω
输出极性	TRUE
封装主体材料	UNSPECIFIED
封装代码	DIP
封装形状	RECTANGULAR
封装形式	IN-LINE
可编程延迟线	NO
认证状态	Not Qualified
座面最大高度	6.6548 mm
表面贴装	NO
温度等级	MILITARY
端子形式	THROUGH-HOLE
端子节距	2.54 mm
端子位置	DUAL
总延迟标称（td）	450 ns
宽度	7.62 mm

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器件捷径: L0 L1 L2 L3 L4 L5 L6 L7 L8 L9 LA LB LC LD LE LF LG LH LI LJ LK LL LM LN LO LP LQ LR LS LT LU LV LW LX LY LZ M0 M1 M2 M3 M4 M5 M6 M7 M8 M9 MA MB MC MD ME MF MG MH MI MJ MK ML MM MN MO MP MQ MR MS MT MU MV MW MX MY MZ N0 N1 N2 N3 N4 N5 N6 N7 N8 NA NB NC ND NE NF NG NH NI NJ NK NL NM NN NO NP NQ NR NS NT NU NV NX NZ O0 O1 O2 O3 OA OB OC OD OE OF OG OH OI OJ OK OL OM ON OP OQ OR OS OT OV OX OY OZ P0 P1 P2 P3 P4 P5 P6 P7 P8 P9 PA PB PC PD PE PF PG PH PI PJ PK PL PM PN PO PP PQ PR PS PT PU PV PW PX PY PZ Q1 Q2 Q3 Q4 Q5 Q6 Q8 Q9 QA QB QC QE QF QG QH QK QL QM QP QR QS QT QV QW QX QY R0 R1 R2 R3 R4 R5 R6 R7 R8 R9 RA RB RC RD RE RF RG RH RI RJ RK RL RM RN RO RP RQ RR RS RT RU RV RW RX RY RZ

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