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IDT5T93GL16TFI: 产品描述Low Skew Clock Driver, 16 True Output(s), 0 Inverted Output(s), PQFP64, TQFP-64; 产品类别逻辑逻辑; 文件大小121KB，共16页; 制造商IDT (Integrated Device Technology)

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IDT5T93GL16TFI概述

Low Skew Clock Driver, 16 True Output(s), 0 Inverted Output(s), PQFP64, TQFP-64

IDT5T93GL16TFI规格参数

参数名称	属性值
是否Rohs认证	不符合
厂商名称	IDT (Integrated Device Technology)
零件包装代码	QFP
包装说明	LFQFP, QFP64,.47SQ,20
针数	64
Reach Compliance Code	not_compliant
输入调节	DIFFERENTIAL MUX
JESD-30 代码	S-PQFP-G64
JESD-609代码	e0
长度	10 mm
逻辑集成电路类型	LOW SKEW CLOCK DRIVER
湿度敏感等级	3
功能数量	1
反相输出次数
端子数量	64
实输出次数	16
最高工作温度	85 °C
最低工作温度	-40 °C
封装主体材料	PLASTIC/EPOXY
封装代码	LFQFP
封装等效代码	QFP64,.47SQ,20
封装形状	SQUARE
封装形式	FLATPACK, LOW PROFILE, FINE PITCH
电源	2.5 V
Prop。Delay @ Nom-Sup	2 ns
传播延迟（tpd）	2 ns
认证状态	Not Qualified
Same Edge Skew-Max（tskwd）	0.025 ns
座面最大高度	1.6 mm
最大供电电压 (Vsup)	2.7 V
最小供电电压 (Vsup)	2.3 V
标称供电电压 (Vsup)	2.5 V
表面贴装	YES
温度等级	INDUSTRIAL
端子面层	Tin/Lead (Sn85Pb15)
端子形式	GULL WING
端子节距	0.5 mm
端子位置	QUAD
宽度	10 mm
最小 fmax	650 MHz

IDT5T93GL16TFI文档预览

IDT5T93GL16

2.5V LVDS 1:16 GLITCHLESS CLOCK BUFFER TERABUFFER II

INDUSTRIAL TEMPERATURE RANGE

2.5V LVDS 1:16

GLITCHLESS CLOCK BUFFER

TERABUFFER™ II

FEATURES:

•

IDT5T93GL16

DESCRIPTION:

Guaranteed Low Skew < 25ps (max)

Very low duty cycle distortion < 100ps (max)

High speed propagation delay < 2ns (max)

Up to 650MHz operation

Glitchless input clock switching

Selectable inputs

Hot insertable and over-voltage tolerant inputs

3.3V / 2.5V LVTTL, HSTL, eHSTL, LVEPECL (2.5V), LVPECL (3.3V),

CML, or LVDS input interface

Selectable differential inputs to sixteen LVDS outputs

Power-down mode

2.5V V

Available in TQFP and VFQFPN packages

APPLICATIONS:

• Clock distribution

The IDT5T93GL16 2.5V differential clock buffer is a user-selectable differ-

ential input to sixteen LVDS outputs . The fanout from a differential input to sixteen

LVDS outputs reduces loading on the preceding driver and provides an efficient

clock distribution network. The IDT5T93GL16 can act as a translator from a

differential HSTL, eHSTL, LVEPECL (2.5V), LVPECL (3.3V), CML, or LVDS

input to LVDS outputs. A single-ended 3.3V / 2.5V LVTTL input can also be

used to translate to LVDS outputs. The redundant input capability allows for a

glitchless change-over from a primary clock source to a secondary clock

source. Selectable inputs are controlled by SEL. During the switchover, the

output will disable low for up to three clock cycles of the previously-selected input

clock. The outputs will remain low for up to three clock cycles of the newly-

selected clock, after which the outputs will start from the newly-selected input.

A FSEL pin has been implemented to control the switchover in cases where a

clock source is absent or is driven to DC levels below the minimum specifications.

The IDT5T93GL16 outputs can be asynchronously enabled/disabled.

When disabled, the outputs will drive to the value selected by the GL pin. Multiple

power and grounds reduce noise.

FUNCTIONAL BLOCK DIAGRAM

OUTPUT

CONTROL

OUTPUT

CONTROL

OUTPUT

CONTROL

OUTPUT

CONTROL

OUTPUT

CONTROL

OUTPUT

CONTROL

OUTPUT

CONTROL

SEL

FSEL

OUTPUT

CONTROL

OUTPUT

CONTROL

OUTPUT

CONTROL

Q10

OUTPUT

CONTROL

Q11

OUTPUT

CONTROL

Q12

OUTPUT

CONTROL

Q13

OUTPUT

CONTROL

Q14

OUTPUT

CONTROL

Q15

The IDT logo is a registered trademark of Integrated Device Technology, Inc.

INDUSTRIAL TEMPERATURE RANGE

OUTPUT

CONTROL

Q16

OCTOBER 2003

DSC-6185/13

IDT5T93GL16

2.5V LVDS 1:16 GLITCHLESS CLOCK BUFFER TERABUFFER II

INDUSTRIAL TEMPERATURE RANGE

PIN CONFIGURATIONS

FSEL

SEL

52 51 50 49 48 47 46 45 44 43 42 41 40

GND

14 15 16 17 18 19 20 21 22 23 24 25 26

GND

VFQFPN

TOP VIEW

IDT5T93GL16

2.5V LVDS 1:16 GLITCHLESS CLOCK BUFFER TERABUFFER II

INDUSTRIAL TEMPERATURE RANGE

PIN CONFIGURATIONS (CONTINUED)

GND

FSEL

SEL

GND

64 63 62 61 60 59 58 57 56 55 54 53 52 51 50 49

GND

17 18 19 20 21 22 23 24 25 26 27 28 29 30 31 32

GND

TQFP

(1)

TOP VIEW

NOTE:

1. 1m/s of airflow is required for TQFP in order to sustain normal operation.

GND

IDT5T93GL16

2.5V LVDS 1:16 GLITCHLESS CLOCK BUFFER TERABUFFER II

INDUSTRIAL TEMPERATURE RANGE

ABSOLUTE MAXIMUM RATINGS

(1)

Symbol

STG

Input Voltage

Output Voltage

(2)

Storage Temperature

Junction Temperature

Description

Power Supply Voltage

Max

–0.5 to +3.6

–0.5 to V

+0.5

–65 to +150

150

Unit

°C

CAPACITANCE

(1)

= +25°C, F = 1.0MHz)

Symbol

Parameter

Input Capacitance

Min

Typ.

Max.

Unit

—

NOTE:

1. This parameter is measured at characterization but not tested

NOTES:

1. Stresses greater than those listed under ABSOLUTE MAXIMUM RATINGS may cause

permanent damage to the device. This is a stress rating only and functional operation

of the device at these or any other conditions above those indicated in the operational

sections of this specification is not implied. Exposure to absolute maximum rating

conditions for extended periods may affect reliability.

2. Not to exceed 3.6V.

RECOMMENDED OPERATING RANGE

Symbol

Description

Ambient Operating Temperature

Internal Power Supply Voltage

Min.

–40

2.3

Typ.

+25

2.5

Max.

+85

2.7

Unit

°C

PIN DESCRIPTION

Symbol

[1:2]

I/O

Type

Adjustable

(1,4)

Adjustable

(1,4)

Description

Clock input. A

[1:2]

is the "true" side of the differential clock input.

Complementary clock inputs.

[1:2]

is the complementary side of A

[1:2].

For LVTTL single-ended operation,

[1:2]

should be set to the

desired toggle voltage for A

[1:2]

3.3V LVTTL V

REF

= 1650mV

2.5V LVTTL V

REF

= 1250mV

Gate control for differential outputs Q

and

through Q

and

. When

is LOW, the differential

outputs are active. When

is HIGH, the differential outputs are asynchronously driven to the level designated by GL

(2)

Gate control for differential outputs Q

and

through Q

and

. When

is LOW, the differential outputs are active. When

HIGH, the differential outputs are asynchronously driven to the level designated by GL

(2)

Specifies output disable level. If HIGH, "true" outputs disable HIGH and "complementary" outputs disable LOW. If LOW, "true"

outputs disable LOW and "complementary" outputs disable HIGH.

Clock outputs

Complementary clock outputs

Reference clock select. When LOW, selects A

and

. When HIGH, selects A

and

Power-down control. Shuts off entire chip. If LOW, the device goes into low power mode. Inputs and outputs are disabled. Both

"true" and "complementary" outputs will pull to V

. Set HIGH for normal operation.

(3)

Forces selection of clock input. If HIGH, FSEL forces select to the input designated by SEL. Set LOW for normal operation.

Power supply for the device core and inputs

Ground

SEL

FSEL

GND

LVTTL

LVDS

LVTTL

PWR

NOTES:

1. Inputs are capable of translating the following interface standards:

Single-ended 3.3V and 2.5V LVTTL levels

Differential HSTL and eHSTL levels

Differential LVEPECL (2.5V) and LVPECL (3.3V) levels

Differential LVDS levels

Differential CML levels

2. Because the gate controls are asynchronous, runt pulses are possible. It is the user's responsibility to either time the gate control signals to minimize the possibility of runt

pulses or be able to tolerate them in down stream circuitry.

3. It is recommended that the outputs be disabled before entering power-down mode. It is also recommended that the outputs remain disabled until the device completes power-

up after asserting

PD.

4. The user must take precautions with any differential input interface standard being used in order to prevent instability when there is no input signal.

IDT5T93GL16

2.5V LVDS 1:16 GLITCHLESS CLOCK BUFFER TERABUFFER II

INDUSTRIAL TEMPERATURE RANGE

DC ELECTRICAL CHARACTERISTICS OVER RECOMMENDED OPERATING

RANGE FOR LVTTL

(1)

Symbol

Parameter

Input Characteristics

Input HIGH Current

Input LOW Current

Clamp Diode Voltage

DC Input Voltage

DC Input HIGH

DC Input LOW

THI

DC Input Threshold Crossing Voltage

Single-Ended Reference Voltage

(3)

REF

Test Conditions

= 2.7V

= 2.3V, I

= -18mA

Min.

—

- 0.3

1.7

—

Typ.

(2)

—

- 0.7

Max

±5

- 1.2

+3.6

—

0.7

—

Unit

µA

3.3V LVTTL

2.5V LVTTL

1.65

1.25

NOTES:

1. See RECOMMENDED OPERATING RANGE table.

2. Typical values are at V

= 2.5V, +25°C ambient.

3. For A

[1:2]

single-ended operation,

[1:2]

is tied to a DC reference voltage.

DC ELECTRICAL CHARACTERISTICS OVER RECOMMENDED OPERATING

RANGE FOR DIFFERENTIAL INPUTS

(1)

Symbol

Parameter

Input Characteristics

Input HIGH Current

Input LOW Current

Clamp Diode Voltage

DC Input Voltage

DIF

DC Differential Voltage

(2)

DC Common Mode Input Voltage

(3)

Test Conditions

= 2.7V

= 2.3V, I

= -18mA

Min.

—

- 0.3

0.1

0.05

Typ.

(4)

—

- 0.7

Max

±5

- 1.2

+3.6

—

Unit

µA

NOTES:

1. See RECOMMENDED OPERATING RANGE table.

2. V

DIF

specifies the minimum input differential voltage (V

- V

) required for switching where V

is the "true" input level and V

is the "complement" input level. The DC differential

voltage must be maintained to guarantee retaining the existing HIGH or LOW input. The AC differential voltage must be achieved to guarantee switching to a new state.

3. V

specifies the maximum allowable range of (V

+ V

) /2.

4. Typical values are at V

= 2.5V, +25°C ambient.

DC ELECTRICAL CHARACTERISTICS OVER RECOMMENDED OPERATING

RANGE FOR LVDS

(1)

Symbol

Parameter

Output Characteristics

(+)

Differential Output Voltage for the True Binary State

(-)

Differential Output Voltage for the False Binary State

∆V

Change in V

Between Complementary Output States

Output Common Mode Voltage (Offset Voltage)

∆V

Change in V

Between Complementary Output States

Outputs Short Circuit Current

OSD

Differential Outputs Short Circuit Current

NOTES:

1. See RECOMMENDED OPERATING RANGE table.

2. Typical values are at V

= 2.5V, +25°C ambient.

Test Conditions

Min.

247

—

1.125

—

Typ.

(2)

—

1.2

—

Max

454

1.375

Unit

OUT

+ and V

OUT

- = 0V

OUT

+ = V

OUT

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IDT5T93GL16TFI相似产品对比

	IDT5T93GL16TFI	IDT5T93GL16NLI
描述	Low Skew Clock Driver, 16 True Output(s), 0 Inverted Output(s), PQFP64, TQFP-64	Low Skew Clock Driver, 5T Series, 16 True Output(s), 0 Inverted Output(s), PQCC52, PLASTIC, QFN-52
是否Rohs认证	不符合	不符合
厂商名称	IDT (Integrated Device Technology)	IDT (Integrated Device Technology)
零件包装代码	QFP	QFN
包装说明	LFQFP, QFP64,.47SQ,20	HVQCCN, LCC52,.31SQ,20
针数	64	52
Reach Compliance Code	not_compliant	not_compliant
输入调节	DIFFERENTIAL MUX	DIFFERENTIAL MUX
JESD-30 代码	S-PQFP-G64	S-PQCC-N52
JESD-609代码	e0	e0
长度	10 mm	8 mm
逻辑集成电路类型	LOW SKEW CLOCK DRIVER	LOW SKEW CLOCK DRIVER
湿度敏感等级	3	3
功能数量	1	1
端子数量	64	52
实输出次数	16	16
最高工作温度	85 °C	85 °C
最低工作温度	-40 °C	-40 °C
封装主体材料	PLASTIC/EPOXY	PLASTIC/EPOXY
封装代码	LFQFP	HVQCCN
封装等效代码	QFP64,.47SQ,20	LCC52,.31SQ,20
封装形状	SQUARE	SQUARE
封装形式	FLATPACK, LOW PROFILE, FINE PITCH	CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE
电源	2.5 V	2.5 V
Prop。Delay @ Nom-Sup	2 ns	2 ns
传播延迟（tpd）	2 ns	2 ns
认证状态	Not Qualified	Not Qualified
Same Edge Skew-Max（tskwd）	0.025 ns	0.025 ns
座面最大高度	1.6 mm	1 mm
最大供电电压 (Vsup)	2.7 V	2.7 V
最小供电电压 (Vsup)	2.3 V	2.3 V
标称供电电压 (Vsup)	2.5 V	2.5 V
表面贴装	YES	YES
温度等级	INDUSTRIAL	INDUSTRIAL
端子面层	Tin/Lead (Sn85Pb15)	Tin/Lead (Sn85Pb15)
端子形式	GULL WING	NO LEAD
端子节距	0.5 mm	0.5 mm
端子位置	QUAD	QUAD
宽度	10 mm	8 mm
最小 fmax	650 MHz	650 MHz

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