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HS328ESC01H: 产品描述IC MCU 8BIT 32KB OTP 68PLCC; 产品类别半导体嵌入式处理器和控制器; 文件大小1MB，共301页; 制造商Renesas(瑞萨电子); 官网地址https://www.renesas.com/

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HS328ESC01H概述

IC MCU 8BIT 32KB OTP 68PLCC

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To all our customers

Regarding the change of names mentioned in the document, such as

Hitachi Electric and Hitachi XX, to Renesas Technology Corp.

The semiconductor operations of Mitsubishi Electric and Hitachi were

transferred to Renesas Technology Corporation on April 1st 2003.

These operations include microcomputer, logic, analog and discrete devices,

and memory chips other than DRAMs (flash memory, SRAMs etc.)

Accordingly, although Hitachi, Hitachi, Ltd., Hitachi Semiconductors,

and other Hitachi brand names are mentioned in the document, these names

have in fact all been changed to Renesas Technology Corp.

Thank you for your understanding. Except for our corporate trademark,

logo and corporate statement, no changes whatsoever have been made to the

contents of the document, and these changes do not constitute any alteration

to the contents of the document itself.

Renesas Technology Home Page: www.renesas.com

Renesas Technology Corp.

Customer Support Dept.

April 1, 2003

Renesas Technology Corp.

CONTENTS

Section 1. Overview

............................................................................................................... 1

1.1

1.2

1.3

Overview...............................................................................................................................

Block Diagram......................................................................................................................

Pin Assignments and Functions............................................................................................

1.3.1 Pin Arrangement......................................................................................................

1.3.2 Pin Functions ...........................................................................................................

Section 2. MCU Operating Modes and Address Space

................................................ 15

2.1

2.2

2.3

Overview...............................................................................................................................

Mode Descriptions................................................................................................................

Address Space Map ..............................................................................................................

2.3.1 Access Speed ...........................................................................................................

2.3.2 IOS...........................................................................................................................

Mode and System Control Registers (MDCR and SYSCR).................................................

2.4.1 Mode Control Register (MDCR) – H’FFC5 ...........................................................

2.4.2 System Control Register (SYSCR) – H’FFC4 ........................................................

2.4

Section 3. CPU

........................................................................................................................ 27

3.1

3.2

Overview...............................................................................................................................

3.1.1 Features....................................................................................................................

Register Configuration..........................................................................................................

3.2.1 General Registers.....................................................................................................

3.2.2 Control Registers .....................................................................................................

3.2.3 Initial Register Values..............................................................................................

Addressing Modes ................................................................................................................

Data Formats.........................................................................................................................

3.4.1 Data Formats in General Registers..........................................................................

3.4.2 Memory Data Formats.............................................................................................

Instruction Set .......................................................................................................................

3.5.1 Data Transfer Instructions .......................................................................................

3.5.2 Arithmetic Operations .............................................................................................

3.5.3 Logic Operations .....................................................................................................

3.5.4 Shift Operations.......................................................................................................

3.5.5 Bit Manipulations ....................................................................................................

3.5.6 Branching Instructions.............................................................................................

3.5.7 System Control Instructions ....................................................................................

3.3

3.4

3.5

3.6

3.7

3.5.8 Block Data Transfer Instruction ..............................................................................

CPU States ............................................................................................................................

3.6.1 Program Execution State .........................................................................................

3.6.2 Exception-Handling State........................................................................................

3.6.3 Power-Down State ...................................................................................................

Access Timing and Bus Cycle ..............................................................................................

3.7.1 Access to On-Chip Memory (RAM and ROM) ......................................................

3.7.2 Access to On-Chip Register Field and External Devices ........................................

Section 4. Exception Handling

............................................................................................ 61

4.1

4.2

Overview...............................................................................................................................

Reset .....................................................................................................................................

4.2.1 Overview .................................................................................................................

4.2.2 Reset Sequence ........................................................................................................

4.2.3 Disabling of Interrupts after Reset...........................................................................

Interrupts...............................................................................................................................

4.3.1 Overview .................................................................................................................

4.3.2 Interrupt-Related Registers......................................................................................

4.3.3 External Interrupts ...................................................................................................

4.3.4 Internal Interrupts ....................................................................................................

4.3.5 Interrupt Handling ...................................................................................................

4.3.6 Interrupt Response Time..........................................................................................

Note on Stack Handling........................................................................................................

4.3

4.4

Section 5. I/O Ports

................................................................................................................ 77

5.1

5.2

5.3

5.4

5.5

5.6

5.7

5.8

Overview............................................................................................................................... 77

Port 1..................................................................................................................................... 78

Port 2..................................................................................................................................... 81

Port 3..................................................................................................................................... 84

Port 4..................................................................................................................................... 87

Port 5..................................................................................................................................... 94

Port 6..................................................................................................................................... 99

Port 7..................................................................................................................................... 104

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