S-818A59AUC-BHN-T2,S-818A59AUC-BHN-T2 pdf中文资料,S-818A59AUC-BHN-T2引脚图,S-818A59AUC-BHN-T2电路-Datasheet-电子工程世界

S-818A59AUC-BHN-T2: 产品描述Fixed Positive LDO Regulator, 5.9V, 0.2V Dropout, CMOS, PDSO6, SOT-89, 5 PIN; 产品类别电源/电源管理电源电路; 文件大小716KB，共31页; 制造商ABLIC

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S-818A59AUC-BHN-T2概述

Fixed Positive LDO Regulator, 5.9V, 0.2V Dropout, CMOS, PDSO6, SOT-89, 5 PIN

参数名称	属性值
是否Rohs认证	不符合
厂商名称	ABLIC
零件包装代码	SOT-89
包装说明	LSOF, FL6,.1,60
针数	5
Reach Compliance Code	compliant
ECCN代码	EAR99
可调性	FIXED
最大回动电压 1	0.2 V
标称回动电压 1	0.17 V
最大绝对输入电压	12 V
最大输入电压	10 V
最小输入电压	6.4 V
JESD-30 代码	R-PDSO-F6
长度	4.5 mm
最大负载调整率	0.05%
功能数量	1
输出次数	1
端子数量	6
最高工作温度	85 °C
最低工作温度	-40 °C
最大输出电流 1	0.08 A
最大输出电压 1	6.018 V
最小输出电压 1	5.782 V
标称输出电压 1	5.9 V
封装主体材料	PLASTIC/EPOXY
封装代码	LSOF
封装等效代码	FL6,.1,60
封装形状	RECTANGULAR
封装形式	SMALL OUTLINE, LOW PROFILE
包装方法	TAPE AND REEL
峰值回流温度（摄氏度）	NOT SPECIFIED
认证状态	Not Qualified
调节器类型	FIXED POSITIVE SINGLE OUTPUT LDO REGULATOR
座面最大高度	1.6 mm
表面贴装	YES
技术	CMOS
端子形式	FLAT
端子节距	1.5 mm
端子位置	DUAL
处于峰值回流温度下的最长时间	NOT SPECIFIED
最大电压容差	2%
宽度	2.5 mm

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关于430放449用IO口模拟串口的下降沿捕获问题: 大家好，我想请教一个问题。我用430f449的2.0和2.1口来模拟串口，2.0做输出，2.1做输入。把2.1的SEL打开，然后用TIMERB0来做接收起始位下降沿的捕获，用外接的32.768K晶振的ACLK做TIMERB0的时钟源。TBCCTL0的控制字是TBCCTL0 = OUTMOD_0 + CCIE + CM_2 + CAP + CCIS_1 + SCS; 结果发现接收数据时下降沿不进入中...; lopwind 微控制器 MCU

器件捷径: E0 E1 E2 E3 E4 E5 E6 E7 E8 E9 EA EB EC ED EE EF EG EH EI EJ EK EL EM EN EO EP EQ ER ES ET EU EV EW EX EY EZ F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 FA FB FC FD FE FF FG FH FI FJ FK FL FM FN FO FP FQ FR FS FT FU FV FW FX FY FZ G0 G1 G2 G3 G4 G5 G6 G7 G8 G9 GA GB GC GD GE GF GG GH GI GJ GK GL GM GN GO GP GQ GR GS GT GU GV GW GX GZ H0 H1 H2 H3 H4 H5 H6 H7 H8 HA HB HC HD HE HF HG HH HI HJ HK HL HM HN HO HP HQ HR HS HT HU HV HW HX HY HZ I1 I2 I3 I4 I5 I6 I7 IA IB IC ID IE IF IG IH II IK IL IM IN IO IP IQ IR IS IT IU IV IW IX J0 J1 J2 J6 J7 JA JB JC JD JE JF JG JH JJ JK JL JM JN JP JQ JR JS JT JV JW JX JZ K0 K1 K2 K3 K4 K5 K6 K7 K8 K9 KA KB KC KD KE KF KG KH KI KJ KK KL KM KN KO KP KQ KR KS KT KU KV KW KX KY KZ

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