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TSXPC750AVGSB/T10LH

产品描述RISC Microprocessor, 32-Bit, 233MHz, CMOS, CBGA360, CERAMIC, CGA-360
产品类别嵌入式处理器和控制器    微控制器和处理器   
文件大小169KB,共2页
制造商Atmel (Microchip)
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TSXPC750AVGSB/T10LH概述

RISC Microprocessor, 32-Bit, 233MHz, CMOS, CBGA360, CERAMIC, CGA-360

TSXPC750AVGSB/T10LH规格参数

参数名称属性值
是否Rohs认证不符合
厂商名称Atmel (Microchip)
零件包装代码CGA
包装说明CGA,
针数360
Reach Compliance Codecompliant
ECCN代码3A001.A.2.C
地址总线宽度32
位大小32
边界扫描YES
最大时钟频率83.3 MHz
外部数据总线宽度64
格式FLOATING POINT
集成缓存YES
JESD-30 代码S-CBGA-X360
长度25 mm
低功率模式YES
端子数量360
封装主体材料CERAMIC, METAL-SEALED COFIRED
封装代码CGA
封装形状SQUARE
封装形式GRID ARRAY
认证状态Not Qualified
筛选级别MIL-STD-883
座面最大高度4.2 mm
速度233 MHz
最大供电电压2.7 V
最小供电电压2.5 V
标称供电电压2.6 V
表面贴装YES
技术CMOS
端子形式UNSPECIFIED
端子节距1.27 mm
端子位置BOTTOM
宽度25 mm
uPs/uCs/外围集成电路类型MICROPROCESSOR, RISC

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PC740A/PC750AFS - Rev.1 – 01/11
PC740A and 750APowerPC™ Microprocessors
Fact Sheet
The PowerPC 750 and PowerPC740 microprocessors are low-power 32-bit implementations of the PowerPC Reduced
Instruction Set Computer (RISC) architecture. The PowerPC 750 and the PowerPC 740 micro-processors differ only in that
the PowerPC 750 features a dedicated L2 cache interface with on-chip L2 tags.
Both are software -compatible and bus-compatible with the PowerPC603e
TM
micro -processor families, and the PowerPC
740 is pin-compatible as well. PowerPC 750/740 micro-processors are fully JTAG
-compliant.
PC740/750 Main Features
n
Six independent execution units
:
- Two integer units
- Floating-point unit
- Branch processing unit
- Load/store unit
- System register unit
n
Cache and MMU Support
- 32-Kbytes, physically-addressed instruction and data cache
- 8-way set -associative
- Dedicated L2 cache interface with on-chip L2 tags (PC750, only)
- Separate Instruction and Data MMUs
- Virtual memory support up to 4 Petabytes (2
52
)
- Real memory support up to 4 Gigabytes (2
52
)
- 128-entry instruction and data TLBs
Completion
Unit
Dispatch
Unit
Branch
Unit
Integer
Unit
Gen Gen
Reg Re-
File name
Load/
Store
Unit
FPU
Reg
File
Floating
Point
Unit
D MMU
Data Cache
I MMU
Inst. Cache
Bus Interface Unit
L2
tags
32bit
Address
System Bus
64bit
Data
L2 Cache
Port (750 only)
L2 Data Bus
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