Datasheet> 器件分类 > 逻辑> 逻辑> 74LVC162373ADGG:11

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74LVC162373ADGG:11: 产品描述IC,LATCH,DUAL,8-BIT,LCX/LVC-CMOS,TSSOP,48PIN,PLASTIC; 产品类别逻辑逻辑; 文件大小246KB，共19页; 制造商NXP(恩智浦); 官网地址https://www.nxp.com; 标准

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74LVC162373ADGG:11概述

IC,LATCH,DUAL,8-BIT,LCX/LVC-CMOS,TSSOP,48PIN,PLASTIC

IC,锁存器,双,8位,LCX/LVC-CMOS,TSSOP,48PIN,塑料

74LVC162373ADGG:11规格参数

参数名称	属性值
Source Url Status Check Date	2013-06-14 00:00:00
Brand Name	NXP Semiconductor
是否Rohs认证	符合
厂商名称	NXP(恩智浦)
零件包装代码	TSSOP
包装说明	6.10 MM, PLASTIC, MO-153, SOT-362-1, TSSOP-48
针数	48
制造商包装代码	SOT362-1
Reach Compliance Code	compliant
Base Number Matches	1

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Important notice

Dear Customer,

On 7 February 2017 the former NXP Standard Product business became a new company with the

tradename

Nexperia.

Nexperia is an industry leading supplier of Discrete, Logic and PowerMOS

semiconductors with its focus on the automotive, industrial, computing, consumer and wearable

application markets

In data sheets and application notes which still contain NXP or Philips Semiconductors references, use

the references to Nexperia, as shown below.

Instead of http://www.nxp.com, http://www.philips.com/ or http://www.semiconductors.philips.com/,

use

http://www.nexperia.com

Instead of sales.addresses@www.nxp.com or sales.addresses@www.semiconductors.philips.com, use

salesaddresses@nexperia.com

(email)

Replace the copyright notice at the bottom of each page or elsewhere in the document, depending on

the version, as shown below:

reserved

Should be replaced with:

If you have any questions related to the data sheet, please contact our nearest sales office via e-mail

or telephone (details via

salesaddresses@nexperia.com).

Thank you for your cooperation and

understanding,

Kind regards,

Team Nexperia

74LVC162373A; 74LVCH162373A

16-bit D-type transparent latch; 30



series termination

resistors; 5 V tolerant inputs/outputs; 3-state

Rev. 4 — 14 May 2013

Product data sheet

1. General description

The 74LVC162373A and 74LVCH162373A are 16-bit D-type transparent latches with

separate D-type inputs with bus hold (74LVCH162373A only) for each latch and 3-state

outputs for bus-oriented applications. One latch enable (pin nLE) input and one output

enable (pin nOE) are provided for each octal. Inputs can be driven from either 3.3 V or 5 V

devices. When disabled, up to 5.5 V can be applied to the outputs. These features allow

the use of these devices in mixed 3.3 V and 5 V applications. The device consists of two

sections of eight D-type transparent latches with 3-state true outputs. When pin nLE is

HIGH, data at the corresponding data inputs (pins nDn) enter the latches. In this condition,

the latches are transparent, that is, the latch output changes each time its corresponding

data inputs changes. When pin nLE is LOW, the latches store the information that was

present at the data inputs a set-up time preceding the HIGH to LOW transition of pin

nLE.When pin nOE is LOW, the contents of the eight latches are available at the outputs.

When pin nOE is HIGH, the outputs go to the high-impedance OFF-state. Operation of the

nOE input does not affect the state of the latches.

The device is designed with 30



series termination resistors in both HIGH and LOW

output stages to reduce line noise. Bus hold on data inputs eliminates the need for

external pull-up resistors to hold unused inputs.

2. Features and benefits



5 V tolerant inputs/outputs for interfacing with 5 V logic

Wide supply voltage range from 1.2 V to 3.6 V

CMOS low power consumption

Multibyte flow-through standard pinout architecture

Multiple low inductance supply pins for minimum noise and ground bounce

Direct interface with TTL levels

All data inputs have bus hold (74LVCH162373A only)

High-impedance when V

= 0 V

Complies with JEDEC standard:



JESD8-7A (1.65 V to 1.95 V)



JESD8-5A (2.3 V to 2.7 V)



JESD8-C/JESD36 (2.7 V to 3.6 V)

74LVC162373ADGG:11相似产品对比

	74LVC162373ADGG:11	74LVC162373ADL,118	74LVCH162373ADGG,1	74LVC162373ADGG:51	74LVC162373ADGG,51	74LVCH162373ADL,11	74LVCH162373ADL:11
描述	IC,LATCH,DUAL,8-BIT,LCX/LVC-CMOS,TSSOP,48PIN,PLASTIC	IC,LATCH,DUAL,8-BIT,LCX/LVC-CMOS,TSSOP,48PIN,PLASTIC	IC,LATCH,DUAL,8-BIT,LCX/LVC-CMOS,TSSOP,48PIN,PLASTIC	IC,LATCH,DUAL,8-BIT,LCX/LVC-CMOS,TSSOP,48PIN,PLASTIC	IC,LATCH,DUAL,8-BIT,LCX/LVC-CMOS,TSSOP,48PIN,PLASTIC	IC,LATCH,DUAL,8-BIT,LCX/LVC-CMOS,TSSOP,48PIN,PLASTIC	IC,LATCH,DUAL,8-BIT,LCX/LVC-CMOS,TSSOP,48PIN,PLASTIC
Brand Name	NXP Semiconductor	NXP Semiconductor	NXP Semiconductor	NXP Semiconduc	NXP Semiconduc	NXP Semiconductor	NXP Semiconductor
厂商名称	NXP(恩智浦)	NXP(恩智浦)	NXP(恩智浦)	NXP(恩智浦)	NXP(恩智浦)	NXP(恩智浦)	NXP(恩智浦)
零件包装代码	TSSOP	SSOP	TSSOP	TSSOP	TSSOP	SSOP	SSOP
针数	48	48	48	48	48	48	48
制造商包装代码	SOT362-1	SOT370-1	SOT362-1	SOT362-1	SOT362-1	SOT370-1	SOT370-1
Reach Compliance Code	compliant	compliant	compliant	unknow	compli	compliant	compliant
Base Number Matches	1	1	1	1	1	1	1
是否Rohs认证	符合	符合	-	符合	-	-	符合
包装说明	6.10 MM, PLASTIC, MO-153, SOT-362-1, TSSOP-48	SSOP, SSOP48,.4	6.10 MM, PLASTIC, MO-153, SOT-362-1, TSSOP-48	-	TSSOP,	7.50 MM, PLASTIC, MO-118, SOT-370-1, SSOP-48	SSOP, SSOP48,.4
系列	-	LVC/LCX/Z	-	LVC/LCX/Z	LVC/LCX/Z	LVC/LCX/Z	LVC/LCX/Z
JESD-30 代码	-	R-PDSO-G48	-	R-PDSO-G48	R-PDSO-G48	R-PDSO-G48	R-PDSO-G48
JESD-609代码	-	e4	-	e4	e4	e4	e4
长度	-	15.875 mm	-	12.5 mm	12.5 mm	15.875 mm	15.875 mm
负载电容（CL）	-	50 pF	-	50 pF	50 pF	50 pF	50 pF
逻辑集成电路类型	-	BUS DRIVER	-	BUS DRIVER	BUS DRIVER	BUS DRIVER	BUS DRIVER
最大I（ol）	-	0.012 A	-	0.012 A	-	0.012 A	0.012 A
湿度敏感等级	-	1	-	1	1	1	1
位数	-	8	-	8	8	8	8
功能数量	-	2	-	2	2	2	2
端口数量	-	2	-	2	2	2	2
端子数量	-	48	-	48	48	48	48
最高工作温度	-	125 °C	-	125 °C	125 °C	125 °C	125 °C
最低工作温度	-	-40 °C	-	-40 °C	-40 °C	-40 °C	-40 °C
输出特性	-	3-STATE WITH SERIES RESISTOR	-	3-STATE WITH SERIES RESISTOR	3-STATE WITH SERIES RESISTOR	3-STATE WITH SERIES RESISTOR	3-STATE WITH SERIES RESISTOR
输出极性	-	TRUE	-	TRUE	TRUE	TRUE	TRUE
封装主体材料	-	PLASTIC/EPOXY	-	PLASTIC/EPOXY	PLASTIC/EPOXY	PLASTIC/EPOXY	PLASTIC/EPOXY
封装代码	-	SSOP	-	TSSOP	TSSOP	SSOP	SSOP
封装等效代码	-	SSOP48,.4	-	TSSOP48,.3,20	-	SSOP48,.4	SSOP48,.4
封装形状	-	RECTANGULAR	-	RECTANGULAR	RECTANGULAR	RECTANGULAR	RECTANGULAR
封装形式	-	SMALL OUTLINE, SHRINK PITCH	-	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH	SMALL OUTLINE, SHRINK PITCH	SMALL OUTLINE, SHRINK PITCH
峰值回流温度（摄氏度）	-	260	-	260	260	260	260
电源	-	3.3 V	-	3.3 V	-	3.3 V	3.3 V
传播延迟（tpd）	-	9 ns	-	9 ns	9 ns	9 ns	9 ns
认证状态	-	Not Qualified	-	Not Qualified	Not Qualified	Not Qualified	Not Qualified
座面最大高度	-	2.8 mm	-	1.2 mm	1.2 mm	2.8 mm	2.8 mm
最大供电电压 (Vsup)	-	3.6 V	-	3.6 V	3.6 V	3.6 V	3.6 V
最小供电电压 (Vsup)	-	1.2 V	-	1.2 V	1.2 V	1.2 V	1.2 V
标称供电电压 (Vsup)	-	2.7 V	-	2.7 V	2.7 V	2.7 V	2.7 V
表面贴装	-	YES	-	YES	YES	YES	YES
技术	-	CMOS	-	CMOS	CMOS	CMOS	CMOS
温度等级	-	AUTOMOTIVE	-	AUTOMOTIVE	AUTOMOTIVE	AUTOMOTIVE	AUTOMOTIVE
端子面层	-	NICKEL PALLADIUM GOLD	-	NICKEL PALLADIUM GOLD	NICKEL PALLADIUM GOLD	NICKEL PALLADIUM GOLD	NICKEL PALLADIUM GOLD
端子形式	-	GULL WING	-	GULL WING	GULL WING	GULL WING	GULL WING
端子节距	-	0.635 mm	-	0.5 mm	0.5 mm	0.635 mm	0.635 mm
端子位置	-	DUAL	-	DUAL	DUAL	DUAL	DUAL
处于峰值回流温度下的最长时间	-	30	-	30	30	30	30
宽度	-	7.5 mm	-	6.1 mm	6.1 mm	7.5 mm	7.5 mm

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