Datasheet> 器件分类 > 可编程逻辑器件> 可编程逻辑> A40MX02-PL44A

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A40MX02-PL44A: 产品描述FPGA, 3000 GATES, PQCC44, PLASTIC, LCC-44; 产品类别可编程逻辑器件可编程逻辑; 文件大小429KB，共76页; 制造商Microsemi; 官网地址https://www.microsemi.com

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A40MX02-PL44A概述

FPGA, 3000 GATES, PQCC44, PLASTIC, LCC-44

A40MX02-PL44A规格参数

参数名称	属性值
是否Rohs认证	不符合
厂商名称	Microsemi
包装说明	QCCJ,
Reach Compliance Code	compliant
CLB-Max的组合延迟	2.3 ns
JESD-30 代码	S-PQCC-J44
JESD-609代码	e0
长度	16.5862 mm
湿度敏感等级	3
等效关口数量	3000
端子数量	44
最高工作温度	125 °C
最低工作温度	-40 °C
组织	3000 GATES
封装主体材料	PLASTIC/EPOXY
封装代码	QCCJ
封装形状	SQUARE
封装形式	CHIP CARRIER
峰值回流温度（摄氏度）	225
可编程逻辑类型	FIELD PROGRAMMABLE GATE ARRAY
认证状态	Not Qualified
座面最大高度	4.57 mm
最大供电电压	5.25 V
最小供电电压	4.75 V
标称供电电压	5 V
表面贴装	YES
技术	CMOS
温度等级	AUTOMOTIVE
端子面层	TIN LEAD
端子形式	J BEND
端子节距	1.27 mm
端子位置	QUAD
处于峰值回流温度下的最长时间	30
宽度	16.5862 mm

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v2.0



MX Automotive Family FPGAs

Features

•

Single-Chip ASIC Alternative for

Automotive Applications

3,000 to 54,000 System Gates

Up to 2.5 kbits Configurable Dual-Port SRAM

Fast Wide-Decode Circuitry

Up to 202 User-Programmable I/O Pins

u e

Ease of Integration

•

Synthesis-Friendly Architecture Supports ASIC Design

Methodologies

Up to 100% Resource Utilization and 100% Pin Fixing

Deterministic, User-Controllable Timing

Unique In-System Diagnostic

Capability with Silicon Explorer II

Low Power Consumption

IEEE Standard 1149.1 (JTAG) Boundary Scan Testing

and

Verification

Product Profile

Device

Capacity

System Gates

SRAM Bits

Logic Modules

Sequential

Combinatorial

Decode

SRAM Modules

(64x4 or 32x8)

Dedicated Flip-Flops

Maximum Flip-Flops

Clocks

Maximum User I/Os

Boundary Scan Test (BST)

Packages

(by pin count)

PLCC

PQFP

VQFP

TQFP

A40MX02

3,000

–

295

–

147

100

–

A40MX04

6,000

–

547

–

273

100

–

A42MX09

14,000

–

348

336

–

348

516

104

100, 160

100

176

A42MX16

24,000

–

624

608

–

624

928

140

–

208

100

176

A42MX24

36,000

–

954

912

–

954

1,410

176

Yes

–

160, 208

–

176

A42MX36

54,000

2,560

1,230

1,184

1,230

1,822

202

Yes

–

208, 240

–

September 2003

Table of Contents

MX Automotive Family FPGAs

General Description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1-1

Power Requirements . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1-1

MX Architectural Overview . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1-1

Development Tool Support . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1-7

5.0V Operating Conditions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1-9

Package Thermal Characteristics . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1-10

Power Dissipation . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1-10

Timing Information . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1-13

Parameter Measurement . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1-16

Sequential Timing Characteristics . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1-17

Decode Module Timing . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1-19

Dual-Port SRAM Timing Waveforms . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1-20

Predictable Performance:

Tight Delay Distributions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1-22

Temperature and Voltage . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1-23

Timing Characteristics . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1-25

Pin Descriptions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1-42

Package Pin Assignments

68-Pin PLCC . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2-1

84-Pin PLCC . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2-2

100-Pin PQFP Package (Top View). . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2-4

160-Pin PQFP Package (Top View). . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2-7

208-Pin PQFP Package (Top View). . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2-11

240-Pin PQFP Package (Top View). . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2-15

80-Pin VQFP . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2-18

100-Pin VQFP Package (Top View) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2-20

176-Pin TQFP Package (Top View). . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2-23

v 2.0

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