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IDT74FCT3807SOI8

产品描述Low Skew Clock Driver, FCT Series, 10 True Output(s), 0 Inverted Output(s), CMOS, PDSO20, SOIC-20
产品类别逻辑    逻辑   
文件大小76KB,共8页
制造商IDT (Integrated Device Technology)
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IDT74FCT3807SOI8概述

Low Skew Clock Driver, FCT Series, 10 True Output(s), 0 Inverted Output(s), CMOS, PDSO20, SOIC-20

IDT74FCT3807SOI8规格参数

参数名称属性值
是否Rohs认证不符合
厂商名称IDT (Integrated Device Technology)
零件包装代码SOIC
包装说明SOP, SOP20,.4
针数20
Reach Compliance Codenot_compliant
系列FCT
输入调节STANDARD
JESD-30 代码R-PDSO-G20
JESD-609代码e0
长度12.8016 mm
逻辑集成电路类型LOW SKEW CLOCK DRIVER
最大I(ol)0.024 A
湿度敏感等级1
功能数量1
反相输出次数
端子数量20
实输出次数10
最高工作温度85 °C
最低工作温度-40 °C
输出特性3-STATE
封装主体材料PLASTIC/EPOXY
封装代码SOP
封装等效代码SOP20,.4
封装形状RECTANGULAR
封装形式SMALL OUTLINE
峰值回流温度(摄氏度)225
电源3.3 V
Prop。Delay @ Nom-Sup4.8 ns
传播延迟(tpd)4.8 ns
认证状态Not Qualified
Same Edge Skew-Max(tskwd)0.6 ns
座面最大高度2.6416 mm
最大供电电压 (Vsup)3.6 V
最小供电电压 (Vsup)3 V
标称供电电压 (Vsup)3.3 V
表面贴装YES
技术CMOS
温度等级INDUSTRIAL
端子面层Tin/Lead (Sn85Pb15)
端子形式GULL WING
端子节距1.27 mm
端子位置DUAL
处于峰值回流温度下的最长时间30
宽度7.5184 mm

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IDT74FCT3807/A
3.3V CMOS 1-TO-10 CLOCK DRIVER
COMMERCIAL/INDUSTRIAL TEMPERATURE RANGES
3.3V CMOS
1-TO-10 CLOCK DRIVER
IDT74FCT3807/A
FEATURES:
DESCRIPTION:
0.5 MICRON CMOS Technology
Guaranteed low skew < 350ps (max.)
Very low duty cycle distortion < 350ps (max.)
High speed: propagation delay < 3ns (max.)
Very low CMOS power levels
TTL compatible inputs and outputs
1:10 fanout
Maximum output rise and fall time < 1.5ns (max.)
Low input capacitance: 4.5pF typical
V
CC
= 3.3V ± 0.3V
Inputs can be driven from 3.3V or 5V components
Available in SSOP, SOIC, and QSOP packages
The FCT3807/A 3.3V clock driver is built using advanced dual metal CMOS
technology. This low skew clock driver offers 1:10 fanout. The large fanout from
a single input reduces loading on the preceding driver and provides an efficient
clock distribution network. The FCT3807/A offers low capacitance inputs with
hysteresis for improved noise margins. Multiple power and grounds reduce
noise. Typical applications are clock and signal distribution.
NOTE: EOL for non-green parts to occur on 5/13/10 per
PDN U-09-01
FUNCTIONAL BLOCK DIAGRAM
O
1
PIN CONFIGURATION
IN
O
2
1
2
3
4
5
6
7
8
9
10
20
19
18
17
16
15
14
13
12
11
V
CC
O
10
O
9
GND
O
8
V
CC
O
7
GND
O
6
O
5
GND
O
1
O
3
V
CC
O
2
O
4
GND
O
3
O
5
IN
O
6
V
CC
O
4
GND
O
7
SOIC/ SSOP/ QSOP
TOP VIEW
O
8
O
9
O
10
The IDT logo is a registered trademark of Integrated Device Technology, Inc.
COMMERCIAL/INDUSTRIAL TEMPERATURE RANGES
1
c
2001 Integrated Device Technology, Inc.
DECEMBER 2009
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