Datasheet> 器件分类 > 嵌入式处理器和控制器> 微控制器和处理器> IA188ES-PTQ100I-03

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IA188ES-PTQ100I-03: 产品描述Microcontroller,; 产品类别嵌入式处理器和控制器微控制器和处理器; 文件大小3MB，共154页; 制造商Innovasic（ADI）; 官网地址http://www.innovasic.com/

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IA188ES-PTQ100I-03概述

Microcontroller,

IA188ES-PTQ100I-03规格参数

参数名称	属性值
厂商名称	Innovasic（ADI）
包装说明	TFQFP, TQFP100,.63SQ
Reach Compliance Code	compliant
具有ADC	NO
地址总线宽度	8
位大小	8
边界扫描	NO
DAC 通道	NO
DMA 通道	YES
集成缓存	NO
JESD-30 代码	S-PQFP-G100
长度	14 mm
DMA 通道数量	2
I/O 线路数量	32
端子数量	100
计时器数量	4
最高工作温度	85 °C
最低工作温度	-40 °C
PWM 通道	NO
封装主体材料	PLASTIC
封装代码	TFQFP
封装等效代码	TQFP100,.63SQ
封装形状	SQUARE
封装形式	FLATPACK, THIN PROFILE, FINE PITCH
座面最大高度	1.2 mm
速度	40 MHz
最大压摆率	5.9 mA
标称供电电压	5 V
表面贴装	YES
技术	CMOS
温度等级	INDUSTRIAL
端子形式	GULL WING
端子节距	0.5 mm
端子位置	QUAD
宽度	14 mm
uPs/uCs/外围集成电路类型	MICROCONTROLLER

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TABLE OF CONTENTS

List of Figures ..................................................................................................................................9

List of Tables .................................................................................................................................10

Conventions ...................................................................................................................................13

Acronyms and Abbreviations ........................................................................................................14

Introduction...........................................................................................................................15

1.1 General Description.....................................................................................................15

1.2 Features .......................................................................................................................15

Packaging, Pin Descriptions, and Physical Dimensions .......................................................16

2.1 Packages and Pinouts ..................................................................................................16

2.1.1 IA186ES TQFP Package ................................................................................17

2.1.2 IA188ES TQFP Package ................................................................................20

2.1.3 TQFP Physical Dimensions ............................................................................23

2.1.4 IA186ES PQFP Package.................................................................................24

2.1.5 IA188ES PQFP Package.................................................................................27

2.1.6 PQFP Physical Dimensions ............................................................................30

2.2 Pin Descriptions ..........................................................................................................31

2.2.1 a19/pio9, a18/pio8, a17/pio7, a16–a0—Address Bus (synchronous

outputs with tristate) .......................................................................................31

2.2.2 ad15–ad8 (IA186ES)—Address/Data Bus (level-sensitive

synchronous inouts with tristate) ....................................................................31

2.2.3 ao15–ao8 (IA188ES)—Address Bus (level-sensitive synchronous

outputs with tristate) .......................................................................................31

2.2.4 ad7–ad0—Address/Data Bus (level-sensitive synchronous inouts with

tristate) ............................................................................................................31

2.2.5 ale—Address Latch Enable (synchronous output) .........................................32

2.2.6 ardy—Asynchronous Ready (level-sensitive asynchronous input) ................32

2.2.7 bhe_n/aden_n (IA186ES only)—Bus High Enable (synchronous

output with tristate)/Address Enable (input with internal pullup) ..................32

2.2.8 clkouta—Clock Output A (synchronous output) ............................................33

2.2.9 clkoutb—Clock Output B (synchronous output) ............................................33

2.2.10 cts0_n/enrx0_n/pio21—Clear-to-Send 0/Enable-Receive-Request 0

(both are asynchronous inputs) .......................................................................33

2.2.11 den_n/ds_n/pio5—Data Enable /Data Strobe (both are synchronous

outputs with tristate) .......................................................................................34

2.2.12 drq0/int5/pio12—DMA Request 0 (synchronous level-sensitive

input)/Maskable Interrupt Request 5 (asynchronous edge-triggered

input) ...............................................................................................................34

2.2.13 drq1/int6/pio13—DMA Request 1 (synchronous level-sensitive

input)/Maskable Interrupt Request 6 (asynchronous edge-triggered

input) ...............................................................................................................34

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2.2.14 dt/r_n/pio4—Data Transmit or Receive (synchronous output with

tristate) ............................................................................................................34

2.2.15 gnd—Ground ..................................................................................................35

2.2.16 hlda—Bus Hold Acknowledge (synchronous output) ....................................35

2.2.17 int0—Maskable Interrupt Request 0 (asynchronous input) ............................35

2.2.18 int1/select_n—Maskable Interrupt Request 1/Slave Select (both are

asynchronous inputs) ......................................................................................35

2.2.19 int2/inta0_n/pwd/pio31—Maskable Interrupt Request 2

(asynchronous input)/Interrupt Acknowledge 0 (synchronous

output)/Pulse Width Demodulator (Schmitt trigger input) .............................36

2.2.20 int3/inta1_n/irq—Maskable Interrupt Request 3 (asynchronous

input)/Interrupt Acknowledge 1 (synchronous output)/Interrupt

Acknowledge (synchronous output) ...............................................................36

2.2.21 int4/pio30—Maskable Interrupt Request 4 (asynchronous input)..................37

2.2.22 lcs_n/once0_n—Lower Memory Chip Select (synchronous output

with internal pullup)/ONCE Mode Request (input) .......................................37

2.2.23 mcs0_n/pio14—Midrange Memory Chip Select (synchronous output

with internal pullup) .......................................................................................37

2.2.24 mcs2_n–mcs1_n (pio24–pio 15)—Midrange Memory Chip Selects

(synchronous outputs with internal pullup) ....................................................37

2.2.25 mcs3_n/rfsh_n/pio25—Midrange Memory Chip Select (synchronous

outputs with internal pullup)/Automatic Refresh (synchronous output) ........38

2.2.26 nmi—Nonmaskable Interrupt (synchronous edge-sensitive input) ................38

2.2.27 pcs1_n–pcs0_n (pio17–pio16)—Peripheral Chip Selects 1–0

(synchronous outputs) .....................................................................................38

2.2.28 pcs2_n/cts1_n/enrx1_n/pio18—Peripheral Chip Select 2

(synchronous output)/Clear-to-Send 1 (asynchronous input)/Enable-

Receiver-Request 1 (asynchronous input) ......................................................39

2.2.29 pcs3_n/rts1_n/rtr1_n/pio18—Peripheral Chip Select 3 (synchronous

output)/Ready-to-Send 1 (asynchronous output)/Ready-to-Receive 1

(asynchronous input) ......................................................................................39

2.2.30 pcs5_n/A1/pio3—Peripheral Chip Select 5 (synchronous

output)/Latched Address Bit [1] (synchronous output) ..................................40

2.2.31 pcs6_n/A2/pio2—Peripheral Chip Select 6 (synchronous

output)/Latched Address Bit [2] (synchronous output) ..................................40

2.2.32 pio31–pio0—Programmable I/O Pins (asynchronous input/output

open-drain) ......................................................................................................40

2.2.33 rd_n—Read strobe (synchronous output with tristate) ...................................40

2.2.34 res_n—Reset (asynchronous level-sensitive input) ........................................40

2.2.35 rfsh2_n/aden_n (IA188ES only)—Refresh 2 (synchronous output

with tristate)/Address Enable (input with internal pullup) .............................41

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2.2.36 rts0_n/rtr0_n/pio20—Ready-to-Send 0 (asynchronous output)/Ready-

to-Receive 0 (asynchronous input) .................................................................41

2.2.37 rxd0_n/pio23—Receive Data 0 (asynchronous input) ...................................41

2.2.38 rxd1_n/pio28—Receive Data 1 (asynchronous input) ...................................41

2.2.39 s2_n–s0_n—Bus Cycle Status (synchronous outputs with tristate) ...............41

2.2.40 s6/lock_n/clkdiv2_n/pio29—Bus Cycle Status Bit [6] (synchronous

output)/Bus Lock (synchronous output)/Clock Divide by 2 (input with

internal pullup)................................................................................................42

2.2.41 srdy/pio6—Synchronous Ready (synchronous level-sensitive input) ............42

2.2.42 tmrin0/pio11—Timer Input 0 (synchronous edge-sensitive input) ................42

2.2.43 tmrin1/pio0—Timer Input 1 (synchronous edge-sensitive input) ..................43

2.2.44 tmrout0/pio10—Timer Output 0 (synchronous output) .................................43

2.2.45 tmrout1/pio1—Timer Output 1 (synchronous output) ...................................43

2.2.46 txd0/pio22—Transmit Data 0 (asynchronous output) ....................................43

2.2.47 txd1/pio27—Transmit Data 1 (asynchronous output) ....................................43

2.2.48 ucs_n/once1_n—Upper Memory Chip Select (synchronous

output)/ONCE Mode Request 1 (input with internal pullup) .........................43

2.2.49 uzi_n/pio26—Upper Zero Indicate (synchronous output) ..............................44

2.2.50 v

—Power Supply (input)..............................................................................44

2.2.51 whb_n (IA186ES only)—Write High Byte (synchronous output with

tristate) ............................................................................................................44

2.2.52 wlb_n/wb_n—Write Low Byte (IA186ES only) (synchronous output

with tristate)/Write Byte (IA188ES only) (synchronous output with

tristate) ............................................................................................................44

2.2.53 wr_n—Write Strobe (synchronous output) ....................................................44

2.2.54 x1—Crystal Input ...........................................................................................44

2.2.55 x2—Crystal Input ...........................................................................................44

2.3 Pins Used by Emulators ..............................................................................................45

Maximum Ratings, Thermal Characteristics, and DC Parameters .......................................45

Device Architecture ..............................................................................................................47

4.1 Bus Interface and Control ...........................................................................................47

4.2 Clock and Power Management ...................................................................................49

4.3 System Clocks .............................................................................................................49

4.4 Power-Save Mode .......................................................................................................50

4.5 Initialization and Reset ................................................................................................50

4.6 Reset Configuration Register ......................................................................................50

4.7 Chip Selects .................................................................................................................50

4.8 Chip-Select Timing .....................................................................................................50

4.9 Ready- and Wait-State Programming..........................................................................51

4.10 Chip-Select Overlap ....................................................................................................51

4.11 Upper-Memory Chip Select ........................................................................................52

4.12 Low-Memory Chip Select ...........................................................................................52

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IA188ES-PTQ100I-03相似产品对比

	IA188ES-PTQ100I-03	IA186ES-PTQ100I-03	IA186ES-PQF100I-03	IA188ES-PQF100I-03	A186ES-PQF100I-R-03
描述	Microcontroller,	Microcontroller,	Microcontroller	Microcontroller	Microcontroller
包装说明	TFQFP, TQFP100,.63SQ	TFQFP, TQFP100,.63SQ	QFP, QFP100,.7X.9	QFP, QFP100,.7X.9	,
Reach Compliance Code	compliant	compliant	compliant	compliant	compliant
厂商名称	Innovasic（ADI）	-	-	Innovasic（ADI）	Innovasic（ADI）
具有ADC	NO	NO	NO	NO	-
地址总线宽度	8	8	8	8	-
位大小	8	8	8	8	-
边界扫描	NO	NO	NO	NO	-
DAC 通道	NO	NO	NO	NO	-
DMA 通道	YES	YES	YES	YES	-
集成缓存	NO	NO	NO	NO	-
JESD-30 代码	S-PQFP-G100	S-PQFP-G100	R-PQFP-G100	R-PQFP-G100	-
长度	14 mm	14 mm	20 mm	20 mm	-
DMA 通道数量	2	2	2	2	-
I/O 线路数量	32	32	32	32	-
端子数量	100	100	100	100	-
计时器数量	4	4	4	4	-
最高工作温度	85 °C	85 °C	85 °C	85 °C	-
最低工作温度	-40 °C	-40 °C	-40 °C	-40 °C	-
PWM 通道	NO	NO	NO	NO	-
封装主体材料	PLASTIC	PLASTIC	PLASTIC	PLASTIC	-
封装代码	TFQFP	TFQFP	QFP	QFP	-
封装等效代码	TQFP100,.63SQ	TQFP100,.63SQ	QFP100,.7X.9	QFP100,.7X.9	-
封装形状	SQUARE	SQUARE	RECTANGULAR	RECTANGULAR	-
封装形式	FLATPACK, THIN PROFILE, FINE PITCH	FLATPACK, THIN PROFILE, FINE PITCH	FLATPACK	FLATPACK	-
座面最大高度	1.2 mm	1.2 mm	3.4 mm	3.4 mm	-
速度	40 MHz	40 MHz	40 MHz	40 MHz	-
最大压摆率	5.9 mA	5.9 mA	5.9 mA	5.9 mA	-
标称供电电压	5 V	5 V	5 V	5 V	-
表面贴装	YES	YES	YES	YES	-
技术	CMOS	CMOS	CMOS	CMOS	-
温度等级	INDUSTRIAL	INDUSTRIAL	INDUSTRIAL	INDUSTRIAL	-
端子形式	GULL WING	GULL WING	GULL WING	GULL WING	-
端子节距	0.5 mm	0.5 mm	0.65 mm	0.65 mm	-
端子位置	QUAD	QUAD	QUAD	QUAD	-
宽度	14 mm	14 mm	14 mm	14 mm	-
uPs/uCs/外围集成电路类型	MICROCONTROLLER	MICROCONTROLLER	MICROCONTROLLER	MICROCONTROLLER	-

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