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IDT71V424L10Y8

产品描述Standard SRAM, 512KX8, 10ns, CMOS, PDSO36, 0.400 INCH, PLASTIC, SOJ-36
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文件大小78KB,共9页
制造商IDT (Integrated Device Technology)
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IDT71V424L10Y8概述

Standard SRAM, 512KX8, 10ns, CMOS, PDSO36, 0.400 INCH, PLASTIC, SOJ-36

IDT71V424L10Y8规格参数

参数名称属性值
是否Rohs认证不符合
厂商名称IDT (Integrated Device Technology)
零件包装代码SOJ
包装说明0.400 INCH, PLASTIC, SOJ-36
针数36
Reach Compliance Codenot_compliant
ECCN代码3A991.B.2.A
最长访问时间10 ns
I/O 类型COMMON
JESD-30 代码R-PDSO-J36
JESD-609代码e0
长度23.495 mm
内存密度4194304 bit
内存集成电路类型STANDARD SRAM
内存宽度8
湿度敏感等级3
功能数量1
端子数量36
字数524288 words
字数代码512000
工作模式ASYNCHRONOUS
最高工作温度70 °C
最低工作温度
组织512KX8
输出特性3-STATE
封装主体材料PLASTIC/EPOXY
封装代码SOJ
封装等效代码SOJ36,.44
封装形状RECTANGULAR
封装形式SMALL OUTLINE
并行/串行PARALLEL
峰值回流温度(摄氏度)225
电源3.3 V
认证状态Not Qualified
座面最大高度3.683 mm
最大待机电流0.01 A
最小待机电流3 V
最大压摆率0.165 mA
最大供电电压 (Vsup)3.6 V
最小供电电压 (Vsup)3 V
标称供电电压 (Vsup)3.3 V
表面贴装YES
技术CMOS
温度等级COMMERCIAL
端子面层Tin/Lead (Sn85Pb15)
端子形式J BEND
端子节距1.27 mm
端子位置DUAL
处于峰值回流温度下的最长时间30
宽度10.16 mm
Base Number Matches1

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3.3V CMOS Static RAM
4 Meg (512K x 8-Bit)
Features
Description
IDT71V424S
IDT71V424L
512K x 8 advanced high-speed CMOS Static RAM
JEDEC Center Power / GND pinout for reduced noise
Equal access and cycle times
— Commercial and Industrial: 10/12/15ns
Single 3.3V power supply
One Chip Select plus one Output Enable pin
Bidirectional data inputs and outputs directly
TTL-compatible
Low power consumption via chip deselect
Available in 36-pin, 400 mil plastic SOJ package and
44-pin, 400 mil TSOP.
The IDT71V424 is a 4,194,304-bit high-speed Static RAM organized
as 512K x 8. It is fabricated using high-perfomance, high-reliability CMOS
technology. This state-of-the-art technology, combined with innovative
circuit design techniques, provides a cost-effective solution for high-speed
memory needs.
The IDT71V424 has an output enable pin which operates as fast as
5ns, with address access times as fast as 10ns. All bidirectional inputs and
outputs of the IDT71V424 are TTL-compatible and operation is from a
single 3.3V supply. Fully static asynchronous circuitry is used, requiring
no clocks or refresh for operation.
The IDT71V424 is packaged in a 36-pin, 400 mil Plastic SOJ and 44-
pin, 400 mil TSOP.
Functional Block Diagram
A
0
A
18
ADDRESS
DECODER
4,194,304-BIT
MEMORY ARRAY
I/O
0
- I/O
7
8
I/O CONTROL
8
8
WE
OE
CS
CONTROL
LOGIC
3622 drw 01
SEPTEMBER 2013
1
©2013
Integrated Device Technology, Inc.
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