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74LVT16500ADL,118

产品描述74LVT16500A - 3.3 V 18-bit universal bus transceiver; 3-state SSOP 56-Pin
产品类别逻辑    逻辑   
文件大小99KB,共19页
制造商NXP(恩智浦)
官网地址https://www.nxp.com
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74LVT16500ADL,118概述

74LVT16500A - 3.3 V 18-bit universal bus transceiver; 3-state SSOP 56-Pin

74LVT16500ADL,118规格参数

参数名称属性值
Source Url Status Check Date2013-06-14 00:00:00
Brand NameNXP Semiconductor
厂商名称NXP(恩智浦)
零件包装代码SSOP
包装说明7.50 MM, PLASTIC, MO-118, SOT-371-1, SSOP-56
针数56
制造商包装代码SOT371-1
Reach Compliance Codeunknown
Base Number Matches1

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74LVT16500A
3.3 V 18-bit universal bus transceiver; 3-state
Rev. 03 — 29 May 2006
Product data sheet
1. General description
The 74LVT16500A is a high-performance BiCMOS product designed for V
CC
operation at
3.3 V.
This device is an 18-bit universal transceiver featuring non-inverting 3-state bus
compatible outputs in both send and receive directions. Data flow in each direction is
controlled by output enable (OEAB and OEBA), latch enable (LEAB and LEBA), and clock
(CPAB and CPBA) inputs. For A-to-B data flow, the device operates in the transparent
mode when LEAB is HIGH. When LEAB is LOW, the A data is latched if CPAB is held at a
HIGH or LOW logic level. If LEAB is LOW, the A-bus data is stored in the latch/flip-flop on
the HIGH-to-LOW transition of CPAB. When OEAB is HIGH, the outputs are active. When
OEAB is LOW, the outputs are in the high-impedance state.
Data flow for B-to-A is similar to that of A-to-B but uses OEBA, LEBA and CPBA. The
output enables are complimentary (OEAB is active HIGH, and OEBA is active LOW).
Active bus-hold circuitry is provided to hold unused or floating data inputs at a valid logic
level.
2. Features
I
I
I
I
I
I
I
I
I
I
I
I
I
18-bit bidirectional bus interface
3-state buffers
Output capability: +64 mA and
−32
mA
TTL input and output switching levels
Input and output interface capability to systems at 5 V supply
Bus-hold data inputs eliminate the need for external pull-up resistors to hold unused
inputs
Live insertion/extraction permitted
Power-up reset
Power-up 3-state
No bus current loading when output is tied to 5 V bus
Negative edge-triggered clock inputs
Latch-up protection:
N
JESD78: exceeds 500 mA
ESD protection:
N
MIL STD 883 Method 3015: exceeds 2000 V
N
CDM JESD22-C101-C exceeds 1000 V

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描述 74LVT16500A - 3.3 V 18-bit universal bus transceiver; 3-state SSOP 56-Pin 74LVT16500A - 3.3 V 18-bit universal bus transceiver; 3-state SSOP 56-Pin
Source Url Status Check Date 2013-06-14 00:00:00 2013-06-14 00:00:00
Brand Name NXP Semiconductor NXP Semiconductor
厂商名称 NXP(恩智浦) NXP(恩智浦)
零件包装代码 SSOP SSOP
包装说明 7.50 MM, PLASTIC, MO-118, SOT-371-1, SSOP-56 7.50 MM, PLASTIC, MO-118, SOT-371-1, SSOP-56
针数 56 56
制造商包装代码 SOT371-1 SOT371-1
Reach Compliance Code unknown unknown
Base Number Matches 1 1
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