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IDT71T016SA20PH1

产品描述Standard SRAM, 64KX16, 20ns, CMOS, PDSO44
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文件大小138KB,共9页
制造商IDT (Integrated Device Technology)
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IDT71T016SA20PH1概述

Standard SRAM, 64KX16, 20ns, CMOS, PDSO44

IDT71T016SA20PH1规格参数

参数名称属性值
是否无铅含铅
是否Rohs认证不符合
Reach Compliance Codenot_compliant
最长访问时间20 ns
I/O 类型COMMON
JESD-30 代码R-PDSO-G44
JESD-609代码e0
内存密度1048576 bit
内存集成电路类型STANDARD SRAM
内存宽度16
湿度敏感等级3
端子数量44
字数65536 words
字数代码64000
工作模式ASYNCHRONOUS
最高工作温度125 °C
最低工作温度-40 °C
组织64KX16
输出特性3-STATE
封装主体材料PLASTIC/EPOXY
封装代码TSOP
封装等效代码TSOP44,.46,32
封装形状RECTANGULAR
封装形式SMALL OUTLINE, THIN PROFILE
并行/串行PARALLEL
峰值回流温度(摄氏度)225
电源2.5 V
认证状态Not Qualified
最大待机电流0.005 A
最小待机电流2.38 V
最大压摆率0.09 mA
标称供电电压 (Vsup)2.5 V
表面贴装YES
技术CMOS
温度等级AUTOMOTIVE
端子面层Tin/Lead (Sn85Pb15)
端子形式GULL WING
端子节距0.8 mm
端子位置DUAL
处于峰值回流温度下的最长时间30
Base Number Matches1

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2.5V CMOS Static RAM
for Automotive Applications
1 Meg (64K x 16-Bit)
Features
x
x
IDT71T016SA
Description
The IDT71T016 is a 1,048,576-bit high-speed Static RAM organized
as 64K x 16. It is fabricated using IDT’s high-perfomance, high-reliability
CMOS technology. This state-of-the-art technology, combined with inno-
vative circuit design techniques, provides a cost-effective solution for high-
speed memory needs for automotive applications.
The IDT71T016 has an output enable pin which operates as fast as
6ns, with address access times as fast as 12ns. All bidirectional inputs and
outputs of the IDT71T016 are LVTTL-compatible and operation is from a
single 2.5V supply. Fully static asynchronous circuitry is used, requiring
no clocks or refresh for operation.
The IDT71T016 is packaged in a JEDEC standard a 44-pin Plastic
SOJ, 44-pin TSOP Type II, and a 48-ball plastic 7 x 7 mm FBGA.
x
x
x
x
x
x
64K x 16 advanced high-speed CMOS Static RAM
Equal access and cycle times
— Automotive: 12/15/20ns
One Chip Select plus one Output Enable pin
Bidirectional data inputs and outputs directly
LVTTL-compatible
Low power consumption via chip deselect
Upper and Lower Byte Enable Pins
Single 2.5V power supply
Available in 44-pin Plastic SOJ, 44-pin TSOP, and 48-Ball
Plastic FBGA packages
Functional Block Diagram
OE
Output
Enable
Buffer
A
0
– A
15
Address
Buffers
Row / Column
Decoders
I/O
15
Chip
Enable
Buffer
Sense
Amps
and
Write
Drivers
8
Low
Byte
I/O
Buffer
8
8
High
Byte
I/O
Buffer
8
CS
I/O
8
WE
Write
Enable
Buffer
64K x 16
Memory
Array
16
I/O
7
I/O
0
BHE
Byte
Enable
Buffers
BLE
6473 drw 01
AUGUST 2004
1
©2004 Integrated Device Technology, Inc.
DSC-6473/00
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