LT1050ACJ8,LT1050ACJ8 pdf中文资料,LT1050ACJ8引脚图,LT1050ACJ8电路-Datasheet-电子工程世界

LT1050ACJ8: 产品描述IC OP-AMP, 5 uV OFFSET-MAX, 2.5 MHz BAND WIDTH, CDIP8, CERAMIC, DIP-8, Operational Amplifier; 产品类别模拟混合信号IC 放大器电路; 文件大小798KB，共16页; 制造商Linear ( ADI ); 官网地址http://www.analog.com/cn/index.html

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LT1050ACJ8概述

IC OP-AMP, 5 uV OFFSET-MAX, 2.5 MHz BAND WIDTH, CDIP8, CERAMIC, DIP-8, Operational Amplifier

参数名称	属性值
零件包装代码	DIP
包装说明	DIP,
针数	8
Reach Compliance Code	unknown
放大器类型	OPERATIONAL AMPLIFIER
最大平均偏置电流 (IIB)	0.0001 µA
标称共模抑制比	140 dB
最大输入失调电压	5 µV
JESD-30 代码	R-CDIP-T8
JESD-609代码	e0
负供电电压上限	-9 V
标称负供电电压 (Vsup)	-5 V
功能数量	1
端子数量	8
最高工作温度	85 °C
最低工作温度	-40 °C
封装主体材料	CERAMIC, METAL-SEALED COFIRED
封装代码	DIP
封装形状	RECTANGULAR
封装形式	IN-LINE
认证状态	Not Qualified
座面最大高度	5.08 mm
标称压摆率	4 V/us
供电电压上限	9 V
标称供电电压 (Vsup)	5 V
表面贴装	NO
技术	CMOS
温度等级	INDUSTRIAL
端子面层	TIN LEAD
端子形式	THROUGH-HOLE
端子节距	2.54 mm
端子位置	DUAL
标称均一增益带宽	2500 kHz
宽度	7.62 mm
Base Number Matches	1

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Getting a task done in another clock domain: If the clkA domain has a task that needs to be completed in the clkB domain, you can use the following design.[img]http://www.fpga4fun.com/images/CrossClockDomain.task.gif[/img]Here's one way to do it...; eeleader FPGA/CPLD

器件捷径: L0 L1 L2 L3 L4 L5 L6 L7 L8 L9 LA LB LC LD LE LF LG LH LI LJ LK LL LM LN LO LP LQ LR LS LT LU LV LW LX LY LZ M0 M1 M2 M3 M4 M5 M6 M7 M8 M9 MA MB MC MD ME MF MG MH MI MJ MK ML MM MN MO MP MQ MR MS MT MU MV MW MX MY MZ N0 N1 N2 N3 N4 N5 N6 N7 N8 NA NB NC ND NE NF NG NH NI NJ NK NL NM NN NO NP NQ NR NS NT NU NV NX NZ O0 O1 O2 O3 OA OB OC OD OE OF OG OH OI OJ OK OL OM ON OP OQ OR OS OT OV OX OY OZ P0 P1 P2 P3 P4 P5 P6 P7 P8 P9 PA PB PC PD PE PF PG PH PI PJ PK PL PM PN PO PP PQ PR PS PT PU PV PW PX PY PZ Q1 Q2 Q3 Q4 Q5 Q6 Q8 Q9 QA QB QC QE QF QG QH QK QL QM QP QR QS QT QV QW QX QY R0 R1 R2 R3 R4 R5 R6 R7 R8 R9 RA RB RC RD RE RF RG RH RI RJ RK RL RM RN RO RP RQ RR RS RT RU RV RW RX RY RZ

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