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HCS10D/SAMPLE

产品描述HCS10D/SAMPLE
产品类别逻辑    逻辑   
文件大小182KB,共8页
制造商Renesas(瑞萨电子)
官网地址https://www.renesas.com/
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HCS10D/SAMPLE概述

HCS10D/SAMPLE

HCS10D/SAMPLE规格参数

参数名称属性值
厂商名称Renesas(瑞萨电子)
零件包装代码DIP
包装说明DIP,
针数14
Reach Compliance Codeunknown
系列HC/UH
JESD-30 代码R-CDIP-T14
逻辑集成电路类型NAND GATE
功能数量3
输入次数3
端子数量14
最高工作温度125 °C
最低工作温度-55 °C
封装主体材料CERAMIC, METAL-SEALED COFIRED
封装代码DIP
封装形状RECTANGULAR
封装形式IN-LINE
传播延迟(tpd)22 ns
认证状态Not Qualified
座面最大高度5.08 mm
最大供电电压 (Vsup)5.5 V
最小供电电压 (Vsup)4.5 V
标称供电电压 (Vsup)5 V
表面贴装NO
技术CMOS
温度等级MILITARY
端子形式THROUGH-HOLE
端子节距2.54 mm
端子位置DUAL
总剂量200k Rad(Si) V
宽度7.62 mm
Base Number Matches1

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HCS10MS
September 1995
Radiation Hardened
Triple 3-Input NAND Gate
Pinouts
14 LEAD CERAMIC DUAL-IN-LINE
METAL SEAL PACKAGE (SBDIP)
MIL-STD-183S CDIP2-T14, LEAD FINISH C
TOP VIEW
A1 1
B1 2
A2 3
B2 4
C2 5
Y2 6
GND 7
14 VCC
13 C1
12 Y1
11 C3
10 B3
9 A3
8 Y3
Features
• 3 Micron Radiation Hardened SOS CMOS
• Total Dose 200K RAD (Si)
• SEP Effective LET No Upsets: >100 MEV-cm
2
/mg
• Single Event Upset (SEU) Immunity < 2 x 10
-9
Errors/Bit-Day
(Typ)
• Dose Rate Survivability: >1 x 10
12
RAD (Si)/s
• Dose Rate Upset >10
10
RAD (SI)/s 20ns Pulse
• Cosmic Ray Upset Immunity < 2 x 10
-9
Errors/Gate Day (Typ)
• Latch-Up Free Under Any Conditions
• Military Temperature Range: -55
o
C to +125
o
C
• Significant Power Reduction Compared to LSTTL ICs
• DC Operating Voltage Range: 4.5V to 5.5V
• Input Logic Levels
- VIL = 30% of VCC Max
- VIH = 70% of VCC Min
• Input Current Levels Ii
5µA at VOL, VOH
14 LEAD CERAMIC METAL SEAL FLATPACK PACKAGE
(FLATPACK) MIL-STD-183S CDFP3-F14, LEAD FINISH C
TOP VIEW
A1
B1
A2
B2
C2
Y2
GND
1
2
3
4
5
6
7
14
13
12
11
10
9
8
VCC
C1
Y1
C3
B3
A3
Y3
Description
The Intersil HCS10MS is a Radiation Hardened Triple 3-Input
NAND Gate. A high on all inputs forces the output to a Low state.
The HCS10MS utilizes advanced CMOS/SOS technology to
achieve high-speed operation. This device is a member of
radiation hardened, high-speed, CMOS/SOS Logic Family.
The HCS10MS is supplied in a 14 lead Ceramic flatpack (K suffix)
or a SBDIP Package (D suffix).
Functional Diagram
An
(1, 3, 9)
Bn
(2, 4, 10)
Yn
(12, 6, 8)
Ordering Information
PART
NUMBER
HCS05DMSR
TEMPERATURE
RANGE
-55
o
C to +125
o
C
SCREENING
LEVEL
Intersil Class
S Equivalent
Intersil Class
S Equivalent
Sample
PACKAGE
14 Lead SBDIP
Cn
(5, 11, 13)
TRUTH TABLE
INPUTS
An
L
Bn
L
L
H
H
L
L
H
H
Cn
L
H
L
H
L
H
L
H
OUTPUTS
Yn
H
H
H
H
H
H
H
L
HCS05KMSR
-55
o
C to +125
o
C
14 Lead Ceramic
Flatpack
14 Lead SBDIP
L
L
HCS05D/
Sample
HCS05K/
Sample
HCS05HMSR
+25
o
C
L
H
+25
o
C
Sample
14 Lead Ceramic
Flatpack
Die
H
H
H
+25
o
C
Die
NOTE: L = Logic Level Low, H = Logic level High
CAUTION: These devices are sensitive to electrostatic discharge; follow proper IC Handling Procedures.
1-888-INTERSIL or 321-724-7143 | Copyright © Intersil Corporation 1999
Spec Number
File Number
1
518747
2435.2

HCS10D/SAMPLE相似产品对比

HCS10D/SAMPLE HCS10K/SAMPLE
描述 HCS10D/SAMPLE HCS10K/SAMPLE
厂商名称 Renesas(瑞萨电子) Renesas(瑞萨电子)
零件包装代码 DIP DFP
包装说明 DIP, DFP,
针数 14 14
Reach Compliance Code unknown unknown
系列 HC/UH HC/UH
JESD-30 代码 R-CDIP-T14 R-CDFP-F14
逻辑集成电路类型 NAND GATE NAND GATE
功能数量 3 3
输入次数 3 3
端子数量 14 14
最高工作温度 125 °C 125 °C
最低工作温度 -55 °C -55 °C
封装主体材料 CERAMIC, METAL-SEALED COFIRED CERAMIC, METAL-SEALED COFIRED
封装代码 DIP DFP
封装形状 RECTANGULAR RECTANGULAR
封装形式 IN-LINE FLATPACK
传播延迟(tpd) 22 ns 22 ns
认证状态 Not Qualified Not Qualified
座面最大高度 5.08 mm 2.92 mm
最大供电电压 (Vsup) 5.5 V 5.5 V
最小供电电压 (Vsup) 4.5 V 4.5 V
标称供电电压 (Vsup) 5 V 5 V
表面贴装 NO YES
技术 CMOS CMOS
温度等级 MILITARY MILITARY
端子形式 THROUGH-HOLE FLAT
端子节距 2.54 mm 1.27 mm
端子位置 DUAL DUAL
总剂量 200k Rad(Si) V 200k Rad(Si) V
宽度 7.62 mm 6.285 mm
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