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LA-ispMACH4064V

产品描述EE PLD, 8 ns, PQFP100
产品类别半导体    可编程逻辑器件   
文件大小185KB,共42页
制造商Lattice(莱迪斯)
官网地址http://www.latticesemi.com
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LA-ispMACH4064V概述

EE PLD, 8 ns, PQFP100

电子可编程逻辑器件, 8 ns, PQFP100

LA-ispMACH4064V规格参数

参数名称属性值
功能数量1
端子数量100
最大工作温度125 Cel
最小工作温度-40 Cel
最大供电/工作电压3.6 V
最小供电/工作电压3 V
额定供电电压3.3 V
输入输出总线数量64
加工封装描述LEAD FREE, TQFP-100
无铅Yes
欧盟RoHS规范Yes
中国RoHS规范Yes
状态ACTIVE
工艺CMOS
包装形状SQUARE
包装尺寸FLATPACK, LOW PROFILE, FINE PITCH
表面贴装Yes
端子形式GULL WING
端子间距0.5000 mm
端子涂层MATTE TIN
端子位置QUAD
包装材料PLASTIC/EPOXY
温度等级AUTOMOTIVE
组织0 DEDICATED INPUTS, 64 I/O
最大FCLK时钟频率168 MHz
输出功能MACROCELL
可编程逻辑类型EE PLD
传播延迟TPD8 ns
专用输入数量0.0

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LA-ispMACH 4000V/Z
Automotive Family
3.3V/1.8V In-System Programmable
SuperFAST
TM
High Density PLDs
May 2009
Data Sheet DS1017
Features
High Performance
• f
MAX
= 168MHz maximum operating frequency
• t
PD
= 7.5ns propagation delay
• Up to four global clock pins with programmable
clock polarity control
• Up to 80 PTs per output
Ease of Design
• Enhanced macrocells with individual clock,
reset, preset and clock enable controls
• Up to four global OE controls
• Individual local OE control per I/O pin
• Excellent First-Time-Fit
TM
and refit
• Fast path, SpeedLocking
TM
Path, and wide-PT
path
• Wide input gating (36 input logic blocks) for fast
counters, state machines and address decoders
• 5V tolerant I/O for LVCMOS 3.3, LVTTL, and PCI
interfaces
• Hot-socketing
• Open-drain capability
• Input pull-up, pull-down or bus-keeper
• Programmable output slew rate
• 3.3V PCI compatible
• IEEE 1149.1 boundary scan testable
• 3.3V/2.5V/1.8V In-System Programmable
(ISP™) using IEEE 1532 compliant interface
• I/O pins with fast setup path
• Lead-free (RoHS) package
Introduction
The high performance LA-ispMACH 4000V/Z automo-
tive family from Lattice offers a SuperFAST CPLD solu-
tion that is tested and qualified to the AEC-Q100
standard. The family is a blend of Lattice’s two most
popular architectures: the ispLSI
®
2000 and ispMACH
4A. Retaining the best of both families, the LA-ispMACH
4000V/Z architecture focuses on significant innovations
to combine the highest performance with low power in a
flexible CPLD family.
The LA-ispMACH 4000V/Z automotive family combines
high speed and low power with the flexibility needed for
ease of design. With its robust Global Routing Pool and
Output Routing Pool, this family delivers excellent First-
Time-Fit, timing predictability, routing, pin-out retention
and density migration.
Zero Power (LA-ispMACH 4000Z)
• Typical static current 10µA (4032Z)
• 1.8V core low dynamic power
• LA-ispMACH 4000Z operational down to 1.6V
AEC-Q100 Tested and Qualified
• Automotive: -40 to 125°C ambient (T
A
)
Easy System Integration
• Superior solution for power sensitive consumer
applications
• Operation with 3.3V, 2.5V or 1.8V LVCMOS I/O
• Operation with 3.3V (4000V) or 1.8V (4000Z)
supplies
Table 1. LA-ispMACH 4000V Automotive Family Selection Guide
LA-ispMACH 4032V
Macrocells
I/O + Dedicated Inputs
t
PD
(ns)
t
S
(ns)
t
CO
(ns)
f
MAX
(MHz)
Supply Voltage (V)
Pins/Package
32
30+2/32+4
7.5
4.5
4.5
168
3.3V
44-pin Lead-Free TQFP
48-pin Lead-Free TQFP
LA-ispMACH 4064V
64
30+2/32+4/64+10
7.5
4.5
4.5
168
3.3V
44-pin Lead-Free TQFP
48-pin Lead-Free TQFP
100-pin Lead-Free TQFP
LA-ispMACH 4128V
128
64+10/92+4/96+4
7.5
4.5
4.5
168
3.3V
100-pin Lead-Free TQFP
128-pin Lead-Free TQFP
144-pin Lead-Free TQFP
© 2009 Lattice Semiconductor Corp. All Lattice trademarks, registered trademarks, patents, and disclaimers are as listed at www.latticesemi.com/legal. All other brand
or product names are trademarks or registered trademarks of their respective holders. The specifications and information herein are subject to change without notice.
www.latticesemi.com
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