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74VHC03_04

产品描述QUAD 2-INPUT OPEN DRAIN NAND GATE
文件大小161KB,共11页
制造商ST(意法半导体)
官网地址http://www.st.com/
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74VHC03_04概述

QUAD 2-INPUT OPEN DRAIN NAND GATE

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74VHC03
QUAD 2-INPUT OPEN DRAIN NAND GATE
s
s
s
s
s
s
s
s
HIGH SPEED: t
PD
= 3.7ns (TYP.) at V
CC
= 5V
LOW POWER DISSIPATION:
I
CC
= 2
µA
(MAX.) at T
A
=25°C
HIGH NOISE IMMUNITY:
V
NIH
= V
NIL
= 28% V
CC
(MIN.)
POWER DOWN PROTECTION ON INPUTS
OPERATING VOLTAGE RANGE:
V
CC
(OPR) = 2V to 5.5V
PIN AND FUNCTION COMPATIBLE WITH
74 SERIES 03
IMPROVED LATCH-UP IMMUNITY
LOW NOISE: V
OLP
= 0.8V (MAX.)
SOP
TSSOP
Table 1: Order Codes
PACKAGE
SOP
TSSOP
DESCRIPTION
The 74VHC03 is an advanced high-speed CMOS
QUAD 2-INPUT OPEN DRAIN NAND GATE
fabricated with sub-micron silicon gate and
double-layer metal wiring C
2
MOS technology.
The internal circuit is composed of 3 stages
including buffer output, which provides high noise
immunity and stable output.
This device can, with an external pull-up resistor,
be used in wired AND configuration. This device
can also be used as a led driver and in any other
application requiring a current sink.
Figure 1: Pin Connection And IEC Logic Symbols
O
et
l
so
b
ro
P
e
uc
d
s)
t(
Power down protection is provided on all inputs
and 0 to 7V can be accepted on inputs with no
regard to the supply voltage. This device can be
used to interface 5V to 3V.
All inputs and outputs are equipped with
protection circuits against static discharge, giving
them 2KV ESD immunity and transient excess
voltage.
O
-
so
b
te
le
ro
P
uc
d
s)
t(
T&R
74VHC03MTR
74VHC03TTR
November 2004
Rev. 4
1/11

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描述 QUAD 2-INPUT OPEN DRAIN NAND GATE QUAD 2-INPUT OPEN DRAIN NAND GATE
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