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CAT22C10PI-30

产品描述Non-Volatile SRAM, 64X4, 300ns, CMOS, PDIP18, PLASTIC, DIP-18
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文件大小58KB,共10页
制造商Catalyst
官网地址http://www.catalyst-semiconductor.com/
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CAT22C10PI-30概述

Non-Volatile SRAM, 64X4, 300ns, CMOS, PDIP18, PLASTIC, DIP-18

CAT22C10PI-30规格参数

参数名称属性值
是否Rohs认证不符合
零件包装代码DIP
包装说明DIP, DIP18,.3
针数18
Reach Compliance Codeunknown
ECCN代码EAR99
最长访问时间300 ns
其他特性DATA RETENTION > 10 YEARS
JESD-30 代码R-PDIP-T18
JESD-609代码e0
长度21.97 mm
内存密度256 bit
内存集成电路类型NON-VOLATILE SRAM
内存宽度4
功能数量1
端口数量1
端子数量18
字数64 words
字数代码64
工作模式ASYNCHRONOUS
最高工作温度85 °C
最低工作温度-40 °C
组织64X4
输出特性3-STATE
可输出NO
封装主体材料PLASTIC/EPOXY
封装代码DIP
封装等效代码DIP18,.3
封装形状RECTANGULAR
封装形式IN-LINE
并行/串行PARALLEL
峰值回流温度(摄氏度)240
电源5 V
认证状态Not Qualified
座面最大高度4.57 mm
最大压摆率0.04 mA
最大供电电压 (Vsup)5.5 V
最小供电电压 (Vsup)4.5 V
标称供电电压 (Vsup)5 V
表面贴装NO
技术CMOS
温度等级INDUSTRIAL
端子面层TIN LEAD
端子形式THROUGH-HOLE
端子节距2.54 mm
端子位置DUAL
处于峰值回流温度下的最长时间30
宽度7.62 mm
Base Number Matches1

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CAT22C10
256-Bit Nonvolatile CMOS Static RAM
FEATURES
s
Single 5V Supply
s
Fast RAM Access Times:
s
Low CMOS Power Consumption:
–200ns
–300ns
s
Infinite E
2
PROM to RAM Recall
s
CMOS and TTL Compatible I/O
s
Power Up/Down Protection
s
100,000 Program/Erase Cycles (E
2
PROM)
–Active: 40mA Max.
–Standby: 30
µ
A Max.
s
JEDEC Standard Pinouts:
–18-pin DIP
–16-pin SOIC
s
10 Year Data Retention
s
Commercial, Industrial and Automotive
Temperature Ranges
DESCRIPTION
The CAT22C10 NVRAM is a 256-bit nonvolatile memory
organized as 64 words x 4 bits. The high speed Static
RAM array is bit for bit backed up by a nonvolatile
E
2
PROM array which allows for easy transfer of data
from RAM array to E
2
PROM (STORE) and from
E
2
PROM to RAM (RECALL). STORE operations are
completed in 10ms max. and RECALL operations typi-
cally within 1.5µs. The CAT22C10 features unlimited
RAM write operations either through external RAM
writes or internal recalls from E
2
PROM. Internal false
store protection circuitry prohibits STORE operations
when V
CC
is less than 3.0V.
The CAT22C10 is manufactured using Catalyst’s ad-
vanced CMOS floating gate technology. It is designed
to endure 100,000 program/erase cycles (E
2
PROM)
and has a data retention of 10 years. The device is
available in JEDEC approved 18-pin plastic DIP and 16-
pin SOIC packages.
PIN CONFIGURATION
DIP Package (P)
SOIC Package (J)
A4
A3
A2
A1
A0
CS
Vss
STORE
PIN FUNCTIONS
Pin Name
A
0
–A
5
Function
Address
Data In/Out
Write Enable
Chip Select
Recall
Store
+5V
Ground
No Connect
NC
A4
A3
A2
A1
A0
CS
Vss
STORE
1
2
3
4
5
6
7
8
9
18
17
16
15
14
13
12
11
10
Vcc
NC
A5
I/O3
I/O2
I/O1
I/O0
WE
RECALL
22C10 F01
1
2
3
4
5
6
7
8
16
15
14
13
12
11
10
9
Vcc
A5
I/O4
I/O3
I/O2
I/O1
WE
RECALL
I/O
0
–I/O
3
WE
CS
RECALL
STORE
V
CC
V
SS
22C10 F02
NC
© 1998 by Catalyst Semiconductor, Inc.
Characteristics subject to change without notice
1
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