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P4KE13B0G: 产品描述Trans Voltage Suppressor Diode, 400W, 10.5V V(RWM), Unidirectional, 1 Element, Silicon, DO-204AL, DO-41, 2 PIN; 产品类别分立半导体二极管; 文件大小212KB，共6页; 制造商Taiwan Semiconductor; 官网地址http://www.taiwansemi.com/; 标准

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P4KE13B0G概述

Trans Voltage Suppressor Diode, 400W, 10.5V V(RWM), Unidirectional, 1 Element, Silicon, DO-204AL, DO-41, 2 PIN

参数名称	属性值
是否Rohs认证	符合
包装说明	O-PALF-W2
Reach Compliance Code	compliant
ECCN代码	EAR99
其他特性	EXCELLENT CLAMPING CAPABILITY, UL RECOGNIZED
最大击穿电压	14.3 V
最小击穿电压	11.7 V
外壳连接	ISOLATED
配置	SINGLE
二极管元件材料	SILICON
二极管类型	TRANS VOLTAGE SUPPRESSOR DIODE
JEDEC-95代码	DO-204AL
JESD-30 代码	O-PALF-W2
JESD-609代码	e3
最大非重复峰值反向功率耗散	400 W
元件数量	1
端子数量	2
最高工作温度	175 °C
最低工作温度	-55 °C
封装主体材料	PLASTIC/EPOXY
封装形状	ROUND
封装形式	LONG FORM
峰值回流温度（摄氏度）	NOT SPECIFIED
极性	UNIDIRECTIONAL
最大功率耗散	1 W
最大重复峰值反向电压	10.5 V
表面贴装	NO
技术	AVALANCHE
端子面层	PURE TIN
端子形式	WIRE
端子位置	AXIAL
处于峰值回流温度下的最长时间	NOT SPECIFIED
Base Number Matches	1

FPGA DSP 通信，用EMIF接口: 请问有人做过FPGA与DSP通信吗？用EMIF接口，在FPGA上我用的是内部fifo，那些fifo的接口与DSP的引脚该怎么连呀？我现在的结果是感觉接受不同步...; wangyaoli FPGA/CPLD

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CPLD有一个管脚不工作: 程序烧写成功后，CPLD的触发管脚一直处于高阻态，整个电路一上电就触发，想知道是CPLD的问题还是PCB 的问题。若是CPLD 的问题，那CPLD 是根据什么判断电路已经触发，然后执行程序的？...; xiaxuedehai FPGA/CPLD

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器件捷径: S0 S1 S2 S3 S4 S5 S6 S7 S8 S9 SA SB SC SD SE SF SG SH SI SJ SK SL SM SN SO SP SQ SR SS ST SU SV SW SX SY SZ T0 T1 T2 T3 T4 T5 T6 T7 T8 T9 TA TB TC TD TE TF TG TH TI TJ TK TL TM TN TO TP TQ TR TS TT TU TV TW TX TY TZ U0 U1 U2 U3 U4 U6 U7 U8 UA UB UC UD UE UF UG UH UI UJ UK UL UM UN UP UQ UR US UT UU UV UW UX UZ V0 V1 V2 V3 V4 V5 V6 V7 V8 V9 VA VB VC VD VE VF VG VH VI VJ VK VL VM VN VO VP VQ VR VS VT VU VV VW VX VY VZ W0 W1 W2 W3 W4 W5 W6 W7 W8 W9 WA WB WC WD WE WF WG WH WI WJ WK WL WM WN WO WP WR WS WT WU WV WW WY X0 X1 X2 X3 X4 X5 X7 X8 X9 XA XB XC XD XE XF XG XH XK XL XM XN XO XP XQ XR XS XT XU XV XW XX XY XZ Y0 Y1 Y2 Y4 Y5 Y6 Y9 YA YB YC YD YE YF YG YH YK YL YM YN YP YQ YR YS YT YX Z0 Z1 Z2 Z3 Z4 Z5 Z6 Z8 ZA ZB ZC ZD ZE ZF ZG ZH ZJ ZL ZM ZN ZP ZR ZS ZT ZU ZV ZW ZX ZY

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