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L-USS820FD-DB: 产品描述USB Bus Controller, CMOS, PBGA48, LEAD FREE, TFSBGAC-48; 产品类别嵌入式处理器和控制器微控制器和处理器; 文件大小828KB，共56页; 制造商LSC/CSI; 官网地址https://lsicsi.com; 标准

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L-USS820FD-DB概述

USB Bus Controller, CMOS, PBGA48, LEAD FREE, TFSBGAC-48

L-USS820FD-DB规格参数

参数名称	属性值
是否无铅	不含铅
是否Rohs认证	符合
零件包装代码	BGA
包装说明	LFBGA, BGA48,8X8,20
针数	48
Reach Compliance Code	unknown
地址总线宽度	5
最大时钟频率	12.024 MHz
外部数据总线宽度	8
JESD-30 代码	S-PBGA-B48
JESD-609代码	e1
长度	5 mm
端子数量	48
最高工作温度	85 °C
最低工作温度
封装主体材料	PLASTIC/EPOXY
封装代码	LFBGA
封装等效代码	BGA48,8X8,20
封装形状	SQUARE
封装形式	GRID ARRAY, LOW PROFILE, FINE PITCH
峰值回流温度（摄氏度）	260
电源	3.3 V
认证状态	Not Qualified
座面最大高度	1.44 mm
最大压摆率	30 mA
最大供电电压	3.465 V
最小供电电压	3.135 V
标称供电电压	3.3 V
表面贴装	YES
技术	CMOS
温度等级	OTHER
端子面层	Tin/Silver/Copper (Sn/Ag/Cu)
端子形式	BALL
端子节距	0.5 mm
端子位置	BOTTOM
处于峰值回流温度下的最长时间	10
宽度	5 mm
uPs/uCs/外围集成电路类型	BUS CONTROLLER, UNIVERSAL SERIAL BUS
Base Number Matches	1

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Data Sheet, Rev. 2

May 2006

USS-820FD

USB 2.0 Full-Speed Device Controller

Features

■

New Features After Revision B

■

Full compliance with the

Universal Serial Bus

Specification Revision 2.0.

Backward compatible with USS-820B, USS-820C,

and USS-820D revisions.

Self-powered or bus-powered USB device. Meets

USB power specifications for bus-powered

devices.

Full-speed USB device (12 Mbits/s).

USB device controller with protocol control and

administration for up to 16 USB endpoints.

Supports control, interrupt, bulk, and isochronous

transfers for all 16 endpoints.

Programmable endpoint types, FIFO sizes, and

internal 1120-byte logical (2240-byte physical for

dual-packet mode) shared FIFO storage allow a

wide variety of configurations.

Dual-packet mode of FIFOs reduces latency.

Supports USB remote wake-up feature.

On-chip crystal oscillator allows external 12 MHz

crystal or 3 V/5 V clock source.

On-chip analog PLL creates 48 MHz clock from

internal 12 MHz clock.

Integrated USB transceivers.

5 V tolerant I/O buffers allow operation in 3 V or

5 V system environments for 0 °C to 70 °C temper-

ature range.

5 V tolerant I/O buffers allow operation in 3 V only

system environments for –20 °C to +85 °C temper-

ature range.

Implemented in Agere Systems Inc. 0.25

µm,

3 V

standard-cell library.

48-ball TFSBGAC. (Lead-free package also avail-

able. See Ordering Information on page 51.)

Evaluation kit available.

New, centralized FIFO status bits and interrupt out-

put pin reduce firmware load.

New, additional nonisochronous transmit mode

allows NAK response to cause interrupt.

Isochronous behavior enhancements simplify firm-

ware control.

Additional FIFO sizes for nonisochronous end-

points.

USB reset can be programmed to clear device

address.

USB reset output status pin.

Firmware ability to wake up and reset a suspended

device.

Lower power.

5 V supply no longer required for 5 V tolerant oper-

ation.

■

Applications

■

Suitable for peripherals with embedded micropro-

cessors.

Glueless interface to microprocessor buses.

Support of multifunction USB implementations,

such as printer/scanner and integrated multimedia

applications.

Suitable for a broad range of device class peripher-

als in the USB standard.

■

Note:

Advisories are issued as needed to update

product information. When using this data

sheet for design purposes, please contact

your Agere Systems Account Manager to

obtain the latest advisory on this product.

■

USS-820FD

USB 2.0 Full-Speed Device Controller

Data Sheet, Rev. 2

May 2006

Table of Contents

Contents

Page

Features ....................................................................................................................................................................1

New Features After Revision B .................................................................................................................................1

Applications ...............................................................................................................................................................1

Description.................................................................................................................................................................3

Serial Interface Engine........................................................................................................................................ 3

Protocol Layer ..................................................................................................................................................... 4

FIFO Control ....................................................................................................................................................... 4

FIFO Programmability ......................................................................................................................................... 4

FIFO Access ....................................................................................................................................................... 4

Transmit FIFO .............................................................................................................................................. 5

Receive FIFO ............................................................................................................................................... 6

Pin Information ......................................................................................................................................................... 7

Register Timing Characteristics................................................................................................................................. 9

Register Interface ....................................................................................................................................................11

Special Firmware Action for Shared Register Bits ............................................................................................13

Register Reads with Side Effects......................................................................................................................14

Register Descriptions ........................................................................................................................................15

Interrupts .................................................................................................................................................................40

Firmware Responsibilities for USB SETUP Commands..........................................................................................41

Other Firmware Responsibilities..............................................................................................................................42

Frame Timer Behavior.............................................................................................................................................42

Suspend and Resume Behavior..............................................................................................................................42

Hardware Suspend Detect ................................................................................................................................43

Firmware Suspend Initiate ................................................................................................................................43

Hardware Resume Detect/Initiate .....................................................................................................................44

Hardware Resume Sequence ...........................................................................................................................44

Firmware Resume Sequence ...........................................................................................................................44

Special Suspend Considerations for Bus-Powered Devices.............................................................................44

Application Notes.....................................................................................................................................................46

USB Application Support Contact Information.........................................................................................................46

Absolute Maximum Ratings.....................................................................................................................................46

Electrical Characteristics .........................................................................................................................................47

dc Characteristics .............................................................................................................................................47

Power Considerations .......................................................................................................................................48

USB Transceiver Driver Characteristics............................................................................................................48

Connection Requirements ................................................................................................................................49

USB Transceiver Connection .....................................................................................................................49

Oscillator Connection Requirements ..........................................................................................................50

Outline Diagrams.....................................................................................................................................................51

48-Ball TFSBGAC (USS-820FD) ......................................................................................................................51

Ordering Information................................................................................................................................................51

Appendix A. Special Function Register Bit Names..................................................................................................52

Appendix B. USS-820FD Register Map ..................................................................................................................53

Appendix C. Changes from USS-820/USS-825 Revision B to C ............................................................................54

Appendix D. Changes from USS-820 Revision C to D............................................................................................55

Appendix E. Changes from USS-820 Revision D to FD..........................................................................................55

Agere Systems Inc.

Data Sheet, Rev. 2

May 2006

USS-820FD

USB 2.0 Full-Speed Device Controller

Description

(continued)

FIFO Access

(continued)

Transmit FIFO

The transmit FIFOs are circulating data buffers that have the following features:

■

Support up to two separate data sets of variable sizes (dual-packet mode).

Include byte counter register for storing the number of bytes in the data sets.

Protect against overwriting data in a full FIFO.

Can retransmit the current data set.

All transmit FIFOs use the same architecture (see Figure 2). The transmit FIFO and its associated logic can man-

age up to two data sets: data set 0 (ds0) and data set 1 (ds1). Since two data sets can be used in the FIFO, back-

to-back transmissions are supported. Dual-packet mode for transmit FIFOs is enabled by default. Single-packet

mode can be enforced by firmware convention (see TXFIF register bits).

The CPU writes to the FIFO location that is specified by the write pointer. After a write, the write pointer automati-

cally increments by 1. The read marker points to the first byte of data written to a data set, and the read pointer

points to the next FIFO location to be read by the USB interface. After a read, the read pointer automatically incre-

ments by 1.

When a good transmission is completed, the read marker can be advanced to the position of the read pointer to set

up for reading the next data set. When a bad transmission is completed, the read pointer can be reversed to the

position of the read marker to enable the function interface to reread the last data set for retransmission. The read

marker advance and read pointer reversal can be achieved two ways: explicitly by firmware or automatically by

hardware, as indicated by bits in the transmit FIFO control register (TXCON).

FROM CPU

WRITE POINTER

CPU

WRITES TO FIFO

DATA SET 1

SIE READS FIFO

TXDAT

READ POINTER

TO USB INTERFACE

BYTE COUNT

REGISTERS

TXCNTH

TXCNTL

DATA SET 0

REVRP

ADVRM

READ MARKER

5-5206

Figure 2. Transmit FIFO

Agere Systems Inc.

L-USS820FD-DB相似产品对比

	L-USS820FD-DB	USS820FD
描述	USB Bus Controller, CMOS, PBGA48, LEAD FREE, TFSBGAC-48	USB Bus Controller, CMOS, PBGA48, TFSBGAC-48
是否无铅	不含铅	含铅
是否Rohs认证	符合	不符合
零件包装代码	BGA	BGA
包装说明	LFBGA, BGA48,8X8,20	LFBGA, BGA48,8X8,20
针数	48	48
Reach Compliance Code	unknown	compliant
地址总线宽度	5	5
最大时钟频率	12.024 MHz	12.024 MHz
外部数据总线宽度	8	8
JESD-30 代码	S-PBGA-B48	S-PBGA-B48
JESD-609代码	e1	e0
长度	5 mm	5 mm
端子数量	48	48
最高工作温度	85 °C	85 °C
封装主体材料	PLASTIC/EPOXY	PLASTIC/EPOXY
封装代码	LFBGA	LFBGA
封装等效代码	BGA48,8X8,20	BGA48,8X8,20
封装形状	SQUARE	SQUARE
封装形式	GRID ARRAY, LOW PROFILE, FINE PITCH	GRID ARRAY, LOW PROFILE, FINE PITCH
峰值回流温度（摄氏度）	260	240
电源	3.3 V	3.3 V
认证状态	Not Qualified	Not Qualified
座面最大高度	1.44 mm	1.44 mm
最大压摆率	30 mA	30 mA
最大供电电压	3.465 V	3.465 V
最小供电电压	3.135 V	3.135 V
标称供电电压	3.3 V	3.3 V
表面贴装	YES	YES
技术	CMOS	CMOS
温度等级	OTHER	OTHER
端子面层	Tin/Silver/Copper (Sn/Ag/Cu)	TIN LEAD
端子形式	BALL	BALL
端子节距	0.5 mm	0.5 mm
端子位置	BOTTOM	BOTTOM
处于峰值回流温度下的最长时间	10	30
宽度	5 mm	5 mm
uPs/uCs/外围集成电路类型	BUS CONTROLLER, UNIVERSAL SERIAL BUS	BUS CONTROLLER, UNIVERSAL SERIAL BUS
Base Number Matches	1	1

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