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IDT70V927S25PRF8

产品描述Dual-Port SRAM, 32KX16, 25ns, CMOS, PQFP128, TQFP-128
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文件大小194KB,共14页
制造商IDT (Integrated Device Technology)
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IDT70V927S25PRF8概述

Dual-Port SRAM, 32KX16, 25ns, CMOS, PQFP128, TQFP-128

IDT70V927S25PRF8规格参数

参数名称属性值
是否无铅含铅
是否Rohs认证不符合
零件包装代码QFP
包装说明TQFP-128
针数128
Reach Compliance Codecompliant
ECCN代码EAR99
最长访问时间25 ns
JESD-30 代码R-PQFP-G128
JESD-609代码e0
长度20 mm
内存密度524288 bit
内存集成电路类型DUAL-PORT SRAM
内存宽度16
湿度敏感等级3
功能数量1
端口数量2
端子数量128
字数32768 words
字数代码32000
工作模式SYNCHRONOUS
最高工作温度70 °C
最低工作温度
组织32KX16
输出特性3-STATE
可输出YES
封装主体材料PLASTIC/EPOXY
封装代码LFQFP
封装形状RECTANGULAR
封装形式FLATPACK, LOW PROFILE, FINE PITCH
并行/串行PARALLEL
峰值回流温度(摄氏度)240
认证状态Not Qualified
座面最大高度1.6 mm
最大供电电压 (Vsup)3.6 V
最小供电电压 (Vsup)3 V
标称供电电压 (Vsup)3.3 V
表面贴装YES
技术CMOS
温度等级COMMERCIAL
端子面层TIN LEAD
端子形式GULL WING
端子节距0.5 mm
端子位置QUAD
处于峰值回流温度下的最长时间20
宽度14 mm
Base Number Matches1

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HIGH-SPEED 3.3V 32K x 16
SYNCHRONOUS
DUAL-PORT STATIC RAM
Features
x
x
PRELIMINARY
IDT70V927S/L
x
x
x
x
True Dual-Ported memory cells which allow simultaneous
access of the same memory location
High-speed clock to data access
– Commercial: 25/30ns
Low-power operation
– IDT70V927S
Active: 550mW (typ.)
Standby: 3.3mW (typ.)
– IDT70V927L
Active: 550mW (typ.)
Standby: 660mW (typ.)
Flow-Through output mode
Counter enable and reset features
Dual chip enables allow for depth expansion without
additional logic
x
x
x
x
x
Full synchronous operation on both ports
– 4ns setup to clock and 1ns hold on all control, data, and
address inputs
– Data input, address, and control registers
– Fast 25ns clock to data out
– Self-timed write allows fast cycle time
– 30ns cycle time, 33MHz operation
Separate upper-byte and lower-byte controls for
multiplexed bus and bus matching compatibility
LVTTL- compatible, single 3.3V (±0.3V) power supply
Industrial temperature range (-40°C to +85°C) is available
for selected speeds
Available in a 128 pin Thin Quad Flatpack
Functional Block Diagram
R/W
L
UB
L
CE
0L
CE
1L
LB
L
OE
L
R/W
R
UB
R
CE
0R
CE
1R
LB
R
OE
R
I/O
8L
-I/O
15L
I/O
0L
-I/O
7L
I/O
8R
-I/O
15R
I/O
Control
I/O
Control
I/O
0R
-I/O
7R
A
14L
A
0L
CLK
L
ADS
L
CNTEN
L
CNTRST
L
Counter/
Address
Reg.
MEMORY
ARRAY
Counter/
Address
Reg.
A
14R
A
0R
CLK
R
ADS
R
CNTEN
R
CNTRST
R
3749 drw 01
SEPTEMBER 1999
1
©1999 Integrated Device Technology, Inc.
DSC 3749/4

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