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MK1705A: 产品描述Video Clock Generator, 167MHz, CMOS, PDSO8, 0.150 INCH, SOIC-8; 产品类别嵌入式处理器和控制器微控制器和处理器; 文件大小60KB，共4页; 制造商IDT (Integrated Device Technology)

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MK1705A概述

Video Clock Generator, 167MHz, CMOS, PDSO8, 0.150 INCH, SOIC-8

MK1705A规格参数

参数名称	属性值
是否无铅	含铅
是否Rohs认证	不符合
厂商名称	IDT (Integrated Device Technology)
零件包装代码	SOIC
包装说明	SOIC-8
针数	8
Reach Compliance Code	not_compliant
ECCN代码	EAR99
Is Samacsys	N
JESD-30 代码	R-PDSO-G8
JESD-609代码	e0
长度	4.9 mm
湿度敏感等级	1
端子数量	8
最高工作温度	70 °C
最低工作温度
最大输出时钟频率	167 MHz
封装主体材料	PLASTIC/EPOXY
封装代码	SOP
封装形状	RECTANGULAR
封装形式	SMALL OUTLINE
峰值回流温度（摄氏度）	240
主时钟/晶体标称频率	167 MHz
认证状态	Not Qualified
座面最大高度	1.75 mm
最大供电电压	5.5 V
最小供电电压	3 V
标称供电电压	3.3 V
表面贴装	YES
技术	CMOS
温度等级	COMMERCIAL
端子面层	Tin/Lead (Sn85Pb15)
端子形式	GULL WING
端子节距	1.27 mm
端子位置	DUAL
处于峰值回流温度下的最长时间	30
宽度	3.9 mm
uPs/uCs/外围集成电路类型	CLOCK GENERATOR, VIDEO
Base Number Matches	1

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ICRO

LOCK

Description

The MK1705A generates a low EMI output clock

from a clock or crystal input. The part is designed

to dither the LCD interface clock or other clocks

for ATI’s flat panel graphics controllers. The

device uses ICS/MicroClock’s proprietary mixture

of analog and digital Phase-Locked Loop (PLL)

technology to synthesize the frequency, and our

patented technique to spread the frequency

spectrum of the output, thereby reducing the

frequency amplitude peaks by several dB.

The MK1705A is designed to have the output

spread centered around the input frequency. Refer

to the MK1704A for spreading down from the

input frequency, or the MK1714-0x for a crystal

input and the widest selection of spread rates and

multipliers.

We offer many other clocks for computers and

computer peripherals. Consult us when you need

to remove crystals and oscillators from your board.

MK1705A

ATI Low EMI Clock Generator

Features

• Packaged in 8 pin SOIC

• Provides a spread spectrum output clock

• Supports ATI’s flat panel controllers

• Accepts a clock input, provides same frequency

dithered output

• Good for all VGA modes from 40 to 167 MHz

• Peak reduction by 7dB - 14 dB typical on 3rd-

19th odd harmonics

• Low EMI feature can be disabled

• 3.3 V or 5 V ±10% supply voltage

• Advanced, low power CMOS process

Block Diagram

VDD GND

Low EMI Enable

Power Down

Input

Buffer

PLL Clock

Synthesis and

Spread Spectrum

Circuitry

Output

Buffer

Clock Out

Input Clock

MDS 1705A B

Revision 8090

Printed 8/9/00

Integrated Circuit Systems, Inc. •525 Race Street•San Jose•CA • 95126 • (408)295-9800tel • www.icst.com

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