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SI5411EDU-T1-GE3

产品描述漏源电压(Vdss):12V 连续漏极电流(Id)(25°C 时):25A(Tc) 栅源极阈值电压:900mV @ 250uA 漏源导通电阻:8.2mΩ @ 6A,4.5V 最大功率耗散(Ta=25°C):31W(Tc) 类型:P沟道 P沟道,-12V,-25A,0.0082Ω@-4.5V
产品类别分立半导体    MOS(场效应管)   
文件大小170KB,共9页
制造商Vishay(威世)
官网地址http://www.vishay.com
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SI5411EDU-T1-GE3在线购买

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SI5411EDU-T1-GE3概述

漏源电压(Vdss):12V 连续漏极电流(Id)(25°C 时):25A(Tc) 栅源极阈值电压:900mV @ 250uA 漏源导通电阻:8.2mΩ @ 6A,4.5V 最大功率耗散(Ta=25°C):31W(Tc) 类型:P沟道 P沟道,-12V,-25A,0.0082Ω@-4.5V

SI5411EDU-T1-GE3规格参数

参数名称属性值
漏源电压(Vdss)12V
连续漏极电流(Id)(25°C 时)25A(Tc)
栅源极阈值电压900mV @ 250uA
漏源导通电阻8.2mΩ @ 6A,4.5V
最大功率耗散(Ta=25°C)31W(Tc)
类型P沟道

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Si5411EDU
www.vishay.com
Vishay Siliconix
P-Channel 12 V (D-S) MOSFET
PRODUCT SUMMARY
V
DS
(V)
R
DS(on)
() (Max.)
0.0082 at V
GS
= - 4.5 V
- 12
0.0094 at V
GS
= - 3.7 V
0.0117 at V
GS
= - 2.5 V
0.0206 at V
GS
= - 1.8 V
PowerPAK ChipFET Single
1
2
D
D
D
D
D
D
G
S
S
FEATURES
I
D
(A)
- 25
a
- 25
a
- 25
a
- 15
43 nC
Q
g
(Typ.)
• TrenchFET
®
Power MOSFET
• Thermally Enhanced PowerPAK
®
ChipFET Package
- Small Footprint Area
- Low On-Resistance
• 100 % R
g
and UIS Tested
• Typical ESD Protection: 5000 V (HBM)
• Material categorization: For definitions of compliance
please see
www.vishay.com/doc?99912
APPLICATIONS
3
4
S
8
7
6
5
1.
m
9m
• Portable Devices such as Smart Phones,
Tablet PCs and Mobile Computing
- Battery Switch
- Load Switch
- Power Management
Marking Code
LB
XXX
Lot Traceability
and Date Code
G
Bottom View
Ordering Information:
Si5411EDU-T1-GE3 (Lead (Pb)-free and Halogen-free)
D
P-Channel MOSFET
Part # Code
ABSOLUTE MAXIMUM RATINGS
(T
C
= 25 °C, unless otherwise noted)
Parameter
Drain-Source Voltage
Gate-Source Voltage
T
C
= 25 °C
Continuous Drain Current (T
J
= 150 °C)
T
C
= 70 °C
T
A
= 25 °C
T
A
= 70 °C
Pulsed Drain Current (t = 100 μs)
Continuous Source-Drain Diode Current
Single Avalanche Current
Single Avalanche Energy
T
C
= 25 °C
T
A
= 25 °C
L = 0.1 mH
T
C
= 25 °C
Maximum Power Dissipation
T
C
= 70 °C
T
A
= 25 °C
T
A
= 70 °C
Operating Junction and Storage Temperature Range
Soldering Recommendations (Peak Temperature)
d, e
T
J
, T
stg
P
D
I
DM
I
S
I
AS
E
AS
I
D
Symbol
V
DS
V
GS
Limit
- 12
±8
- 25
a
- 25
a
- 16.5
b, c
- 13
b, c
- 140
- 25
a
- 2.6
b, c
- 15
11
31
20
3.1
b, c
2
b, c
- 50 to 150
260
°C
W
mJ
A
Unit
V
THERMAL RESISTANCE RATINGS
Parameter
Maximum
Junction-to-Ambient
b, f
t
5s
Steady State
Maximum Junction-to-Case (Drain)
Symbol
R
thJA
R
thJC
Typical
34
3
Maximum
40
4
Unit
°C/W
Notes
a. Package limited.
b. Surface mounted on 1" x 1" FR4 board.
c. t = 5 s.
d. See solder profile (www.vishay.com/doc?73257). The PowerPAK ChipFET is a leadless package. The end of the lead terminal is exposed
copper (not plated) as a result of the singulation process in manufacturing. A solder fillet at the exposed copper tip cannot be guaranteed
and is not required to ensure adequate bottom side solder interconnection.
e. Rework conditions: manual soldering with a soldering iron is not recommended for leadless components.
f. Maximum under steady state conditions is 90 °C/W.
S13-1662-Rev. A, 29-Jul-13
Document Number: 62879
1
For technical questions, contact:
pmostechsupport@vishay.com
THIS DOCUMENT IS SUBJECT TO CHANGE WITHOUT NOTICE. THE PRODUCTS DESCRIBED HEREIN AND THIS DOCUMENT
ARE SUBJECT TO SPECIFIC DISCLAIMERS, SET FORTH AT
www.vishay.com/doc?91000
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