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0ADKC9150-BE: 产品描述保险丝管 FUSE, CERAMIC TUBE 15A, 600VAC/500VDC; 产品类别电路保护保险丝保险丝管; 文件大小817KB，共5页; 制造商Bel Fuse; 标准

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保险丝管 FUSE, CERAMIC TUBE 15A, 600VAC/500VDC

文件夹游览SHBrowseForFolder标题问题: 大家好，最近我想写一个只游览文件夹的程序，这个程序运行有WNCE5.0上，主要代码如下，但当他运行时，却发现弹出的对话框不仅有“游览文件夹”这个标题，而且也有“select folder"这个标题，且出现的位置与背景都不对。我想知道这个原因是为什么？应怎样解决？CString strPath;LPMALLOCpMalloc;SHGetMalloc(&pMalloc);BROWSEINFObi;IT...; chely 嵌入式系统

2015年2月版主芯币奖励公告: [font=微软雅黑][size=4]根据EEWORLD版主规则及版主操作手册[/size][/font][align=left][url=https://bbs.eeworld.com.cn/thread-370268-1-1.html][font=微软雅黑][size=4][color=#0066cc]https://bbs.eeworld.com.cn/thread-370268-1-1.htm...; eric_wang 为我们提建议&公告

PCB基础知识（二）: [color=rgb(0,0,0)][font=SimSun][size=11pt]零件封装技术插入式封装技术（ Through Hole Technology）将零件安置在板子的一面，并将接脚焊在另一面上，这种技术称为「插入式（ ThroughHole Technology， THT）」封装。这种零件会需要占用大量的空间，并且要为每只接脚钻一个洞。所以它们的接脚其实占掉两面的空间，而且焊点也比较...; ohahaha PCB设计

FPGA设置IP核时，编译出错。。。: 最近搞ucgui到FPGA上面，软IP做好了。加入到QUARTUSII中，编译的时候，出错。我以前做到这步的时候是没有问题的，这次做的时候，用了一个ALT_PLL，50MHZ的时钟经倍频后，得到两个100MHZ的输出。在IP核里面，做了SDRAM,CFI_FLASH,RS232,16根TFT屏的数据线，9根控制线。其中两根输入用了上升沿中断，不知道哪里有问题。请高人指点一二。。。。...; shilaike FPGA/CPLD

28027launchpad的ADCINB0 ADCINB5 ADCINB5 是哪个引脚啊？？: 28027launchpad的ADCINB0 ADCINB5 ADCINB5 是哪个引脚啊？？。。原理图上貌似没找到...; jetlin1992 微控制器 MCU

器件捷径: E0 E1 E2 E3 E4 E5 E6 E7 E8 E9 EA EB EC ED EE EF EG EH EI EJ EK EL EM EN EO EP EQ ER ES ET EU EV EW EX EY EZ F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 FA FB FC FD FE FF FG FH FI FJ FK FL FM FN FO FP FQ FR FS FT FU FV FW FX FY FZ G0 G1 G2 G3 G4 G5 G6 G7 G8 G9 GA GB GC GD GE GF GG GH GI GJ GK GL GM GN GO GP GQ GR GS GT GU GV GW GX GZ H0 H1 H2 H3 H4 H5 H6 H7 H8 HA HB HC HD HE HF HG HH HI HJ HK HL HM HN HO HP HQ HR HS HT HU HV HW HX HY HZ I1 I2 I3 I4 I5 I6 I7 IA IB IC ID IE IF IG IH II IK IL IM IN IO IP IQ IR IS IT IU IV IW IX J0 J1 J2 J6 J7 JA JB JC JD JE JF JG JH JJ JK JL JM JN JP JQ JR JS JT JV JW JX JZ K0 K1 K2 K3 K4 K5 K6 K7 K8 K9 KA KB KC KD KE KF KG KH KI KJ KK KL KM KN KO KP KQ KR KS KT KU KV KW KX KY KZ

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