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7132LA100PDG

产品描述IC SRAM 16K PARALLEL 48DIP
产品类别存储   
文件大小150KB,共16页
制造商IDT(艾迪悌)
官网地址http://www.idt.com/
标准
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7132LA100PDG在线购买

供应商 器件名称 价格 最低购买 库存  
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7132LA100PDG概述

IC SRAM 16K PARALLEL 48DIP

7132LA100PDG规格参数

参数名称属性值
存储器类型易失
存储器格式SRAM
技术SRAM - 双端口,异步
存储容量16Kb (2K x 8)
写周期时间 - 字,页100ns
访问时间100ns
存储器接口并联
电压 - 电源4.5 V ~ 5.5 V
工作温度0°C ~ 70°C(TA)
安装类型通孔
封装/外壳48-DIP(0.600",15.24mm)
供应商器件封装48-PDIP

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HIGH SPEED
2K x 8 DUAL PORT
STATIC RAM
Features
IDT7132SA/LA
IDT7142SA/LA
LEAD FINISH (SnPb) ARE IN EOL PROCESS - LAST TIME BUY EXPIRES JUNE 15, 2018
High-speed access
– Commercial: 20/25/35/55/100ns (max.)
– Industrial: 25ns (max.)
– Military: 25/35/55/100ns (max.)
Low-power operation
– IDT7132/42SA
Active: 325mW (typ.)
Standby: 5mW (typ.)
– IDT7132/42LA
Active: 325mW (typ.)
Standby: 1mW (typ.)
MASTER IDT7132 easily expands data bus width to 16-or-more
bits using SLAVE IDT7142
On-chip port arbitration logic (IDT7132 only)
BUSY
output flag on IDT7132;
BUSY
input on IDT7142
Battery backup operation —2V data retention (LA only)
TTL-compatible, single 5V ±10% power supply
Available in 48-pin DIP, LCC and Flatpack, and 52-pin PLCC
packages
Military product compliant to MIL-PRF-38535 QML
Industrial temperature range (–40°C to +85°C) is available for
selected speeds
Green parts available, see ordering information
Functional Block Diagram
OE
L
CE
L
R/W
L
OE
R
CE
R
R/W
R
I/O
OL-
I/O
7L
I/O
Control
I/O
Control
I/O
OR-
I/O
7R
m
BUSY
L
(1,2)
A
10L
A
0L
Address
Decoder
11
BUSY
R
(1,2)
MEMORY
ARRAY
11
Address
Decoder
A
10R
A
0R
CE
L
OE
L
R/W
L
ARBITRATION
LOGIC
CE
R
OE
R
R/W
R
2692 drw 01
NOTES:
1. IDT7132 (MASTER):
BUSY
is open drain output and requires pullup resistor of 270Ω.
IDT7142 (SLAVE):
BUSY
is input.
2. Open drain output: requires pullup resistor of 270Ω.
JULY 2018
1
©2018 Integrated Device Technology, Inc.
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